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Arquitetura modular de processador multicore, flexível, segura e tolerante a falhas, para sistemas embarcados ciberfísicos.

Penteado, Cesar Giacomini

Biblioteca Digital de Teses e Dissertações da USP; Universidade de São Paulo; Escola Politécnica 2010-12-08

Acesso online. A biblioteca também possui exemplares impressos.

EPBC - Esc. Politécnica-Bib Central (FT-2906 Ed.rev. ) Disponível na Biblioteca
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EP-Bib. Central FT-2906 Item disponível 31200026131 DOCUMENTO IMPRESSO
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EP-Bib. Central FT-2906 Ed.rev. Item disponível 31200018386 DOCUMENTO IMPRESSO
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