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Superscalar microprocessor design
Superscalar microprocessor design
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Superscalar microprocessor design

Mike Johnson 1953-

Englewood Cliffs, N.J. Prentice Hall 1991

Localização: ICMC - Inst. Ciên. Mat. Computação    (68M05.20 J68sm e.1 )(Acessar)

2
Reduced Instruction Set Computers Then and Now
Reduced Instruction Set Computers Then and Now
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Artigo 		Adicionar ao Meu Espaço

Reduced Instruction Set Computers Then and Now

Patterson, David

Computer (Long Beach, Calif.), 2017-12, Vol.50 (12), p.10-12 [Periódico revisado por pares]

New York: IEEE

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3
Exploiting Direct Memory Operands in GPU Instructions
Exploiting Direct Memory Operands in GPU Instructions
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Artigo 		Adicionar ao Meu Espaço

Exploiting Direct Memory Operands in GPU Instructions

Mohammadpur-Fard, Ali ; Darabi, Sina ; Falahati, Hajar ; Mahani, Negin ; Sarbazi-Azad, Hamid

IEEE computer architecture letters, 2024, p.1-4 [Periódico revisado por pares]

IEEE

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4
Letters
Letters
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Artigo 		Adicionar ao Meu Espaço

Letters

Computer (Long Beach, Calif.), 2018-04, Vol.51 (4), p.4-7 [Periódico revisado por pares]

IEEE

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5
Insights from the 2016 Eckert-Mauchly Award Recipient
Insights from the 2016 Eckert-Mauchly Award Recipient
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Insights from the 2016 Eckert-Mauchly Award Recipient

Weiser, Uri

IEEE MICRO, 2017, Vol.37 (3), p.126-128 [Periódico revisado por pares]

Los Alamitos: IEEE

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Common Bonds: MIPS, HPS, Two-Level Branch Prediction, and Compressed Code RISC Processor
Common Bonds: MIPS, HPS, Two-Level Branch Prediction, and Compressed Code RISC Processor
Material Type:
Artigo 		Adicionar ao Meu Espaço

Common Bonds: MIPS, HPS, Two-Level Branch Prediction, and Compressed Code RISC Processor

Mutlu, Onur ; Belgard, Rich ; Gross, Thomas R. ; Jouppi, Norman R. ; Hennessy, John L. ; Przybylski, Steven ; Rowen, Chris ; Patt, Yale N. ; Hwu, Wen-Mei W. ; Melvin, Stephen W. ; Shebanow, Michael C. ; Yeh, Tse-Yu ; Wolfe, Andy

IEEE MICRO, 2016-07, Vol.36 (4), p.70-85 [Periódico revisado por pares]

Los Alamitos: IEEE

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Chapter 2 - CPUs
Chapter 2 - CPUs
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Capítulo de Livro 		Adicionar ao Meu Espaço

Chapter 2 - CPUs

Marilyn Wolf

High-Performance Embedded Computing, 2014, p.59-138

Elsevier Inc

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MicroASM: Academic simulator for x86 and MIPS32 assembly language
MicroASM: Academic simulator for x86 and MIPS32 assembly language
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MicroASM: Academic simulator for x86 and MIPS32 assembly language

2017 IEEE 37th Central America and Panama Convention (CONCAPAN XXXVII), 2017, p.1-5

IEEE

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16-Bit RISC processor design for convolution application
16-Bit RISC processor design for convolution application
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Ata de Congresso 		Adicionar ao Meu Espaço

16-Bit RISC processor design for convolution application

Sakthikumaran, S. ; Salivahanan, S. ; Bhaaskaran, V. S. K.

2011 International Conference on Recent Trends in Information Technology (ICRTIT), 2011, p.394-397

IEEE

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10
A Reduced Complexity Instruction Set architecture for low cost embedded processors
A Reduced Complexity Instruction Set architecture for low cost embedded processors
Material Type:
Ata de Congresso 		Adicionar ao Meu Espaço

A Reduced Complexity Instruction Set architecture for low cost embedded processors

Lozano, Hanni ; Ito, Mabo

2015 International Conference on High Performance Computing & Simulation (HPCS), 2015, p.400-407

IEEE

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  1. Johnson, M

Neste Assunto:

  1. Cisc
  2. Risc
  3. Cisc
  4. Reduced Instruction Set Computing
  5. Computer Architecture

  • Realização: ABCD-USP USP   Logos de Redes Sociais: Freepik

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