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Energy-Efficient Exposed Datapath Architecture With a RISC-V Instruction Set Mode
Energy-Efficient Exposed Datapath Architecture With a RISC-V Instruction Set Mode
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Energy-Efficient Exposed Datapath Architecture With a RISC-V Instruction Set Mode

Hepola, Kari ; Multanen, Joonas ; Jaaskelainen, Pekka

IEEE transactions on computers, 2024-02, Vol.73 (2), p.1-13 [Periódico revisado por pares]

IEEE

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Implementing Over 100 Command Codes for a High-Speed Hybrid Brain-Computer Interface Using Concurrent P300 and SSVEP Features
Implementing Over 100 Command Codes for a High-Speed Hybrid Brain-Computer Interface Using Concurrent P300 and SSVEP Features
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Implementing Over 100 Command Codes for a High-Speed Hybrid Brain-Computer Interface Using Concurrent P300 and SSVEP Features

Xu, Minpeng ; Han, Jin ; Wang, Yijun ; Jung, Tzyy-Ping ; Ming, Dong

IEEE transactions on biomedical engineering, 2020-11, Vol.67 (11), p.3073-3082 [Periódico revisado por pares]

United States: IEEE

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Dedicated Instruction Set for Pattern-based Data Transfers: an Experimental Validation on Systems Containing In-Memory Computing Units
Dedicated Instruction Set for Pattern-based Data Transfers: an Experimental Validation on Systems Containing In-Memory Computing Units
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Dedicated Instruction Set for Pattern-based Data Transfers: an Experimental Validation on Systems Containing In-Memory Computing Units

Mambu, Kevin ; Charles, Henri-Pierre ; Kooli, Maha

IEEE transactions on computer-aided design of integrated circuits and systems, 2023-11, Vol.42 (11), p.1-1 [Periódico revisado por pares]

New York: IEEE

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Compact Instruction Set Extensions for Kyber
Compact Instruction Set Extensions for Kyber
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Compact Instruction Set Extensions for Kyber

Li, Lu ; Qin, Guofeng ; Yu, Yang ; Wang, Weijia

IEEE transactions on computer-aided design of integrated circuits and systems, 2024-03, Vol.43 (3), p.1-1 [Periódico revisado por pares]

New York: IEEE

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RISC-V-Based Evaluation and Strategy Exploration of MRAM Triple-Level Hybrid Cache Systems
RISC-V-Based Evaluation and Strategy Exploration of MRAM Triple-Level Hybrid Cache Systems
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RISC-V-Based Evaluation and Strategy Exploration of MRAM Triple-Level Hybrid Cache Systems

Han, Shaopu ; Jiang, Yanfeng

IEEE transactions on very large scale integration (VLSI) systems, 2023-07, Vol.31 (7), p.1-13 [Periódico revisado por pares]

New York: IEEE

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Back to Homogeneous Computing: A Tightly-Coupled Neuromorphic Processor With Neuromorphic ISA
Back to Homogeneous Computing: A Tightly-Coupled Neuromorphic Processor With Neuromorphic ISA
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Back to Homogeneous Computing: A Tightly-Coupled Neuromorphic Processor With Neuromorphic ISA

Yang, Zhijie ; Wang, Lei ; Shi, Wei ; Wang, Yao ; Tie, Junbo ; Wang, Feng ; Yu, Xiang ; Peng, Linghui ; Xiao, Chao ; Xiao, Xun ; Yao, Yao ; Zhou, Gan ; Yu, Xuhu ; Gong, Rui ; Zhao, Xia ; Tang, Yuhua ; Xu, Weixia

IEEE transactions on parallel and distributed systems, 2023-11, Vol.34 (11), p.1-18 [Periódico revisado por pares]

IEEE

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DSIP: A Scalable Inference Accelerator for Convolutional Neural Networks
DSIP: A Scalable Inference Accelerator for Convolutional Neural Networks
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DSIP: A Scalable Inference Accelerator for Convolutional Neural Networks

Jo, Jihyuck ; Cha, Soyoung ; Rho, Dayoung ; Park, In-Cheol

IEEE journal of solid-state circuits, 2018-02, Vol.53 (2), p.605-618 [Periódico revisado por pares]

New York: IEEE

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In-memory Set Operations on Memristor Crossbar
In-memory Set Operations on Memristor Crossbar
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In-memory Set Operations on Memristor Crossbar

Kishori, Kajal ; Pyne, Sumanta

IEEE transactions on computer-aided design of integrated circuits and systems, 2023-12, Vol.42 (12), p.1-1 [Periódico revisado por pares]

New York: IEEE

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ISA Extensions of Shuffling Against Side-channel Attacks
ISA Extensions of Shuffling Against Side-channel Attacks
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ISA Extensions of Shuffling Against Side-channel Attacks

Zhou, Jiayun ; Qin, Guofeng ; Li, Lu ; Guo, Chun ; Wang, Weijia

IEEE transactions on computer-aided design of integrated circuits and systems, 2024-03, Vol.43 (3), p.1-1 [Periódico revisado por pares]

New York: IEEE

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10
Exact and approximate algorithms for the extension of embedded processor instruction sets
Exact and approximate algorithms for the extension of embedded processor instruction sets
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Exact and approximate algorithms for the extension of embedded processor instruction sets

Pozzi, L. ; Atasu, K. ; Ienne, P.

IEEE transactions on computer-aided design of integrated circuits and systems, 2006-07, Vol.25 (7), p.1209-1229 [Periódico revisado por pares]

New York: IEEE

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