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Design of Low-Power High-Speed Truncation-Error-Tolerant Adder and Its Application in Digital Signal Processing
Design of Low-Power High-Speed Truncation-Error-Tolerant Adder and Its Application in Digital Signal Processing
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Design of Low-Power High-Speed Truncation-Error-Tolerant Adder and Its Application in Digital Signal Processing

Zhu, Ning ; Goh, Wang Ling ; Zhang, Weija ; Yeo, Kiat Seng ; Kong, Zhi Hui

IEEE transactions on very large scale integration (VLSI) systems, 2010-08, Vol.18 (8), p.1225-1229 [Periódico revisado por pares]

New York, NY: IEEE

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2
Low-Power and Area-Efficient Carry Select Adder
Low-Power and Area-Efficient Carry Select Adder
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Low-Power and Area-Efficient Carry Select Adder

Ramkumar, B. ; Kittur, H. M.

IEEE transactions on very large scale integration (VLSI) systems, 2012-02, Vol.20 (2), p.371-375 [Periódico revisado por pares]

New York, NY: IEEE

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The Impact of NBTI Effect on Combinational Circuit: Modeling, Simulation, and Analysis
The Impact of NBTI Effect on Combinational Circuit: Modeling, Simulation, and Analysis
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The Impact of NBTI Effect on Combinational Circuit: Modeling, Simulation, and Analysis

Wenping Wang ; Shengqi Yang ; Bhardwaj, S. ; Vrudhula, S. ; Liu, F. ; Yu Cao

IEEE transactions on very large scale integration (VLSI) systems, 2010-02, Vol.18 (2), p.173-183 [Periódico revisado por pares]

New York, NY: IEEE

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Design of Testable Reversible Sequential Circuits
Design of Testable Reversible Sequential Circuits
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Design of Testable Reversible Sequential Circuits

Thapliyal, H. ; Ranganathan, N. ; Kotiyal, S.

IEEE transactions on very large scale integration (VLSI) systems, 2013-07, Vol.21 (7), p.1201-1209 [Periódico revisado por pares]

New York, NY: IEEE

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A universal method for designing low-power carbon nanotube FET-based multiple-valued logic circuits
A universal method for designing low-power carbon nanotube FET-based multiple-valued logic circuits
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A universal method for designing low-power carbon nanotube FET-based multiple-valued logic circuits

Moaiyeri, Mohammad Hossein ; Mirzaee, Reza Faghih ; Doostaregan, Akbar ; Navi, Keivan ; Hashemipour, Omid

IET computers & digital techniques, 2013-07, Vol.7 (4), p.167-181 [Periódico revisado por pares]

Stevenage: The Institution of Engineering and Technology

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Design of Robust, Energy-Efficient Full Adders for Deep-Submicrometer Design Using Hybrid-CMOS Logic Style
Design of Robust, Energy-Efficient Full Adders for Deep-Submicrometer Design Using Hybrid-CMOS Logic Style
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Design of Robust, Energy-Efficient Full Adders for Deep-Submicrometer Design Using Hybrid-CMOS Logic Style

Goel, S. ; Kumar, A. ; Bayoumi, M.A.

IEEE transactions on very large scale integration (VLSI) systems, 2006-12, Vol.14 (12), p.1309-1321 [Periódico revisado por pares]

Piscataway, NJ: IEEE

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Scalable Packet Classification on FPGA
Scalable Packet Classification on FPGA
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Scalable Packet Classification on FPGA

Weirong Jiang ; Prasanna, V. K.

IEEE transactions on very large scale integration (VLSI) systems, 2012-09, Vol.20 (9), p.1668-1680 [Periódico revisado por pares]

New York, NY: IEEE

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Design of Ternary Logic Combinational Circuits Based on Quantum Dot Gate FETs
Design of Ternary Logic Combinational Circuits Based on Quantum Dot Gate FETs
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Design of Ternary Logic Combinational Circuits Based on Quantum Dot Gate FETs

Karmakar, Supriya ; Chandy, John A. ; Jain, Faquir C.

IEEE transactions on very large scale integration (VLSI) systems, 2013-05, Vol.21 (5), p.793-806 [Periódico revisado por pares]

New York, NY: IEEE

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Understanding the Effect of Process Variations on the Delay of Static and Domino Logic
Understanding the Effect of Process Variations on the Delay of Static and Domino Logic
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Understanding the Effect of Process Variations on the Delay of Static and Domino Logic

Alioto, Massimo ; Palumbo, Gaetano ; Pennisi, Melita

IEEE transactions on very large scale integration (VLSI) systems, 2010-05, Vol.18 (5), p.697-710 [Periódico revisado por pares]

New York, NY: IEEE

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10
FPGA Based on Integration of CMOS and RRAM
FPGA Based on Integration of CMOS and RRAM
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FPGA Based on Integration of CMOS and RRAM

Tanachutiwat, S. ; Ming Liu ; Wei Wang

IEEE transactions on very large scale integration (VLSI) systems, 2011-11, Vol.19 (11), p.2023-2032 [Periódico revisado por pares]

New York, NY: IEEE

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