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1
N Point DCT VLSI Architecture for Emerging HEVC Standard
N Point DCT VLSI Architecture for Emerging HEVC Standard
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N Point DCT VLSI Architecture for Emerging HEVC Standard

Ahmed, Ashfaq ; Shahid, Muhammad Usman ; Rehman, Ata ur Norkin, Andrey

VLSI Design, 2012-01, Vol.2012 [Periódico revisado por pares]

New York: Hindawi Limiteds

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2
Self-Healing Many-Core Architecture: Analysis and Evaluation
Self-Healing Many-Core Architecture: Analysis and Evaluation
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Self-Healing Many-Core Architecture: Analysis and Evaluation

Kamran, Arezoo ; Navabi, Zainalabedin Palesi, Maurizio

VLSI Design, 2016-01, Vol.2016, p.1-17 [Periódico revisado por pares]

New York: Hindawi Limiteds

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3
A Novel Scan Architecture for Low Power Scan-Based Testing
A Novel Scan Architecture for Low Power Scan-Based Testing
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A Novel Scan Architecture for Low Power Scan-Based Testing

Mojtabavi Naeini, Mahshid ; Ooi, Chia Yee Monteiro, Jose Carlos

VLSI Design, 2015-01, Vol.2015, p.1-13 [Periódico revisado por pares]

New York: Hindawi Limiteds

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4
Design of Smart Power-Saving Architecture for Network on Chip
Design of Smart Power-Saving Architecture for Network on Chip
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Design of Smart Power-Saving Architecture for Network on Chip

Lee, Trong-Yen ; Huang, Chi-Han Fan, Yu-Cheng

VLSI Design, 2014-01, Vol.2014 (2014), p.1-10 [Periódico revisado por pares]

New York: Hindawi Limiteds

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5
Implementation, Test Pattern Generation, and Comparative Analysis of Different Adder Circuits
Implementation, Test Pattern Generation, and Comparative Analysis of Different Adder Circuits
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Implementation, Test Pattern Generation, and Comparative Analysis of Different Adder Circuits

Saini, Vikas K. ; Akhter, Shamim ; Chauhan, Tanuj Lee, Chang-Ho

VLSI Design, 2016-01, Vol.2016, p.1-8 [Periódico revisado por pares]

New York: Hindawi Limiteds

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6
An Efficient Reconfigurable Architecture for Fingerprint Recognition
An Efficient Reconfigurable Architecture for Fingerprint Recognition
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An Efficient Reconfigurable Architecture for Fingerprint Recognition

Bhairannawar, Satish S. ; Raja, K. B. ; Venugopal, K. R. Khriji, Lazhar

VLSI Design, 2016-01, Vol.2016, p.1-22 [Periódico revisado por pares]

New York: Hindawi Limiteds

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7
Efficient Nonrecursive Bit-Parallel Karatsuba Multiplier for a Special Class of Trinomials
Efficient Nonrecursive Bit-Parallel Karatsuba Multiplier for a Special Class of Trinomials
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Efficient Nonrecursive Bit-Parallel Karatsuba Multiplier for a Special Class of Trinomials

Li, Yin ; Zhang, Yu ; Guo, Xiaoli Sun, Junqing

VLSI design (Yverdon, Switzerland), 2018-01, Vol.2018, p.1-7 [Periódico revisado por pares]

New York: Hindawi

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8
A Unified Approach to Mapping and Routing on a Network-on-Chip for Both Best-Effort and Guaranteed Service Traffic
A Unified Approach to Mapping and Routing on a Network-on-Chip for Both Best-Effort and Guaranteed Service Traffic
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A Unified Approach to Mapping and Routing on a Network-on-Chip for Both Best-Effort and Guaranteed Service Traffic

Hansson, Andreas ; Goossens, Kees ; Rădulescu, Andrei

VLSI Design, 2007-01, Vol.2007, p.1-16 [Periódico revisado por pares]

Hindawi Limiteds

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9
CORDIC Architectures: A Survey
CORDIC Architectures: A Survey
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CORDIC Architectures: A Survey

Lakshmi, B. ; Dhar, A. S. Choi, Kiyoung

VLSI Design, 2010-01, Vol.2010, p.1-19 [Periódico revisado por pares]

New York: Hindawi Limiteds

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10
Optimized Architecture Using a Novel Subexpression Elimination on Loeffler Algorithm for DCT-Based Image Compression
Optimized Architecture Using a Novel Subexpression Elimination on Loeffler Algorithm for DCT-Based Image Compression
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Optimized Architecture Using a Novel Subexpression Elimination on Loeffler Algorithm for DCT-Based Image Compression

Jridi, Maher ; Alfalou, Ayman ; Meher, Pramod Kumar Shafique, Muhammad

VLSI Design, 2012-01, Vol.2012, p.1-12 [Periódico revisado por pares]

New York: Hindawi Limiteds

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