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Design and simulation of a sensorless permanent magnet synchronous motor drive with microprocessor-based PI controller and dedicated hardware EKF estimator
Design and simulation of a sensorless permanent magnet synchronous motor drive with microprocessor-based PI controller and dedicated hardware EKF estimator
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Design and simulation of a sensorless permanent magnet synchronous motor drive with microprocessor-based PI controller and dedicated hardware EKF estimator

Kung, Ying-Shieh ; Thanh, Nguyen Phan ; Wang, Ming-Shyng

Applied mathematical modelling, 2015-10, Vol.39 (19), p.5816-5827 [Periódico revisado por pares]

Elsevier Inc

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Side-channel leakage models for RISC instruction set architectures from empirical data
Side-channel leakage models for RISC instruction set architectures from empirical data
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Side-channel leakage models for RISC instruction set architectures from empirical data

Seuschek, Hermann ; Rass, Stefan

Microprocessors and microsystems, 2016-11, Vol.47, p.74-81 [Periódico revisado por pares]

Elsevier B.V

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State of art innovative technique for management of scratchpad memory (scratch)
State of art innovative technique for management of scratchpad memory (scratch)
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State of art innovative technique for management of scratchpad memory (scratch)

Tabbassum, Kavita ; Talpur, Shahnawaz ; Khahro, Shahnwaz Farhan

Microprocessors and microsystems, 2019-10, Vol.70, p.31-37 [Periódico revisado por pares]

Kidlington: Elsevier B.V

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Design space exploration in many-core processors for sound synthesis of plucked string instruments
Design space exploration in many-core processors for sound synthesis of plucked string instruments
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Design space exploration in many-core processors for sound synthesis of plucked string instruments

Choi, Jiwon ; Kang, Myeongsu ; Kim, Yongmin ; Kim, Cheol-Hong ; Kim, Jong-Myon

Journal of parallel and distributed computing, 2013-11, Vol.73 (11), p.1506-1522 [Periódico revisado por pares]

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An adaptive multisite mapping for computationally intensive grid applications
An adaptive multisite mapping for computationally intensive grid applications
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An adaptive multisite mapping for computationally intensive grid applications

De Falco, Ivanoe ; Scafuri, Umberto ; Tarantino, Ernesto

Future generation computer systems, 2010-06, Vol.26 (6), p.857-867 [Periódico revisado por pares]

Elsevier B.V

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Real-time scheduling on heterogeneous system-on-chip architectures using an optimised artificial neural network
Real-time scheduling on heterogeneous system-on-chip architectures using an optimised artificial neural network
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Real-time scheduling on heterogeneous system-on-chip architectures using an optimised artificial neural network

Chillet, Daniel ; Eiche, Antoine ; Pillement, Sébastien ; Sentieys, Olivier

Journal of systems architecture, 2011-04, Vol.57 (4), p.340-353 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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Processor architecture exploration and synthesis of massively parallel multi-processor accelerators in application to LDPC decoding
Processor architecture exploration and synthesis of massively parallel multi-processor accelerators in application to LDPC decoding
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Processor architecture exploration and synthesis of massively parallel multi-processor accelerators in application to LDPC decoding

Jan, Yahya ; Jóźwiak, Lech

Microprocessors and microsystems, 2014-03, Vol.38 (2), p.152-169 [Periódico revisado por pares]

Elsevier B.V

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Special purpose processor for parameter identification of CNC second order servo systems on a low-cost FPGA platform
Special purpose processor for parameter identification of CNC second order servo systems on a low-cost FPGA platform
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Special purpose processor for parameter identification of CNC second order servo systems on a low-cost FPGA platform

Morales-Velazquez, Luis ; Romero-Troncoso, Rene de Jesus ; Osornio-Rios, Roque Alfredo ; Herrera-Ruiz, Gilberto ; Jesus de Santiago-Perez, J.

Mechatronics (Oxford), 2010-03, Vol.20 (2), p.265-272 [Periódico revisado por pares]

Oxford: Elsevier Ltd

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Dictionary-based program compression on customizable processor architectures
Dictionary-based program compression on customizable processor architectures
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Dictionary-based program compression on customizable processor architectures

Heikkinen, Jari ; Takala, Jarmo ; Corporaal, Henk

Microprocessors and microsystems, 2009-03, Vol.33 (2), p.139-153 [Periódico revisado por pares]

Elsevier B.V

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On the performance benefits of sharing and privatizing second and third-level cache memories in homogeneous multi-core architectures
On the performance benefits of sharing and privatizing second and third-level cache memories in homogeneous multi-core architectures
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On the performance benefits of sharing and privatizing second and third-level cache memories in homogeneous multi-core architectures

Sibai, Fadi N.

Microprocessors and microsystems, 2008-10, Vol.32 (7), p.405-412 [Periódico revisado por pares]

Elsevier B.V

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