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Basic issues in microprocessor architecture
Basic issues in microprocessor architecture
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Basic issues in microprocessor architecture

Flynn, M.J.

Journal of systems architecture, 1999-06, Vol.45 (12), p.939-948 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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2
Benchmarking SOI and bulk FinFET alternatives for PLANAR CMOS scaling succession
Benchmarking SOI and bulk FinFET alternatives for PLANAR CMOS scaling succession
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Benchmarking SOI and bulk FinFET alternatives for PLANAR CMOS scaling succession

Chiarella, T. ; Witters, L. ; Mercha, A. ; Kerner, C. ; Rakowski, M. ; Ortolland, C. ; Ragnarsson, L.-Å. ; Parvais, B. ; De Keersgieter, A. ; Kubicek, S. ; Redolfi, A. ; Vrancken, C. ; Brus, S. ; Lauwers, A. ; Absil, P. ; Biesemans, S. ; Hoffmann, T.

Solid-state electronics, 2010-09, Vol.54 (9), p.855-860 [Periódico revisado por pares]

Kidlington: Elsevier Ltd

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3
Use of FPGA or GPU-based architectures for remotely sensed hyperspectral image processing
Use of FPGA or GPU-based architectures for remotely sensed hyperspectral image processing
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Use of FPGA or GPU-based architectures for remotely sensed hyperspectral image processing

González, Carlos ; Sánchez, Sergio ; Paz, Abel ; Resano, Javier ; Mozos, Daniel ; Plaza, Antonio

Integration (Amsterdam), 2013-03, Vol.46 (2), p.89-103 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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4
Optimizing the live migration of virtual machine by CPU scheduling
Optimizing the live migration of virtual machine by CPU scheduling
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Optimizing the live migration of virtual machine by CPU scheduling

Jin, Hai ; Gao, Wei ; Wu, Song ; Shi, Xuanhua ; Wu, Xiaoxin ; Zhou, Fan

Journal of network and computer applications, 2011-07, Vol.34 (4), p.1088-1096 [Periódico revisado por pares]

Kidlington: Elsevier Ltd

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5
Graceful deadlock-free fault-tolerant routing algorithm for 3D Network-on-Chip architectures
Graceful deadlock-free fault-tolerant routing algorithm for 3D Network-on-Chip architectures
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Graceful deadlock-free fault-tolerant routing algorithm for 3D Network-on-Chip architectures

Ben Ahmed, Akram ; Ben Abdallah, Abderazek

Journal of parallel and distributed computing, 2014-04, Vol.74 (4), p.2229-2240 [Periódico revisado por pares]

Amsterdam: Elsevier Inc

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6
Compact thermal modeling for packaged microprocessor design with practical power maps
Compact thermal modeling for packaged microprocessor design with practical power maps
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Compact thermal modeling for packaged microprocessor design with practical power maps

Liu, Zao ; Tan, Sheldon X.-D. ; Wang, Hai ; Hua, Yingbo ; Gupta, Ashish

Integration (Amsterdam), 2014-01, Vol.47 (1), p.71-85 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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7
A novel design method for discrete time chaos based true random number generators
A novel design method for discrete time chaos based true random number generators
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A novel design method for discrete time chaos based true random number generators

Cicek, Ihsan ; Pusane, Ali Emre ; Dundar, Gunhan

Integration (Amsterdam), 2014-01, Vol.47 (1), p.38-47 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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8
Implication logic gates using spin-transfer-torque-operated magnetic tunnel junctions for intrinsic logic-in-memory
Implication logic gates using spin-transfer-torque-operated magnetic tunnel junctions for intrinsic logic-in-memory
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Implication logic gates using spin-transfer-torque-operated magnetic tunnel junctions for intrinsic logic-in-memory

Mahmoudi, Hiwa ; Windbacher, Thomas ; Sverdlov, Viktor ; Selberherr, Siegfried

Solid-state electronics, 2013-06, Vol.84, p.191-197 [Periódico revisado por pares]

Kidlington: Elsevier Ltd

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9
Design of two Low-Power full adder cells using GDI structure and hybrid CMOS logic style
Design of two Low-Power full adder cells using GDI structure and hybrid CMOS logic style
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Design of two Low-Power full adder cells using GDI structure and hybrid CMOS logic style

Foroutan, Vahid ; Taheri, MohammadReza ; Navi, Keivan ; Mazreah, Arash Azizi

Integration (Amsterdam), 2014-01, Vol.47 (1), p.48-61 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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10
Adaptive Census Transform: A novel hardware-oriented stereovision algorithm
Adaptive Census Transform: A novel hardware-oriented stereovision algorithm
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Adaptive Census Transform: A novel hardware-oriented stereovision algorithm

Perri, Stefania ; Corsonello, Pasquale ; Cocorullo, Giuseppe

Computer vision and image understanding, 2013-01, Vol.117 (1), p.29-41 [Periódico revisado por pares]

Amsterdam: Elsevier Inc

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