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Real-time scheduling on heterogeneous system-on-chip architectures using an optimised artificial neural network
Real-time scheduling on heterogeneous system-on-chip architectures using an optimised artificial neural network
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Real-time scheduling on heterogeneous system-on-chip architectures using an optimised artificial neural network

Chillet, Daniel ; Eiche, Antoine ; Pillement, Sébastien ; Sentieys, Olivier

Journal of systems architecture, 2011-04, Vol.57 (4), p.340-353 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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2
A consistency-free memory architecture for sort-last parallel rendering processors
A consistency-free memory architecture for sort-last parallel rendering processors
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A consistency-free memory architecture for sort-last parallel rendering processors

Park, Woo-Chan ; Kim, Cheong-Ghil ; Yoon, Duk-Ki ; Lee, Kil-Whan ; Kim, Il-San ; Han, Tack-Don

Journal of systems architecture, 2007-05, Vol.53 (5), p.272-284 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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3
Instruction level redundant number computations for fast data intensive processing in asynchronous processors
Instruction level redundant number computations for fast data intensive processing in asynchronous processors
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Instruction level redundant number computations for fast data intensive processing in asynchronous processors

Lee, Jeong-Gun ; Kim, Euiseok ; Lee, Dong-Ik

Journal of systems architecture, 2005-03, Vol.51 (3), p.151-164 [Periódico revisado por pares]

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4
Architectural differences of efficient sequential and parallel computers
Architectural differences of efficient sequential and parallel computers
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Architectural differences of efficient sequential and parallel computers

Forsell, Martti J.

Journal of systems architecture, 2002-07, Vol.47 (13), p.1017-1041 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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5
Optimal node placement in an optical packet switching Manhattan street network
Optimal node placement in an optical packet switching Manhattan street network
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Optimal node placement in an optical packet switching Manhattan street network

Komolafe, Olufemi ; Harle, David

Computer networks (Amsterdam, Netherlands : 1999), 2003-06, Vol.42 (2), p.251-260 [Periódico revisado por pares]

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6
Enhancing multiple-path speculative execution with predicate window shifting
Enhancing multiple-path speculative execution with predicate window shifting
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Enhancing multiple-path speculative execution with predicate window shifting

Tsai, Jenn-Yuan ; Yew, Pen-Chung

Journal of systems architecture, 1999-06, Vol.45 (12), p.1075-1095 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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7
Basic issues in microprocessor architecture
Basic issues in microprocessor architecture
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Basic issues in microprocessor architecture

Flynn, M.J.

Journal of systems architecture, 1999-06, Vol.45 (12), p.939-948 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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8
Multiple precision square root using the Dwandwa square-root algorithm
Multiple precision square root using the Dwandwa square-root algorithm
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Multiple precision square root using the Dwandwa square-root algorithm

Parthasarathi, Ranjani ; Jhunjhunwala, Ashok

Journal of systems architecture, 1997-11, Vol.44 (2), p.143-158 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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9
Boundary element quadrature schemes for multi- and many-core architectures
Boundary element quadrature schemes for multi- and many-core architectures
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Boundary element quadrature schemes for multi- and many-core architectures

Zapletal, Jan ; Merta, Michal ; Malý, Lukáš

Computers & mathematics with applications (1987), 2017-07, Vol.74 (1), p.157-173 [Periódico revisado por pares]

Oxford: Elsevier Ltd

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10
A Java processor architecture for embedded real-time systems
A Java processor architecture for embedded real-time systems
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A Java processor architecture for embedded real-time systems

Schoeberl, Martin

Journal of systems architecture, 2008, Vol.54 (1), p.265-286 [Periódico revisado por pares]

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