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An Open-Source Platform for High-Performance Non-Coherent On-Chip Communication
An Open-Source Platform for High-Performance Non-Coherent On-Chip Communication
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An Open-Source Platform for High-Performance Non-Coherent On-Chip Communication

Kurth, Andreas ; Ronninger, Wolfgang ; Benz, Thomas ; Cavalcante, Matheus ; Schuiki, Fabian ; Zaruba, Florian ; Benini, Luca

IEEE transactions on computers, 2021-08, p.1-1 [Periódico revisado por pares]

IEEE

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A systematic approach to exploring embedded system architectures at multiple abstraction levels
A systematic approach to exploring embedded system architectures at multiple abstraction levels
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A systematic approach to exploring embedded system architectures at multiple abstraction levels

Pimentel, A.D. ; Erbas, C. ; Polstra, S.

IEEE transactions on computers, 2006-02, Vol.55 (2), p.99-112 [Periódico revisado por pares]

New York: IEEE

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DyNNamic: Dynamically Reshaping, High Data-Reuse Accelerator for Compact DNNs
DyNNamic: Dynamically Reshaping, High Data-Reuse Accelerator for Compact DNNs
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DyNNamic: Dynamically Reshaping, High Data-Reuse Accelerator for Compact DNNs

Hanson, Edward ; Li, Shiyu ; Qian, Xuehai ; Li, Hai Helen ; Chen, Yiran

IEEE transactions on computers, 2023-03, Vol.72 (3), p.880-892 [Periódico revisado por pares]

New York: IEEE

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SqueezeFlow: A Sparse CNN Accelerator Exploiting Concise Convolution Rules
SqueezeFlow: A Sparse CNN Accelerator Exploiting Concise Convolution Rules
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SqueezeFlow: A Sparse CNN Accelerator Exploiting Concise Convolution Rules

Li, Jiajun ; Jiang, Shuhao ; Gong, Shijun ; Wu, Jingya ; Yan, Junchao ; Yan, Guihai ; Li, Xiaowei

IEEE transactions on computers, 2019-11, Vol.68 (11), p.1663-1677 [Periódico revisado por pares]

IEEE

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Lightweight Neural Architecture Search for Temporal Convolutional Networks at the Edge
Lightweight Neural Architecture Search for Temporal Convolutional Networks at the Edge
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Lightweight Neural Architecture Search for Temporal Convolutional Networks at the Edge

Risso, Matteo ; Burrello, Alessio ; Conti, Francesco ; Lamberti, Lorenzo ; Chen, Yukai ; Benini, Luca ; Macii, Enrico ; Poncino, Massimo ; Pagliari, Daniele Jahier

IEEE transactions on computers, 2023-03, Vol.72 (3), p.744-758 [Periódico revisado por pares]

IEEE

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An Architecture for Fault-Tolerant Computation with Stochastic Logic
An Architecture for Fault-Tolerant Computation with Stochastic Logic
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An Architecture for Fault-Tolerant Computation with Stochastic Logic

Weikang Qian ; Xin Li ; Riedel, M D ; Bazargan, K ; Lilja, D J

IEEE transactions on computers, 2011-01, Vol.60 (1), p.93-105 [Periódico revisado por pares]

New York: IEEE

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Snitch: A Tiny Pseudo Dual-Issue Processor for Area and Energy Efficient Execution of Floating-Point Intensive Workloads
Snitch: A Tiny Pseudo Dual-Issue Processor for Area and Energy Efficient Execution of Floating-Point Intensive Workloads
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Snitch: A Tiny Pseudo Dual-Issue Processor for Area and Energy Efficient Execution of Floating-Point Intensive Workloads

Zaruba, Florian ; Schuiki, Fabian ; Hoefler, Torsten ; Benini, Luca

IEEE transactions on computers, 2021-11, Vol.70 (11), p.1845-1860 [Periódico revisado por pares]

IEEE

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EnGN: A High-Throughput and Energy-Efficient Accelerator for Large Graph Neural Networks
EnGN: A High-Throughput and Energy-Efficient Accelerator for Large Graph Neural Networks
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EnGN: A High-Throughput and Energy-Efficient Accelerator for Large Graph Neural Networks

Liang, Shengwen ; Wang, Ying ; Liu, Cheng ; He, Lei ; Li, Huawei ; Xu, Dawen ; Li, Xiaowei

IEEE transactions on computers, 2021-09, Vol.70 (9), p.1511-1525 [Periódico revisado por pares]

IEEE

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LUTNet: Learning FPGA Configurations for Highly Efficient Neural Network Inference
LUTNet: Learning FPGA Configurations for Highly Efficient Neural Network Inference
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LUTNet: Learning FPGA Configurations for Highly Efficient Neural Network Inference

Wang, Erwei ; Davis, James J. ; Cheung, Peter Y. K. ; Constantinides, George A.

IEEE transactions on computers, 2020-12, Vol.69 (12), p.1795-1808 [Periódico revisado por pares]

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A Multi-Resolution FPGA-Based Architecture for Real-Time Edge and Corner Detection
A Multi-Resolution FPGA-Based Architecture for Real-Time Edge and Corner Detection
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A Multi-Resolution FPGA-Based Architecture for Real-Time Edge and Corner Detection

Possa, Paulo Ricardo ; Mahmoudi, Sidi Ahmed ; Harb, Naim ; Valderrama, Carlos ; Manneback, Pierre

IEEE transactions on computers, 2014-10, Vol.63 (10), p.2376-2388 [Periódico revisado por pares]

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