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Computation structures
Computation structures
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Computation structures

Stephen A. Ward Robert H Halstead

Cambridge, Mass. MIT Press New York McGraw-Hill c1990

Localização: EPBC - Esc. Politécnica-Bib Central    (004.2 W217c ) e outros locais(Acessar)

2
RANC: Reconfigurable Architecture for Neuromorphic Computing
RANC: Reconfigurable Architecture for Neuromorphic Computing
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RANC: Reconfigurable Architecture for Neuromorphic Computing

Mack, Joshua ; Purdy, Ruben ; Rockowitz, Kris ; Inouye, Michael ; Richter, Edward ; Valancius, Spencer ; Kumbhare, Nirmal ; Hassan, Md Sahil ; Fair, Kaitlin ; Mixter, John ; Akoglu, Ali

IEEE transactions on computer-aided design of integrated circuits and systems, 2021-11, Vol.40 (11), p.2265-2278 [Periódico revisado por pares]

New York: IEEE

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3
A Highly Secure FPGA-Based Dual-Hiding Asynchronous-Logic AES Accelerator Against Side-Channel Attacks
A Highly Secure FPGA-Based Dual-Hiding Asynchronous-Logic AES Accelerator Against Side-Channel Attacks
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A Highly Secure FPGA-Based Dual-Hiding Asynchronous-Logic AES Accelerator Against Side-Channel Attacks

Ng, Jun-Sheng ; Chen, Juncheng ; Chong, Kwen-Siong ; Chang, Joseph S. ; Gwee, Bah-Hwee

IEEE transactions on very large scale integration (VLSI) systems, 2022-09, Vol.30 (9), p.1144-1157 [Periódico revisado por pares]

New York: IEEE

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4
High-performance elliptic curve cryptography processor over NIST prime fields
High-performance elliptic curve cryptography processor over NIST prime fields
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High-performance elliptic curve cryptography processor over NIST prime fields

Hossain, Md Selim ; Kong, Yinan ; Saeedi, Ehsan ; Vayalil, Niras C

IET computers & digital techniques, 2017-01, Vol.11 (1), p.33-42 [Periódico revisado por pares]

The Institution of Engineering and Technology

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5
FeFET Multi-Bit Content-Addressable Memories for In-Memory Nearest Neighbor Search
FeFET Multi-Bit Content-Addressable Memories for In-Memory Nearest Neighbor Search
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Artigo 		Adicionar ao Meu Espaço

FeFET Multi-Bit Content-Addressable Memories for In-Memory Nearest Neighbor Search

Kazemi, Arman ; Sharifi, Mohammad Mehdi ; Laguna, Ann Franchesca ; Muller, Franz ; Yin, Xunzhao ; Kampfe, Thomas ; Niemier, Michael ; Hu, X. Sharon

IEEE transactions on computers, 2022-10, Vol.71 (10), p.2565-2576 [Periódico revisado por pares]

IEEE

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6
DeepBurning-GL: an Automated Framework for Generating Graph Neural Network Accelerators
DeepBurning-GL: an Automated Framework for Generating Graph Neural Network Accelerators
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Ata de Congresso 		Adicionar ao Meu Espaço

DeepBurning-GL: an Automated Framework for Generating Graph Neural Network Accelerators

Liang, Shengwen ; Liu, Cheng ; Wang, Ying ; Li, Huawei ; Li, Xiaowei

2020 IEEE/ACM International Conference On Computer Aided Design (ICCAD), 2020, p.1-9

Association on Computer Machinery

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7
High-speed VLSI architectures for the AES algorithm
High-speed VLSI architectures for the AES algorithm
Material Type:
Artigo 		Adicionar ao Meu Espaço

High-speed VLSI architectures for the AES algorithm

Xinmiao Zhang ; Parhi, K.K.

IEEE transactions on very large scale integration (VLSI) systems, 2004-09, Vol.12 (9), p.957-967 [Periódico revisado por pares]

Piscataway, NJ: IEEE

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8
4-Valued spectral transforms implementation on GPU with Tensor Cores
4-Valued spectral transforms implementation on GPU with Tensor Cores
Material Type:
Artigo 		Adicionar ao Meu Espaço

4-Valued spectral transforms implementation on GPU with Tensor Cores

Marković, Ivica ; Stojković, Suzana

The Journal of supercomputing, 2023, Vol.79 (1), p.51-74 [Periódico revisado por pares]

New York: Springer US

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9
EGRA: A Coarse Grained Reconfigurable Architectural Template
EGRA: A Coarse Grained Reconfigurable Architectural Template
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Artigo 		Adicionar ao Meu Espaço

EGRA: A Coarse Grained Reconfigurable Architectural Template

Ansaloni, Giovanni ; Bonzini, Paolo ; Pozzi, Laura

IEEE transactions on very large scale integration (VLSI) systems, 2011-06, Vol.19 (6), p.1062-1074 [Periódico revisado por pares]

New York, NY: IEEE

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10
Data-Driven Feature Selection Framework for Approximate Circuit Design
Data-Driven Feature Selection Framework for Approximate Circuit Design
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Artigo 		Adicionar ao Meu Espaço

Data-Driven Feature Selection Framework for Approximate Circuit Design

Zhao, Bingyin ; Qiu, Ling ; Lao, Yingjie

IEEE transactions on computer-aided design of integrated circuits and systems, 2023-11, Vol.42 (11), p.1-1 [Periódico revisado por pares]

New York: IEEE

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