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Software-Defined Networking: Challenges and research opportunities for Future Internet
Software-Defined Networking: Challenges and research opportunities for Future Internet
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Software-Defined Networking: Challenges and research opportunities for Future Internet

Hakiri, Akram ; Gokhale, Aniruddha ; Berthou, Pascal ; Schmidt, Douglas C. ; Gayraud, Thierry

Computer networks (Amsterdam, Netherlands : 1999), 2014-12, Vol.75, p.453-471 [Periódico revisado por pares]

Kidlington: Elsevier B.V

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Snitch: A Tiny Pseudo Dual-Issue Processor for Area and Energy Efficient Execution of Floating-Point Intensive Workloads
Snitch: A Tiny Pseudo Dual-Issue Processor for Area and Energy Efficient Execution of Floating-Point Intensive Workloads
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Snitch: A Tiny Pseudo Dual-Issue Processor for Area and Energy Efficient Execution of Floating-Point Intensive Workloads

Zaruba, Florian ; Schuiki, Fabian ; Hoefler, Torsten ; Benini, Luca

IEEE transactions on computers, 2021-11, Vol.70 (11), p.1845-1860 [Periódico revisado por pares]

IEEE

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A Combined SDC-SDF Architecture for Normal I/O Pipelined Radix-2 FFT
A Combined SDC-SDF Architecture for Normal I/O Pipelined Radix-2 FFT
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A Combined SDC-SDF Architecture for Normal I/O Pipelined Radix-2 FFT

Wang, Zeke ; Liu, Xue ; He, Bingsheng ; Yu, Feng

IEEE transactions on very large scale integration (VLSI) systems, 2015-05, Vol.23 (5), p.973-977 [Periódico revisado por pares]

IEEE

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24
LUTNet: Learning FPGA Configurations for Highly Efficient Neural Network Inference
LUTNet: Learning FPGA Configurations for Highly Efficient Neural Network Inference
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LUTNet: Learning FPGA Configurations for Highly Efficient Neural Network Inference

Wang, Erwei ; Davis, James J. ; Cheung, Peter Y. K. ; Constantinides, George A.

IEEE transactions on computers, 2020-12, Vol.69 (12), p.1795-1808 [Periódico revisado por pares]

IEEE

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25
A Multi-Resolution FPGA-Based Architecture for Real-Time Edge and Corner Detection
A Multi-Resolution FPGA-Based Architecture for Real-Time Edge and Corner Detection
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A Multi-Resolution FPGA-Based Architecture for Real-Time Edge and Corner Detection

Possa, Paulo Ricardo ; Mahmoudi, Sidi Ahmed ; Harb, Naim ; Valderrama, Carlos ; Manneback, Pierre

IEEE transactions on computers, 2014-10, Vol.63 (10), p.2376-2388 [Periódico revisado por pares]

New York: IEEE

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26
Power7: IBM's Next-Generation Server Processor
Power7: IBM's Next-Generation Server Processor
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Power7: IBM's Next-Generation Server Processor

Kalla, Ron ; Sinharoy, Balaram ; Starke, William J ; Floyd, Michael

IEEE MICRO, 2010-03, Vol.30 (2), p.7-15 [Periódico revisado por pares]

Los Alamitos: IEEE

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An SDN Architecture for AUV-Based Underwater Wireless Networks to Enable Cooperative Underwater Search
An SDN Architecture for AUV-Based Underwater Wireless Networks to Enable Cooperative Underwater Search
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An SDN Architecture for AUV-Based Underwater Wireless Networks to Enable Cooperative Underwater Search

Lin, Chuan ; Han, Guangjie ; Guizani, Mohsen ; Bi, Yuanguo ; Du, Jiaxin ; Shu, Lei

IEEE wireless communications, 2020-06, Vol.27 (3), p.132-139 [Periódico revisado por pares]

New York: IEEE

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28
Built-in Security Computer: Deploying Security-First Architecture Using Active Security Processor
Built-in Security Computer: Deploying Security-First Architecture Using Active Security Processor
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Built-in Security Computer: Deploying Security-First Architecture Using Active Security Processor

Meng, Dan ; Hou, Rui ; Shi, Gang ; Tu, Bibo ; Yu, Aimin ; Zhu, Ziyuan ; Jia, Xiaoqi ; Wen, Yu ; Yang, Yun

IEEE transactions on computers, 2020-11, Vol.69 (11), p.1571-1583 [Periódico revisado por pares]

IEEE

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A 4096-Point Radix-4 Memory-Based FFT Using DSP Slices
A 4096-Point Radix-4 Memory-Based FFT Using DSP Slices
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A 4096-Point Radix-4 Memory-Based FFT Using DSP Slices

Garrido, Mario ; Sanchez, Miguel Angel ; Lopez-Vallejo, Maria Luisa ; Grajal, Jesus

IEEE transactions on very large scale integration (VLSI) systems, 2017-01, Vol.25 (1), p.375-379 [Periódico revisado por pares]

New York: IEEE

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30
An Approach to Generate the Traceability Between Restricted Natural Language Requirements and AADL Models
An Approach to Generate the Traceability Between Restricted Natural Language Requirements and AADL Models
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An Approach to Generate the Traceability Between Restricted Natural Language Requirements and AADL Models

Wang, Fei ; Yang, Zhi-Bin ; Huang, Zhi-Qiu ; Liu, Cheng-Wei ; Zhou, Yong ; Bodeveix, Jean-Paul ; Filali, Mamoun

IEEE transactions on reliability, 2020-03, Vol.69 (1), p.154-173 [Periódico revisado por pares]

New York: IEEE

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