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11
On-Chip Interconnection Architecture of the Tile Processor
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On-Chip Interconnection Architecture of the Tile Processor

Wentzlaff, D. ; Griffin, P. ; Hoffmann, H. ; Liewei Bao ; Edwards, B. ; Ramey, C. ; Mattina, M. ; Chyi-Chang Miao ; Brown, J.F. ; Agarwal, A.

IEEE MICRO, 2007-09, Vol.27 (5), p.15-31 [Periódico revisado por pares]

Los Alamitos: IEEE

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12
Scene Recognition by Manifold Regularized Deep Learning Architecture
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Scene Recognition by Manifold Regularized Deep Learning Architecture

Yuan, Yuan ; Mou, Lichao ; Lu, Xiaoqiang

IEEE transaction on neural networks and learning systems, 2015-10, Vol.26 (10), p.2222-2233

United States: IEEE

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13
NVIDIA Tesla: A Unified Graphics and Computing Architecture
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NVIDIA Tesla: A Unified Graphics and Computing Architecture

Lindholm, E. ; Nickolls, J. ; Oberman, S. ; Montrym, J.

IEEE MICRO, 2008-03, Vol.28 (2), p.39-55 [Periódico revisado por pares]

Los Alamitos: IEEE

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14
An Efficient and Scalable Semiconductor Architecture for Parallel Automata Processing
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An Efficient and Scalable Semiconductor Architecture for Parallel Automata Processing

Dlugosch, Paul ; Brown, Dave ; Glendenning, Paul ; Leventhal, Michael ; Noyes, Harold

IEEE transactions on parallel and distributed systems, 2014-12, Vol.25 (12), p.3088-3098 [Periódico revisado por pares]

New York: IEEE

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15
A million spiking-neuron integrated circuit with a scalable communication network and interface
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A million spiking-neuron integrated circuit with a scalable communication network and interface

Merolla, Paul A. ; Arthur, John V. ; Alvarez-Icaza, Rodrigo ; Cassidy, Andrew S. ; Sawada, Jun ; Akopyan, Filipp ; Jackson, Bryan L. ; Imam, Nabil ; Guo, Chen ; Nakamura, Yutaka ; Brezzo, Bernard ; Vo, Ivan ; Esser, Steven K. ; Appuswamy, Rathinakumar ; Taba, Brian ; Amir, Arnon ; Flickner, Myron D. ; Risk, William P. ; Manohar, Rajit ; Modha, Dharmendra S.

Science (American Association for the Advancement of Science), 2014-08, Vol.345 (6197), p.668-673 [Periódico revisado por pares]

Washington: American Association for the Advancement of Science

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16
Software Architecture Reconstruction: A Process-Oriented Taxonomy
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Software Architecture Reconstruction: A Process-Oriented Taxonomy

Ducasse, S. ; Pollet, D.

IEEE transactions on software engineering, 2009-07, Vol.35 (4), p.573-591 [Periódico revisado por pares]

New York: IEEE

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17
What Industry Needs from Architectural Languages: A Survey
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What Industry Needs from Architectural Languages: A Survey

Malavolta, I. ; Lago, P. ; Muccini, H. ; Pelliccione, P. ; Tang, A.

IEEE transactions on software engineering, 2013-06, Vol.39 (6), p.869-891 [Periódico revisado por pares]

New York: IEEE

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18
Software Architecture Optimization Methods: A Systematic Literature Review
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Software Architecture Optimization Methods: A Systematic Literature Review

Aleti, A. ; Buhnova, B. ; Grunske, L. ; Koziolek, A. ; Meedeniya, I.

IEEE transactions on software engineering, 2013-05, Vol.39 (5), p.658-683 [Periódico revisado por pares]

New York: IEEE

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19
GPUs and the Future of Parallel Computing
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GPUs and the Future of Parallel Computing

Keckler, S. W. ; Dally, W. J. ; Khailany, B. ; Garland, M. ; Glasco, D.

IEEE MICRO, 2011-09, Vol.31 (5), p.7-17 [Periódico revisado por pares]

Los Alamitos: IEEE

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20
Hexagon DSP: An Architecture Optimized for Mobile Multimedia and Communications
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Hexagon DSP: An Architecture Optimized for Mobile Multimedia and Communications

Codrescu, Lucian ; Anderson, Willie ; Venkumanhanti, Suresh ; Zeng, Mao ; Plondke, Erich ; Koob, Chris ; Ingle, Ajay ; Tabony, Charles ; Maule, Rick

IEEE MICRO, 2014-03, Vol.34 (2), p.34-43 [Periódico revisado por pares]

Los Alamitos: IEEE

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