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Scheduling master-slave multiprocessor systems
Scheduling master-slave multiprocessor systems
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Scheduling master-slave multiprocessor systems

Sahni, S.

IEEE transactions on computers, 1996-10, Vol.45 (10), p.1195-1199 [Periódico revisado por pares]

New York, NY: IEEE

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2
Ge photodetectors integrated in CMOS photonic circuits
Ge photodetectors integrated in CMOS photonic circuits
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Ata de Congresso 		Adicionar ao Meu Espaço

Ge photodetectors integrated in CMOS photonic circuits

Masini, G ; Sahni, S ; Capellini, G ; Witzens, J ; White, J ; Song, D ; Gunn, C

Proceedings of SPIE, the International Society for Optical Engineering, 2008, Vol.6898, p.689808-689808-6

Bellingham, Wash: SPIE

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3
Dynamic IP router-tables using highest-priority matching
Dynamic IP router-tables using highest-priority matching
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Ata de Congresso 		Adicionar ao Meu Espaço

Dynamic IP router-tables using highest-priority matching

Lu, H. ; Sahni, S.

Proceedings. ISCC 2004. Ninth International Symposium on Computers And Communications (IEEE Cat. No.04TH8769), 2004, Vol.2, p.858-863 Vol.2

Los Alamitos CA: IEEE

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4
A B-tree dynamic router-table design
A B-tree dynamic router-table design
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Ata de Congresso 		Adicionar ao Meu Espaço

A B-tree dynamic router-table design

Lu, H. ; Sahni, S.

Proceedings. ISCC 2004. Ninth International Symposium on Computers And Communications (IEEE Cat. No.04TH8769), 2004, Vol.2, p.840-845 Vol.2

Los Alamitos CA: IEEE

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5
Efficient Algorithms for Computing With Protein-Based Volumetric Memory Processors
Efficient Algorithms for Computing With Protein-Based Volumetric Memory Processors
Material Type:
Artigo 		Adicionar ao Meu Espaço

Efficient Algorithms for Computing With Protein-Based Volumetric Memory Processors

Rajasekaran, S. ; Kundeti, V. ; Birge, R. ; Kumar, V. ; Sahni, S.

IEEE transactions on nanotechnology, 2011-07, Vol.10 (4), p.881-890 [Periódico revisado por pares]

New York, NY: IEEE

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6
Deleting vertices to bound path length
Deleting vertices to bound path length
Material Type:
Artigo 		Adicionar ao Meu Espaço

Deleting vertices to bound path length

Paik, D. ; Reddy, S. ; Sahni, S.

IEEE transactions on computers, 1994-09, Vol.43 (9), p.1091-1096 [Periódico revisado por pares]

New York, NY: IEEE

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7
Serial and parallel algorithms for the medial axis transform
Serial and parallel algorithms for the medial axis transform
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Artigo 		Adicionar ao Meu Espaço

Serial and parallel algorithms for the medial axis transform

Jenq, J.-F. ; Sahni, S.

IEEE transactions on pattern analysis and machine intelligence, 1992-12, Vol.14 (12), p.1218-1224 [Periódico revisado por pares]

LOS ALAMITOS: IEEE

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8
Planar topological routing
Planar topological routing
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Artigo 		Adicionar ao Meu Espaço

Planar topological routing

Lim, A. ; Thanvantri, V. ; Sahni, S.

IEEE transactions on computer-aided design of integrated circuits and systems, 1997-06, Vol.16 (6), p.651-656 [Periódico revisado por pares]

New York, NY: IEEE

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9
Optimal realizations of floorplans (VLSI layout)
Optimal realizations of floorplans (VLSI layout)
Material Type:
Artigo 		Adicionar ao Meu Espaço

Optimal realizations of floorplans (VLSI layout)

Chong, K. ; Sahni, S.

IEEE transactions on computer-aided design of integrated circuits and systems, 1993-06, Vol.12 (6), p.793-801 [Periódico revisado por pares]

New York, NY: IEEE

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10
Folding a stack of equal width components
Folding a stack of equal width components
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Artigo 		Adicionar ao Meu Espaço

Folding a stack of equal width components

Thanvantri, V. ; Sahni, S.

IEEE transactions on computer-aided design of integrated circuits and systems, 1995-06, Vol.14 (6), p.775-780 [Periódico revisado por pares]

New York, NY: IEEE

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