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Unification of scheduling, binding, and retiming to reduce power consumption under timings and resources constraints
Unification of scheduling, binding, and retiming to reduce power consumption under timings and resources constraints
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Unification of scheduling, binding, and retiming to reduce power consumption under timings and resources constraints

Chabini, N. ; Wolf, W.

IEEE transactions on very large scale integration (VLSI) systems, 2005-10, Vol.13 (10), p.1113-1126 [Periódico revisado por pares]

Piscataway, NJ: IEEE

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Reducing dynamic power consumption in synchronous sequential digital designs using retiming and supply voltage scaling
Reducing dynamic power consumption in synchronous sequential digital designs using retiming and supply voltage scaling
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Reducing dynamic power consumption in synchronous sequential digital designs using retiming and supply voltage scaling

Chabini, N. ; Wolf, W.

IEEE transactions on very large scale integration (VLSI) systems, 2004-06, Vol.12 (6), p.573-589 [Periódico revisado por pares]

Piscataway, NJ: IEEE

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3
Hardware implementation of evolvable block-based neural networks utilizing a cost efficient sigmoid-like activation function
Hardware implementation of evolvable block-based neural networks utilizing a cost efficient sigmoid-like activation function
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Hardware implementation of evolvable block-based neural networks utilizing a cost efficient sigmoid-like activation function

Nambiar, Vishnu P. ; Khalil-Hani, Mohamed ; Sahnoun, Riadh ; Marsono, M.N.

Neurocomputing (Amsterdam), 2014-09, Vol.140, p.228-241 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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Asynchronous Data-Driven Circuit Synthesis
Asynchronous Data-Driven Circuit Synthesis
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Asynchronous Data-Driven Circuit Synthesis

Taylor, Sam ; Edwards, Doug A ; Plana, Luis A ; Tarazona D, Luis A

IEEE transactions on very large scale integration (VLSI) systems, 2010-07, Vol.18 (7), p.1093-1106 [Periódico revisado por pares]

New York, NY: IEEE

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5
Differentiation of discrete multidimensional signals
Differentiation of discrete multidimensional signals
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Differentiation of discrete multidimensional signals

Farid, H. ; Simoncelli, E.P.

IEEE transactions on image processing, 2004-04, Vol.13 (4), p.496-508 [Periódico revisado por pares]

New York, NY: IEEE

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6
On the Design of RNS Reverse Converters for the Four-Moduli Set {2n + 1, 2n ― 1, 2n, 2n+1 + 1}
On the Design of RNS Reverse Converters for the Four-Moduli Set {2n + 1, 2n ― 1, 2n, 2n+1 + 1}
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On the Design of RNS Reverse Converters for the Four-Moduli Set {2n + 1, 2n ― 1, 2n, 2n+1 + 1}

SOUSA, Leonel ; ANTAO, Samuel ; CHAVES, Ricardo

IEEE transactions on very large scale integration (VLSI) systems, 2013-10, Vol.21 (10), p.1945-1949 [Periódico revisado por pares]

New York, NY: Institute of Electrical and Electronics Engineers

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7
Overlap-Save and Overlap-Add Filters: Optimal Design and Comparison
Overlap-Save and Overlap-Add Filters: Optimal Design and Comparison
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Overlap-Save and Overlap-Add Filters: Optimal Design and Comparison

Daher, Ali ; Baghious, El-Houssain ; Burel, Gilles ; Radoi, Emanuel

IEEE transactions on signal processing, 2010-06, Vol.58 (6), p.3066-3075 [Periódico revisado por pares]

New York, NY: IEEE

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8
An Ultra Low Power Baseband Transceiver IC for Wireless Body Area Network in 0.18- \mu m CMOS Technology
An Ultra Low Power Baseband Transceiver IC for Wireless Body Area Network in 0.18- \mu m CMOS Technology
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An Ultra Low Power Baseband Transceiver IC for Wireless Body Area Network in 0.18- \mu m CMOS Technology

Liu, Xin ; Zheng, Yuanjin ; Zhao, Bin ; Wang, Yisheng ; Phyu, Myint Wai

IEEE transactions on very large scale integration (VLSI) systems, 2011-08, Vol.19 (8), p.1418-1428 [Periódico revisado por pares]

New York, NY: IEEE

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9
The impact of intra-die device parameter variations on path delays and on the design for yield of low voltage digital circuits
The impact of intra-die device parameter variations on path delays and on the design for yield of low voltage digital circuits
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The impact of intra-die device parameter variations on path delays and on the design for yield of low voltage digital circuits

Eisele, M. ; Berthold, J. ; Schmitt-Landsiedel, D. ; Mahnkopf, R.

IEEE transactions on very large scale integration (VLSI) systems, 1997-12, Vol.5 (4), p.360-368 [Periódico revisado por pares]

Piscataway, NJ: IEEE

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10
Approach to design a compact reversible low power binary comparator
Approach to design a compact reversible low power binary comparator
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Approach to design a compact reversible low power binary comparator

Hasan Babu, Hafiz Md ; Saleheen, Nazir ; Jamal, Lafifa ; Sarwar, Sheikh Muhammad ; Sasao, Tsutomu

IET computers & digital techniques, 2014-05, Vol.8 (3), p.129-139 [Periódico revisado por pares]

Stevenage: The Institution of Engineering and Technology

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