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MINOTAuR: A Timing Predictable RISC-V Core Featuring Speculative Execution
MINOTAuR: A Timing Predictable RISC-V Core Featuring Speculative Execution
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MINOTAuR: A Timing Predictable RISC-V Core Featuring Speculative Execution

Gruin, Alban ; Carle, Thomas ; Rochange, Christine ; Casse, Hugues ; Sainrat, Pascal

IEEE transactions on computers, 2023-01, Vol.72 (1), p.1-14 [Periódico revisado por pares]

IEEE

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An Ontology-Based Method for HW/SW Architecture Reconstruction
An Ontology-Based Method for HW/SW Architecture Reconstruction
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An Ontology-Based Method for HW/SW Architecture Reconstruction

Musavi, Seyyedeh Atefeh ; Hashemi, Mahmoud Reza

IEEE transactions on computers, 2019-07, Vol.68 (7), p.1007-1018 [Periódico revisado por pares]

IEEE

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NV-Clustering: Normally-Off Computing Using Non-Volatile Datapaths
NV-Clustering: Normally-Off Computing Using Non-Volatile Datapaths
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NV-Clustering: Normally-Off Computing Using Non-Volatile Datapaths

Roohi, Arman ; DeMara, Ronald F.

IEEE transactions on computers, 2018-07, Vol.67 (7), p.949-959 [Periódico revisado por pares]

New York: IEEE

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14
Accelerating Fully Homomorphic Encryption in Hardware
Accelerating Fully Homomorphic Encryption in Hardware
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Accelerating Fully Homomorphic Encryption in Hardware

Doroz, Yarkın ; Ozturk, Erdinc ; Sunar, Berk

IEEE transactions on computers, 2015-06, Vol.64 (6), p.1509-1521 [Periódico revisado por pares]

New York: IEEE

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An Open-Source Platform for High-Performance Non-Coherent On-Chip Communication
An Open-Source Platform for High-Performance Non-Coherent On-Chip Communication
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An Open-Source Platform for High-Performance Non-Coherent On-Chip Communication

Kurth, Andreas ; Ronninger, Wolfgang ; Benz, Thomas ; Cavalcante, Matheus ; Schuiki, Fabian ; Zaruba, Florian ; Benini, Luca

IEEE transactions on computers, 2021-08, p.1-1 [Periódico revisado por pares]

IEEE

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All-Optical Wavelength-Routed Architecture for a Power-Efficient Network on Chip
All-Optical Wavelength-Routed Architecture for a Power-Efficient Network on Chip
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All-Optical Wavelength-Routed Architecture for a Power-Efficient Network on Chip

Koohi, Somayyeh ; Hessabi, Shaahin

IEEE transactions on computers, 2014-03, Vol.63 (3), p.777-792 [Periódico revisado por pares]

New York: IEEE

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In-Memory Processing on the Spintronic CRAM: From Hardware Design to Application Mapping
In-Memory Processing on the Spintronic CRAM: From Hardware Design to Application Mapping
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In-Memory Processing on the Spintronic CRAM: From Hardware Design to Application Mapping

Zabihi, Masoud ; Chowdhury, Zamshed Iqbal ; Zhao, Zhengyang ; Karpuzcu, Ulya R. ; Wang, Jian-Ping ; Sapatnekar, Sachin S.

IEEE transactions on computers, 2019-08, Vol.68 (8), p.1159-1173 [Periódico revisado por pares]

New York: IEEE

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DRAM Refresh Mechanisms, Penalties, and Trade-Offs
DRAM Refresh Mechanisms, Penalties, and Trade-Offs
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DRAM Refresh Mechanisms, Penalties, and Trade-Offs

Bhati, Ishwar ; Mu-Tien Chang ; Chishti, Zeshan ; Shih-Lien Lu ; Jacob, Bruce

IEEE transactions on computers, 2016-01, Vol.65 (1), p.108-121 [Periódico revisado por pares]

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HEAWS: An Accelerator for Homomorphic Encryption on the Amazon AWS FPGA
HEAWS: An Accelerator for Homomorphic Encryption on the Amazon AWS FPGA
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HEAWS: An Accelerator for Homomorphic Encryption on the Amazon AWS FPGA

Turan, Furkan ; Roy, Sujoy Sinha ; Verbauwhede, Ingrid

IEEE transactions on computers, 2020-08, Vol.69 (8), p.1185-1196 [Periódico revisado por pares]

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20
Performance evaluation and design trade-offs for network-on-chip interconnect architectures
Performance evaluation and design trade-offs for network-on-chip interconnect architectures
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Performance evaluation and design trade-offs for network-on-chip interconnect architectures

Partha Pratim Pande ; Grecu, C. ; Jones, M. ; Ivanov, A. ; Saleh, R.

IEEE transactions on computers, 2005-08, Vol.54 (8), p.1025-1040 [Periódico revisado por pares]

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