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Overview of the SpiNNaker System Architecture
Overview of the SpiNNaker System Architecture
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Overview of the SpiNNaker System Architecture

Furber, Steve B. ; Lester, David R. ; Plana, Luis A. ; Garside, Jim D. ; Painkras, Eustace ; Temple, Steve ; Brown, Andrew D.

IEEE transactions on computers, 2013-12, Vol.62 (12), p.2454-2467 [Periódico revisado por pares]

New York: IEEE

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High Throughput/Gate AES Hardware Architectures Based on Datapath Compression
High Throughput/Gate AES Hardware Architectures Based on Datapath Compression
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High Throughput/Gate AES Hardware Architectures Based on Datapath Compression

Ueno, Rei ; Homma, Naofumi ; Morioka, Sumio ; Miura, Noriyuki ; Matsuda, Kohei ; Nagata, Makoto ; Bhasin, Shivam ; Mathieu, Yves ; Graba, Tarik ; Danger, Jean-Luc

IEEE transactions on computers, 2020-04, Vol.69 (4), p.534-548 [Periódico revisado por pares]

IEEE

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NeST: A Neural Network Synthesis Tool Based on a Grow-and-Prune Paradigm
NeST: A Neural Network Synthesis Tool Based on a Grow-and-Prune Paradigm
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NeST: A Neural Network Synthesis Tool Based on a Grow-and-Prune Paradigm

Dai, Xiaoliang ; Yin, Hongxu ; Jha, Niraj K.

IEEE transactions on computers, 2019-10, Vol.68 (10), p.1487-1497 [Periódico revisado por pares]

IEEE

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Hardware-Based Trusted Computing Architectures for Isolation and Attestation
Hardware-Based Trusted Computing Architectures for Isolation and Attestation
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Hardware-Based Trusted Computing Architectures for Isolation and Attestation

Maene, Pieter ; Gotzfried, Johannes ; de Clercq, Ruan ; Muller, Tilo ; Freiling, Felix ; Verbauwhede, Ingrid

IEEE transactions on computers, 2018-03, Vol.67 (3), p.361-374 [Periódico revisado por pares]

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Device-Circuit-Architecture Co-Exploration for Computing-in-Memory Neural Accelerators
Device-Circuit-Architecture Co-Exploration for Computing-in-Memory Neural Accelerators
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Device-Circuit-Architecture Co-Exploration for Computing-in-Memory Neural Accelerators

Jiang, Weiwen ; Lou, Qiuwen ; Yan, Zheyu ; Yang, Lei ; Hu, Jingtong ; Hu, Xiaobo Sharon ; Shi, Yiyu

IEEE transactions on computers, 2021-04, Vol.70 (4), p.595-605 [Periódico revisado por pares]

IEEE

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Routing or Computing? The Paradigm Shift Towards Intelligent Computer Network Packet Transmission Based on Deep Learning
Routing or Computing? The Paradigm Shift Towards Intelligent Computer Network Packet Transmission Based on Deep Learning
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Routing or Computing? The Paradigm Shift Towards Intelligent Computer Network Packet Transmission Based on Deep Learning

Bomin Mao ; Fadlullah, Zubair Md ; Fengxiao Tang ; Kato, Nei ; Akashi, Osamu ; Inoue, Takeru ; Mizutani, Kimihiro

IEEE transactions on computers, 2017-11, Vol.66 (11), p.1946-1960 [Periódico revisado por pares]

New York: IEEE

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Enhancing Graph Random Walk Acceleration via Efficient Dataflow and Hybrid Memory Architecture
Enhancing Graph Random Walk Acceleration via Efficient Dataflow and Hybrid Memory Architecture
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Enhancing Graph Random Walk Acceleration via Efficient Dataflow and Hybrid Memory Architecture

Gao, Yingxue ; Wang, Teng ; Gong, Lei ; Wang, Chao ; Hu, Yiqing ; Yang, Yi ; Liu, Zhongming ; Li, Xi ; Zhou, Xuehai

IEEE transactions on computers, 2024-03, p.1-14 [Periódico revisado por pares]

IEEE

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Energy-Efficient Exposed Datapath Architecture With a RISC-V Instruction Set Mode
Energy-Efficient Exposed Datapath Architecture With a RISC-V Instruction Set Mode
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Energy-Efficient Exposed Datapath Architecture With a RISC-V Instruction Set Mode

Hepola, Kari ; Multanen, Joonas ; Jaaskelainen, Pekka

IEEE transactions on computers, 2024-02, Vol.73 (2), p.1-13 [Periódico revisado por pares]

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Elliptic-Curve-Based Security Processor for RFID
Elliptic-Curve-Based Security Processor for RFID
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Elliptic-Curve-Based Security Processor for RFID

Yong Ki Lee ; Sakiyama, K. ; Batina, L. ; Verbauwhede, I.

IEEE transactions on computers, 2008-11, Vol.57 (11), p.1514-1527 [Periódico revisado por pares]

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10
Networks-on-Chip in a Three-Dimensional Environment: A Performance Evaluation
Networks-on-Chip in a Three-Dimensional Environment: A Performance Evaluation
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Networks-on-Chip in a Three-Dimensional Environment: A Performance Evaluation

Feero, B.S. ; Pande, P.P.

IEEE transactions on computers, 2009-01, Vol.58 (1), p.32-45 [Periódico revisado por pares]

New York: IEEE

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