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Integrated Circuit Design. Power and Timing Modeling, Optimization and Simulation: 12th International Workshop, PATMOS 2002 Seville, Spain, September 11–13, 2002 Proceedings
Integrated Circuit Design. Power and Timing Modeling, Optimization and Simulation: 12th International Workshop, PATMOS 2002 Seville, Spain, September 11–13, 2002 Proceedings
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Integrated Circuit Design. Power and Timing Modeling, Optimization and Simulation: 12th International Workshop, PATMOS 2002 Seville, Spain, September 11–13, 2002 Proceedings

Hochet, Bertrand ; Acosta, Antonio J ; Bellido, Manuel J Bellido, Manuel J. ; Hochet, Bertrand ; Acosta, Antonio J.

Berlin, Heidelberg: Springer Berlin Heidelberg 2002

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Design Process: metodologia de interação entre design e engenharia como vetor de inovação; Design Process: interaction methodology between design and engineering as an innovation vector
Design Process: metodologia de interação entre design e engenharia como vetor de inovação; Design Process: interaction methodology between design and engineering as an innovation vector
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Design Process: metodologia de interação entre design e engenharia como vetor de inovação; Design Process: interaction methodology between design and engineering as an innovation vector

Barcellos, Ekaterina Emmanuil Inglesis; Botura Junior, Galdenoro

Gestão & Tecnologia de Projetos; v. 14 n. 2 (2019): Edição Regular de 2019 em fluxo contínuo; 65-74

Universidade de São Paulo. Instituto de Arquitetura e Urbanismo 2019-12-13

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3
Contemporary Architects
Contemporary Architects
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Contemporary Architects

Emanuel, Muriel

London: Palgrave Macmillan UK 1980

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Multithreaded Computer Architecture: A Summary of the State of the ART
Multithreaded Computer Architecture: A Summary of the State of the ART
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Multithreaded Computer Architecture: A Summary of the State of the ART

Iannucci, Robert A ; Gao, Guang R ; Halstead, Robert H

Boston: Springer 1994

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A Guide to VHDL
A Guide to VHDL
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A Guide to VHDL

Mazor, Stanley ; Langstraat, Patricia

New York, NY: Springer 1993

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Optimal VLSI Architectural Synthesis: Area, Performance and Testability
Optimal VLSI Architectural Synthesis: Area, Performance and Testability
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Optimal VLSI Architectural Synthesis: Area, Performance and Testability

Gebotys, Catherine H ; Elmasry, Mohamed I

New York, NY: Springer 1991

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ASIC System Design with VHDL: A Paradigm
ASIC System Design with VHDL: A Paradigm
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ASIC System Design with VHDL: A Paradigm

Allen, Jonathan ; Leung, Steven S ; Shanblatt, Michael A

Boston, MA: Springer 1989

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The Role of Placemaking Strategies in Urban Spaces and Urban Mobility in Brazilian Cities
The Role of Placemaking Strategies in Urban Spaces and Urban Mobility in Brazilian Cities
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The Role of Placemaking Strategies in Urban Spaces and Urban Mobility in Brazilian Cities

Ozelim, Juliana Carvalho Mendes ; De Holanda, Frederico

ITE journal, 2024-02, Vol.94 (2), p.40-46 [Periódico revisado por pares]

Washington: Institute of Transportation Engineers

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Post-Occupancy Evaluation and Design Quality in Brazil: Concepts, Approaches and an Example of Application
Post-Occupancy Evaluation and Design Quality in Brazil: Concepts, Approaches and an Example of Application
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Post-Occupancy Evaluation and Design Quality in Brazil: Concepts, Approaches and an Example of Application

Ornstein, Sheila Walbe ; Ono, Rosaria

Architectural engineering and design management, 2010-01, Vol.6 (1), p.48-67 [Periódico revisado por pares]

London: Taylor & Francis Group

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Housing Design: Furniture or Fixtures? Accommodating Change through Technological and Typological Innovation
Housing Design: Furniture or Fixtures? Accommodating Change through Technological and Typological Innovation
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Housing Design: Furniture or Fixtures? Accommodating Change through Technological and Typological Innovation

Daglio, Laura ; Ginelli, Elisabetta ; Vignati, Giulia

Buildings (Basel), 2023-07, Vol.13 (7), p.1862 [Periódico revisado por pares]

Basel: MDPI AG

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  1. Botura Junior, G
  2. Barcellos, E

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  1. Engineering
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  • Realização: ABCD-USP USP   Logos de Redes Sociais: Freepik

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