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1
Controle de acesso à TV interativa por meio de impressão digital baseado em FPGA
Controle de acesso à TV interativa por meio de impressão digital baseado em FPGA
Material Type:
Artigo de Congresso 		Adicionar ao Meu Espaço

Controle de acesso à TV interativa por meio de impressão digital baseado em FPGA

Vanderlei Bonato Ricardo Menotti; Rolf Fredi Molz; Eduardo Marques; Simpósio Latino Americano em Aplicações de Lógica Programável e Processadores Digitais de Sinais em Processamwento de Vídeo, Visão Computacional e Robótica (2004 São Carlos)

SLALP'2004 São Carlos, 2004

São Carlos 2004

Localização: ICMC - Inst. Ciên. Mat. Computação    (PROD-1408128 ) e outros locais(Acessar)

2
Scaling up loop pipelining for high-level synthesis a non-iterative approach
Scaling up loop pipelining for high-level synthesis a non-iterative approach
Material Type:
Artigo de Congresso 		Adicionar ao Meu Espaço

Scaling up loop pipelining for high-level synthesis a non-iterative approach

Leandro de Souza Rosa Vanderlei Bonato; Christos-Savvas Bouganis; International Conference on Field-Programmable Technology - FPT (2018 Naha)

Proceedings Piscataway : IEEE, 2018

Piscataway IEEE 2018

Localização: ICMC - Inst. Ciên. Mat. Computação    (PROD-2952266 )(Acessar)

3
ProfCounter line-level cycle counter for Xilinx OpenCL high-level synthesis
ProfCounter line-level cycle counter for Xilinx OpenCL high-level synthesis
Material Type:
Artigo de Congresso 		Adicionar ao Meu Espaço

ProfCounter line-level cycle counter for Xilinx OpenCL high-level synthesis

André Bannwart Perina Jürgen Becker; Vanderlei Bonato; IEEE International Conference on Electronics, Circuits and Systems - ICECS (26. 2019 Genoa, Italy)

Proceedings Los Alamitos : IEEE, 2019

Los Alamitos IEEE 2019

Localização: ICMC - Inst. Ciên. Mat. Computação    (PROD-2988345 )(Acessar)

4
Proposta de uma arquitetura de hardware em FPGA implementada para SLAM com multi-câmeras aplicada à robótica móvel
Proposta de uma arquitetura de hardware em FPGA implementada para SLAM com multi-câmeras aplicada à robótica móvel
Material Type:
Tese de Doutorado 		Adicionar ao Meu Espaço

Proposta de uma arquitetura de hardware em FPGA implementada para SLAM com multi-câmeras aplicada à robótica móvel

Bonato, Vanderlei

Biblioteca Digital de Teses e Dissertações da USP; Universidade de São Paulo; Instituto de Ciências Matemáticas e de Computação 2008-01-30

Acesso online. A biblioteca também possui exemplares impressos.

5
A parallel hardware architecture for image feature detection
A parallel hardware architecture for image feature detection
Material Type:
Artigo de Congresso 		Adicionar ao Meu Espaço

A parallel hardware architecture for image feature detection

Vanderlei Bonato Eduardo Marques; George A Constantinides 1975-; International Workshop on Applied Reconfigurable Computing (4 London 2008)

Lecture Notes in Computer Science, v. 4943, p. 134-148, 2008

Heidelberger Springer 2008

Acesso online. A biblioteca também possui exemplares impressos.

6
Otimização de memória cache em tempo de execução para o processador embarcado LEON3
Otimização de memória cache em tempo de execução para o processador embarcado LEON3
Material Type:
Dissertação de Mestrado 		Adicionar ao Meu Espaço

Otimização de memória cache em tempo de execução para o processador embarcado LEON3

Cuminato, Lucas Albers

Biblioteca Digital de Teses e Dissertações da USP; Universidade de São Paulo; Instituto de Ciências Matemáticas e de Computação 2014-04-28

Acesso online. A biblioteca também possui exemplares impressos.

7
Fast resource and timing aware design optimisation for high-level synthesis
Fast resource and timing aware design optimisation for high-level synthesis
Material Type:
Artigo 		Adicionar ao Meu Espaço

Fast resource and timing aware design optimisation for high-level synthesis

André Bannwart Perina Arthur Silitonga; Jürgen Becker; Vanderlei Bonato

IEEE Transactions on Computers Piscataway : IEEE v. 70, n. 12, p. 2070-2082, 2021

Piscataway 2021

Localização: ICMC - Inst. Ciên. Mat. Computação    (PROD-3042380 )(Acessar)

8
Non-iterative SDC modulo scheduling for high-level synthesis
Non-iterative SDC modulo scheduling for high-level synthesis
Material Type:
Artigo 		Adicionar ao Meu Espaço

Non-iterative SDC modulo scheduling for high-level synthesis

Leandro de Souza Rosa Christos-Savvas Bouganis; Vanderlei Bonato

Microprocessors and Microsystems Amsterdam : Elsevier v. 86, p. 1-13, 2021

Amsterdam 2021

Localização: ICMC - Inst. Ciên. Mat. Computação    (PROD-3043210 )(Acessar)

9
A FAST hardware decoder optimized for template features to obtain order book Data in low latency
A FAST hardware decoder optimized for template features to obtain order book Data in low latency
Material Type:
Artigo 		Adicionar ao Meu Espaço

A FAST hardware decoder optimized for template features to obtain order book Data in low latency

Caio C. S Oliveira Vanderlei Bonato

Journal of Signal Processing Systems New York : Springer v. 95, p. 559-567, 2023

New York 2023

Localização: ICMC - Inst. Ciên. Mat. Computação    (PROD-3140301 )(Acessar)

10
Fast Code Exploration for Pipeline Processing in FPGA Accelerators
Fast Code Exploration for Pipeline Processing in FPGA Accelerators
Material Type:
Tese de Doutorado 		Adicionar ao Meu Espaço

Fast Code Exploration for Pipeline Processing in FPGA Accelerators

Rosa, Leandro De Souza

Biblioteca Digital de Teses e Dissertações da USP; Universidade de São Paulo; Instituto de Ciências Matemáticas e de Computação 2019-05-31

Acesso online. A biblioteca também possui exemplares impressos.

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Deste Autor:

  1. Bonato, V
  2. Marques, E
  3. Rosa, L
  4. Constantinides, G
  5. Bouganis, C

Neste Assunto:

  1. Hardware
  2. Sistemas Embutidos
  3. Circuitos Fpga
  4. Fpga
  5. Computação Evolutiva

  • Realização: ABCD-USP USP   Logos de Redes Sociais: Freepik

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