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Energy-Efficient High-Throughput Montgomery Modular Multipliers for RSA Cryptosystems
Energy-Efficient High-Throughput Montgomery Modular Multipliers for RSA Cryptosystems
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Energy-Efficient High-Throughput Montgomery Modular Multipliers for RSA Cryptosystems

KUANG, Shiann-Rong ; WANG, Jiun-Ping ; CHANG, Kai-Cheng ; HSU, Huan-Wei

IEEE transactions on very large scale integration (VLSI) systems, 2013-11, Vol.21 (11), p.1999-2009 [Periódico revisado por pares]

New York, NY: IEEE

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High-throughput LDPC decoders
High-throughput LDPC decoders
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High-throughput LDPC decoders

Mansour, M.M. ; Shanbhag, N.R.

IEEE transactions on very large scale integration (VLSI) systems, 2003-12, Vol.11 (6), p.976-996 [Periódico revisado por pares]

Piscataway, NJ: IEEE

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Reduced-Complexity Decoder Architecture for Non-Binary LDPC Codes
Reduced-Complexity Decoder Architecture for Non-Binary LDPC Codes
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Artigo 		Adicionar ao Meu Espaço

Reduced-Complexity Decoder Architecture for Non-Binary LDPC Codes

Zhang, Xinmiao ; Cai, Fang

IEEE transactions on very large scale integration (VLSI) systems, 2011-07, Vol.19 (7), p.1229-1238 [Periódico revisado por pares]

New York, NY: IEEE

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Security as a new dimension in embedded system design
Security as a new dimension in embedded system design
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Ata de Congresso 		Adicionar ao Meu Espaço

Security as a new dimension in embedded system design

Ravi, Srivaths ; Kocher, Paul ; Lee, Ruby ; McGraw, Gary ; Raghunathan, Anand

Annual ACM IEEE Design Automation Conference: Proceedings of the 41st annual conference on Design automation, 2004, p.753-760

Piscataway NJ: ACM

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15
Overview of the architecture, circuit design, and physical implementation of a first-generation cell processor
Overview of the architecture, circuit design, and physical implementation of a first-generation cell processor
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Overview of the architecture, circuit design, and physical implementation of a first-generation cell processor

Pham, D.C. ; Aipperspach, T. ; Boerstler, D. ; Bolliger, M. ; Chaudhry, R. ; Cox, D. ; Harvey, P. ; Harvey, P.M. ; Hofstee, H.P. ; Johns, C. ; Kahle, J. ; Kameyama, A. ; Keaty, J. ; Masubuchi, Y. ; Pham, M. ; Pille, J. ; Posluszny, S. ; Riley, M. ; Stasiak, D.L. ; Suzuoki, M. ; Takahashi, O. ; Warnock, J. ; Weitzel, S. ; Wendel, D. ; Yazawa, K.

IEEE journal of solid-state circuits, 2006-01, Vol.41 (1), p.179-196 [Periódico revisado por pares]

New York, NY: IEEE

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16
Dynamic Bit-Width Adaptation in DCT: An Approach to Trade Off Image Quality and Computation Energy
Dynamic Bit-Width Adaptation in DCT: An Approach to Trade Off Image Quality and Computation Energy
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Artigo 		Adicionar ao Meu Espaço

Dynamic Bit-Width Adaptation in DCT: An Approach to Trade Off Image Quality and Computation Energy

Jongsun Park ; Jung Hwan Choi ; Roy, Kaushik

IEEE transactions on very large scale integration (VLSI) systems, 2010-05, Vol.18 (5), p.787-793 [Periódico revisado por pares]

New York, NY: IEEE

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"It's a small world after all": NoC performance optimization via long-range link insertion
"It's a small world after all": NoC performance optimization via long-range link insertion
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"It's a small world after all": NoC performance optimization via long-range link insertion

Ogras, U.Y. ; Marculescu, R.

IEEE transactions on very large scale integration (VLSI) systems, 2006-07, Vol.14 (7), p.693-706 [Periódico revisado por pares]

Piscataway, NJ: IEEE

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18
A Novel Technique for Improving Hardware Trojan Detection and Reducing Trojan Activation Time
A Novel Technique for Improving Hardware Trojan Detection and Reducing Trojan Activation Time
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A Novel Technique for Improving Hardware Trojan Detection and Reducing Trojan Activation Time

Salmani, H. ; Tehranipoor, M. ; Plusquellic, J.

IEEE transactions on very large scale integration (VLSI) systems, 2012-01, Vol.20 (1), p.112-125 [Periódico revisado por pares]

New York, NY: IEEE

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19
A Low-Power FPGA Based on Autonomous Fine-Grain Power Gating
A Low-Power FPGA Based on Autonomous Fine-Grain Power Gating
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A Low-Power FPGA Based on Autonomous Fine-Grain Power Gating

Ishihara, S. ; Hariyama, M. ; Kameyama, M.

IEEE transactions on very large scale integration (VLSI) systems, 2011-08, Vol.19 (8), p.1394-1406 [Periódico revisado por pares]

New York, NY: IEEE

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ORION 2.0: A Power-Area Simulator for Interconnection Networks
ORION 2.0: A Power-Area Simulator for Interconnection Networks
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ORION 2.0: A Power-Area Simulator for Interconnection Networks

Kahng, A. B. ; Bin Li ; Li-Shiuan Peh ; Samadi, K.

IEEE transactions on very large scale integration (VLSI) systems, 2012-01, Vol.20 (1), p.191-196 [Periódico revisado por pares]

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