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Refinado por: Nome da Publicação: Ieee Transactions On Computers remover assunto: Parallel Processing remover
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Enhancing Graph Random Walk Acceleration via Efficient Dataflow and Hybrid Memory Architecture
Enhancing Graph Random Walk Acceleration via Efficient Dataflow and Hybrid Memory Architecture
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Enhancing Graph Random Walk Acceleration via Efficient Dataflow and Hybrid Memory Architecture

Gao, Yingxue ; Wang, Teng ; Gong, Lei ; Wang, Chao ; Hu, Yiqing ; Yang, Yi ; Liu, Zhongming ; Li, Xi ; Zhou, Xuehai

IEEE transactions on computers, 2024-03, Vol.73 (3), p.887-901 [Periódico revisado por pares]

IEEE

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FlinkCL: An OpenCL-Based In-Memory Computing Architecture on Heterogeneous CPU-GPU Clusters for Big Data
FlinkCL: An OpenCL-Based In-Memory Computing Architecture on Heterogeneous CPU-GPU Clusters for Big Data
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FlinkCL: An OpenCL-Based In-Memory Computing Architecture on Heterogeneous CPU-GPU Clusters for Big Data

Chen, Cen ; Li, Kenli ; Ouyang, Aijia ; Li, Keqin

IEEE transactions on computers, 2018-12, Vol.67 (12), p.1765-1779 [Periódico revisado por pares]

New York: IEEE

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Svelto: High-Level Synthesis of Multi-Threaded Accelerators for Graph Analytics
Svelto: High-Level Synthesis of Multi-Threaded Accelerators for Graph Analytics
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Svelto: High-Level Synthesis of Multi-Threaded Accelerators for Graph Analytics

Minutoli, Marco ; Castellana, Vito Giovanni ; Saporetti, Nicola ; Devecchi, Stefano ; Lattuada, Marco ; Fezzardi, Pietro ; Tumeo, Antonino ; Ferrandi, Fabrizio

IEEE transactions on computers, 2022-03, Vol.71 (3), p.520-533 [Periódico revisado por pares]

IEEE

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Ozone (O3): An Out-of-Order Flash Memory Controller Architecture
Ozone (O3): An Out-of-Order Flash Memory Controller Architecture
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Ozone (O3): An Out-of-Order Flash Memory Controller Architecture

Eyee Hyun Nam ; Kim, B S J ; Hyeonsang Eom ; Sang Lyul Min

IEEE transactions on computers, 2011-05, Vol.60 (5), p.653-666 [Periódico revisado por pares]

New York: IEEE

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VSPIM: SRAM Processing-in-Memory DNN Acceleration via Vector-Scalar Operations
VSPIM: SRAM Processing-in-Memory DNN Acceleration via Vector-Scalar Operations
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VSPIM: SRAM Processing-in-Memory DNN Acceleration via Vector-Scalar Operations

Nie, Chen ; Tang, Chenyu ; Lin, Jie ; Hu, Huan ; Lv, Chenyang ; Cao, Ting ; Zhang, Weifeng ; Jiang, Li ; Liang, Xiaoyao ; Qian, Weikang ; Sun, Yanan ; He, Zhezhi

IEEE transactions on computers, 2023, p.1-12 [Periódico revisado por pares]

IEEE

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FPDeep: Scalable Acceleration of CNN Training on Deeply-Pipelined FPGA Clusters
FPDeep: Scalable Acceleration of CNN Training on Deeply-Pipelined FPGA Clusters
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FPDeep: Scalable Acceleration of CNN Training on Deeply-Pipelined FPGA Clusters

Wang, Tianqi ; Geng, Tong ; Li, Ang ; Jin, Xi ; Herbordt, Martin

IEEE Transactions on Computers, 2020-08, Vol.69 (8), p.1143-1158 [Periódico revisado por pares]

United States: IEEE

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An Area-Efficient In-Memory Implementation Method of Arbitrary Boolean Function based on SRAM Array
An Area-Efficient In-Memory Implementation Method of Arbitrary Boolean Function based on SRAM Array
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An Area-Efficient In-Memory Implementation Method of Arbitrary Boolean Function based on SRAM Array

Zhang, Sunrui ; Cui, Xiaole ; Wei, Feng ; Cui, Xiaoxin

IEEE transactions on computers, 2023-12, Vol.72 (12), p.1-14 [Periódico revisado por pares]

IEEE

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Serving Multi-DNN Workloads on FPGAs: a Coordinated Architecture, Scheduling, and Mapping Perspective
Serving Multi-DNN Workloads on FPGAs: a Coordinated Architecture, Scheduling, and Mapping Perspective
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Serving Multi-DNN Workloads on FPGAs: a Coordinated Architecture, Scheduling, and Mapping Perspective

Zeng, Shulin ; Dai, Guohao ; Zhang, Niansong ; Yang, Xinhao ; Zhang, Haoyu ; Zhu, Zhenhua ; Yang, Huazhong ; Wang, Yu

IEEE transactions on computers, 2023-05, Vol.72 (5), p.1-14 [Periódico revisado por pares]

IEEE

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An STT-MRAM Based in Memory Architecture for Low Power Integral Computing
An STT-MRAM Based in Memory Architecture for Low Power Integral Computing
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An STT-MRAM Based in Memory Architecture for Low Power Integral Computing

Zhao, Yinglin ; Ouyang, Peng ; Kang, Wang ; Yin, Shouyi ; Zhang, Youguang ; Wei, Shaojun ; Zhao, Weisheng

IEEE transactions on computers, 2019-04, Vol.68 (4), p.617-623 [Periódico revisado por pares]

New York: IEEE

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A High-Performance and Scalable Hardware Architecture for Isogeny-Based Cryptography
A High-Performance and Scalable Hardware Architecture for Isogeny-Based Cryptography
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A High-Performance and Scalable Hardware Architecture for Isogeny-Based Cryptography

Koziel, Brian ; Azarderakhsh, Reza ; Kermani, Mehran Mozaffari

IEEE transactions on computers, 2018-11, Vol.67 (11), p.1594-1609 [Periódico revisado por pares]

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