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Construindo com bits: análise do processo de projeto assistido por computador
Construindo com bits: análise do processo de projeto assistido por computador
Material Type:
Dissertação de Mestrado 		Adicionar ao Meu Espaço

Construindo com bits: análise do processo de projeto assistido por computador

Oliveira, Juliano Carlos Cecílio Batista

Biblioteca Digital de Teses e Dissertações da USP; Universidade de São Paulo; Escola de Engenharia de São Carlos 2007-11-19

Acesso online

2
The NuMI neutrino beam
The NuMI neutrino beam
Material Type:
Artigo 		Adicionar ao Meu Espaço

The NuMI neutrino beam

Coelho, João De Abreu Barbosa, 1984-; Escobar, Carlos Ourivio, 1948- Universidade Estadual de Campinas (Unicamp); Universidade Estadual De Campinas

COELHO, João de Abreu Barbosa; ESCOBAR, Carlos Ourivio. The NuMI neutrino beam. Nuclear instruments & methods in physics research. Section A, Accelerators spectrometers detectors and associated equipment. Amsterdam : Elsevier, 2016. Vol. 806 (Jan., 2016), p. 279-306. Disponível em: https://hdl.handle.net/20.500.12733/1666957. Acesso em: 16 nov. 2023.

2016

Acesso online

3
Integrating Innovation in Architecture: Design, Methods and Technology for Progressive Practice and Research
Integrating Innovation in Architecture: Design, Methods and Technology for Progressive Practice and Research
Material Type:
Livro 		Adicionar ao Meu Espaço

Integrating Innovation in Architecture: Design, Methods and Technology for Progressive Practice and Research

Aksamija, Ajla

Newark: John Wiley & Sons, Incorporated 2017

Texto completo disponível

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4
The Digital Turn in Architecture 1992 - 2012
The Digital Turn in Architecture 1992 - 2012
Material Type:
Livro 		Adicionar ao Meu Espaço

The Digital Turn in Architecture 1992 - 2012

Carpo, Mario

Newark: Wiley 2013

Texto completo disponível

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5
Optimizing the Convolution Operation to Accelerate Deep Neural Networks on FPGA
Optimizing the Convolution Operation to Accelerate Deep Neural Networks on FPGA
Material Type:
Artigo 		Adicionar ao Meu Espaço

Optimizing the Convolution Operation to Accelerate Deep Neural Networks on FPGA

Ma, Yufei ; Cao, Yu ; Vrudhula, Sarma ; Seo, Jae-sun

IEEE transactions on very large scale integration (VLSI) systems, 2018-07, Vol.26 (7), p.1354-1367 [Periódico revisado por pares]

New York: IEEE

Texto completo disponível

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6
Reference Architectures for the Internet of Things
Reference Architectures for the Internet of Things
Material Type:
Artigo 		Adicionar ao Meu Espaço

Reference Architectures for the Internet of Things

Weyrich, Michael ; Ebert, Christof

IEEE software, 2016-01, Vol.33 (1), p.112-116 [Periódico revisado por pares]

Los Alamitos: IEEE

Texto completo disponível

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7
A Heterogeneous Group CNN for Image Super-Resolution
A Heterogeneous Group CNN for Image Super-Resolution
Material Type:
Artigo 		Adicionar ao Meu Espaço

A Heterogeneous Group CNN for Image Super-Resolution

Tian, Chunwei ; Zhang, Yanning ; Zuo, Wangmeng ; Lin, Chia-Wen ; Zhang, David ; Yuan, Yixuan

IEEE transaction on neural networks and learning systems, 2024-05, Vol.35 (5), p.6507-6519

United States: IEEE

Texto completo disponível

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8
Overview of the SpiNNaker System Architecture
Overview of the SpiNNaker System Architecture
Material Type:
Artigo 		Adicionar ao Meu Espaço

Overview of the SpiNNaker System Architecture

Furber, Steve B. ; Lester, David R. ; Plana, Luis A. ; Garside, Jim D. ; Painkras, Eustace ; Temple, Steve ; Brown, Andrew D.

IEEE transactions on computers, 2013-12, Vol.62 (12), p.2454-2467 [Periódico revisado por pares]

New York: IEEE

Texto completo disponível

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9
Home in A Hybrid World: or To Dwell in A Networked Environment
Home in A Hybrid World: or To Dwell in A Networked Environment
Material Type:
Livro 		Adicionar ao Meu Espaço

Home in A Hybrid World: or To Dwell in A Networked Environment

Pot, Martin

Denmark: River Publishers 2020

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10
High Throughput/Gate AES Hardware Architectures Based on Datapath Compression
High Throughput/Gate AES Hardware Architectures Based on Datapath Compression
Material Type:
Artigo 		Adicionar ao Meu Espaço

High Throughput/Gate AES Hardware Architectures Based on Datapath Compression

Ueno, Rei ; Homma, Naofumi ; Morioka, Sumio ; Miura, Noriyuki ; Matsuda, Kohei ; Nagata, Makoto ; Bhasin, Shivam ; Mathieu, Yves ; Graba, Tarik ; Danger, Jean-Luc

IEEE transactions on computers, 2020-04, Vol.69 (4), p.534-548 [Periódico revisado por pares]

IEEE

Texto completo disponível

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Deste Autor:

  1. Santos, J
  2. Santos, I
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  4. Santos, E
  5. Santos, D

Neste Assunto:

  1. Computer Science
  2. Computer Science
  3. Science & Technology
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  5. Computer Science, Hardware & Architecture

  • Realização: ABCD-USP USP   Logos de Redes Sociais: Freepik

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