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Low-Power and Area-Efficient Carry Select Adder
Low-Power and Area-Efficient Carry Select Adder
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Low-Power and Area-Efficient Carry Select Adder

Ramkumar, B. ; Kittur, H. M.

IEEE transactions on very large scale integration (VLSI) systems, 2012-02, Vol.20 (2), p.371-375 [Periódico revisado por pares]

New York, NY: IEEE

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Neuromorphic Electronic Circuits for Building Autonomous Cognitive Systems
Neuromorphic Electronic Circuits for Building Autonomous Cognitive Systems
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Neuromorphic Electronic Circuits for Building Autonomous Cognitive Systems

Chicca, Elisabetta ; Stefanini, Fabio ; Bartolozzi, Chiara ; Indiveri, Giacomo

Proceedings of the IEEE, 2014-09, Vol.102 (9), p.1367-1388 [Periódico revisado por pares]

New York, NY: IEEE

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Pipelined Parallel FFT Architectures via Folding Transformation
Pipelined Parallel FFT Architectures via Folding Transformation
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Pipelined Parallel FFT Architectures via Folding Transformation

Ayinala, M. ; Brown, M. ; Parhi, K. K.

IEEE transactions on very large scale integration (VLSI) systems, 2012-06, Vol.20 (6), p.1068-1081 [Periódico revisado por pares]

New York, NY: IEEE

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TSV Redundancy: Architecture and Design Issues in 3-D IC
TSV Redundancy: Architecture and Design Issues in 3-D IC
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TSV Redundancy: Architecture and Design Issues in 3-D IC

HSIEH, Ang-Chih ; HWANG, Tingting

IEEE transactions on very large scale integration (VLSI) systems, 2012-04, Vol.20 (4), p.711-722 [Periódico revisado por pares]

New York, NY: IEEE

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5
High-throughput LDPC decoders
High-throughput LDPC decoders
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High-throughput LDPC decoders

Mansour, M.M. ; Shanbhag, N.R.

IEEE transactions on very large scale integration (VLSI) systems, 2003-12, Vol.11 (6), p.976-996 [Periódico revisado por pares]

Piscataway, NJ: IEEE

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Flexible Hardware Architecture of Hierarchical K-Means Clustering for Large Cluster Number
Flexible Hardware Architecture of Hierarchical K-Means Clustering for Large Cluster Number
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Flexible Hardware Architecture of Hierarchical K-Means Clustering for Large Cluster Number

CHEN, Tse-Wei ; CHIEN, Shao-Yi

IEEE transactions on very large scale integration (VLSI) systems, 2011-08, Vol.19 (8), p.1336-1345 [Periódico revisado por pares]

New York, NY: IEEE

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7
A Low-Power FPGA Based on Autonomous Fine-Grain Power Gating
A Low-Power FPGA Based on Autonomous Fine-Grain Power Gating
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A Low-Power FPGA Based on Autonomous Fine-Grain Power Gating

Ishihara, S. ; Hariyama, M. ; Kameyama, M.

IEEE transactions on very large scale integration (VLSI) systems, 2011-08, Vol.19 (8), p.1394-1406 [Periódico revisado por pares]

New York, NY: IEEE

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8
A Flexible Parallel Hardware Architecture for AdaBoost-Based Real-Time Object Detection
A Flexible Parallel Hardware Architecture for AdaBoost-Based Real-Time Object Detection
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A Flexible Parallel Hardware Architecture for AdaBoost-Based Real-Time Object Detection

Kyrkou, C ; Theocharides, T

IEEE transactions on very large scale integration (VLSI) systems, 2011-06, Vol.19 (6), p.1034-1047 [Periódico revisado por pares]

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9
Bandwidth Adaptive Hardware Architecture of K-Means Clustering for Video Analysis
Bandwidth Adaptive Hardware Architecture of K-Means Clustering for Video Analysis
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Bandwidth Adaptive Hardware Architecture of K-Means Clustering for Video Analysis

CHEN, Tse-Wei ; CHIEN, Shao-Yi

IEEE transactions on very large scale integration (VLSI) systems, 2010-06, Vol.18 (6), p.957-966 [Periódico revisado por pares]

New York, NY: IEEE

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10
Application-Aware Topology Reconfiguration for On-Chip Networks
Application-Aware Topology Reconfiguration for On-Chip Networks
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Application-Aware Topology Reconfiguration for On-Chip Networks

Modarressi, M. ; Tavakkol, A. ; Sarbazi-Azad, H.

IEEE transactions on very large scale integration (VLSI) systems, 2011-11, Vol.19 (11), p.2010-2022 [Periódico revisado por pares]

New York, NY: IEEE

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