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Digital Systems Design with FPGAs and CPLDs
Digital Systems Design with FPGAs and CPLDs
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Livro 		Adicionar ao Meu Espaço

Digital Systems Design with FPGAs and CPLDs

Grout, Ian

San Diego: Elsevier Science 2011

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Ultra-Low Input Power Conversion Circuits Based on Tunnel-FETs
Ultra-Low Input Power Conversion Circuits Based on Tunnel-FETs
Material Type:
Livro 		Adicionar ao Meu Espaço

Ultra-Low Input Power Conversion Circuits Based on Tunnel-FETs

Cavalheiro, David

Aalborg: River Publishers 2018

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3
Teaching Digital Circuit Design With a 3-D Video Game: The Impact of Using In-Game Tools on Students' Performance
Teaching Digital Circuit Design With a 3-D Video Game: The Impact of Using In-Game Tools on Students' Performance
Material Type:
Artigo 		Adicionar ao Meu Espaço

Teaching Digital Circuit Design With a 3-D Video Game: The Impact of Using In-Game Tools on Students' Performance

Oren, Mehmet ; Pedersen, Susan ; Butler-Purry, Karen L.

IEEE transactions on education, 2021-02, Vol.64 (1), p.24-31 [Periódico revisado por pares]

IEEE

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4
Hybrid digital-optical imaging design for reducing surface asphericity cost while keeping high performance
Hybrid digital-optical imaging design for reducing surface asphericity cost while keeping high performance
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Ata de Congresso 		Adicionar ao Meu Espaço

Hybrid digital-optical imaging design for reducing surface asphericity cost while keeping high performance

Portilla, Javier ; Barbero, Sergio Erdmann, Andreas ; Smith, Daniel G ; Wyrowski, Frank

SPIE 2018

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5
A Review of Binarized Neural Networks
A Review of Binarized Neural Networks
Material Type:
Artigo 		Adicionar ao Meu Espaço

A Review of Binarized Neural Networks

Simons, Taylor ; Lee, Dah-Jye

Electronics (Basel), 2019-06, Vol.8 (6), p.661 [Periódico revisado por pares]

Basel: MDPI AG

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6
Digital Approach In Case of FPGA Realization of Quartic Neuron Model (QNM) Using Cost-Effective Mathematical Modifications
Digital Approach In Case of FPGA Realization of Quartic Neuron Model (QNM) Using Cost-Effective Mathematical Modifications
Material Type:
Artigo 		Adicionar ao Meu Espaço

Digital Approach In Case of FPGA Realization of Quartic Neuron Model (QNM) Using Cost-Effective Mathematical Modifications

Chen, Yong ; Wu, Xidong ; Ba, Huajun ; Miao, Xinjun ; Daoud, Mohammad Sh ; Pan, Xiaotian ; Mayet, Abdulilah Mohammad ; Zhang, Guodao ; Sun, Jun

IEEE transactions on circuits and systems. I, Regular papers, 2024-05, p.1-9 [Periódico revisado por pares]

IEEE

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7
A 32 nm Embedded, Fully-Digital, Phase-Locked Low Dropout Regulator for Fine Grained Power Management in Digital Circuits
A 32 nm Embedded, Fully-Digital, Phase-Locked Low Dropout Regulator for Fine Grained Power Management in Digital Circuits
Material Type:
Artigo 		Adicionar ao Meu Espaço

A 32 nm Embedded, Fully-Digital, Phase-Locked Low Dropout Regulator for Fine Grained Power Management in Digital Circuits

Gangopadhyay, Samantak ; Somasekhar, Dinesh ; Tschanz, James W. ; Raychowdhury, Arijit

IEEE journal of solid-state circuits, 2014-11, Vol.49 (11), p.2684-2693 [Periódico revisado por pares]

IEEE

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8
Margin Elimination Through Timing Error Detection in a Near-Threshold Enabled 32-bit Microcontroller in 40-nm CMOS
Margin Elimination Through Timing Error Detection in a Near-Threshold Enabled 32-bit Microcontroller in 40-nm CMOS
Material Type:
Artigo 		Adicionar ao Meu Espaço

Margin Elimination Through Timing Error Detection in a Near-Threshold Enabled 32-bit Microcontroller in 40-nm CMOS

Reyserhove, Hans ; Dehaene, Wim

IEEE journal of solid-state circuits, 2018-07, Vol.53 (7), p.2101-2113 [Periódico revisado por pares]

IEEE

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9
Implementing homomorphic encryption based secure feedback control
Implementing homomorphic encryption based secure feedback control
Material Type:
Artigo 		Adicionar ao Meu Espaço

Implementing homomorphic encryption based secure feedback control

Tran, Julian ; Farokhi, Farhad ; Cantoni, Michael ; Shames, Iman

Control engineering practice, 2020-04, Vol.97, p.104350, Article 104350 [Periódico revisado por pares]

Elsevier Ltd

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10
Design Margin Reduction Through Completion Detection in a 28-nm Near-Threshold DSP Processor
Design Margin Reduction Through Completion Detection in a 28-nm Near-Threshold DSP Processor
Material Type:
Artigo 		Adicionar ao Meu Espaço

Design Margin Reduction Through Completion Detection in a 28-nm Near-Threshold DSP Processor

Uytterhoeven, Roel ; Dehaene, Wim

IEEE journal of solid-state circuits, 2022-02, Vol.57 (2), p.651-660 [Periódico revisado por pares]

New York: IEEE

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