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Efficient exception handling support for GPUs
Efficient exception handling support for GPUs
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Efficient exception handling support for GPUs

Tanasic, Ivan ; Gelado, Isaac ; Jorda, Marc ; Ayguade, Eduard ; Navarro, Nacho

2017 50th Annual IEEE/ACM International Symposium on Microarchitecture (MICRO), 2017, p.109-122

New York, NY, USA: ACM

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Using intra-core loop-task accelerators to improve the productivity and performance of task-based parallel programs
Using intra-core loop-task accelerators to improve the productivity and performance of task-based parallel programs
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Using intra-core loop-task accelerators to improve the productivity and performance of task-based parallel programs

Kim, Ji ; Jiang, Shunning ; Torng, Christopher ; Wang, Moyang ; Srinath, Shreesha ; Ilbeyi, Berkin ; Al-Hawaj, Khalid ; Batten, Christopher

2017 50th Annual IEEE/ACM International Symposium on Microarchitecture (MICRO), 2017, p.759-773

New York, NY, USA: ACM

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13
DaDianNao: A Machine-Learning Supercomputer
DaDianNao: A Machine-Learning Supercomputer
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Ata de Congresso 		Adicionar ao Meu Espaço

DaDianNao: A Machine-Learning Supercomputer

Chen, Yunji ; Luo, Tao ; Liu, Shaoli ; Zhang, Shijin ; He, Liqiang ; Wang, Jia ; Li, Ling ; Chen, Tianshi ; Xu, Zhiwei ; Sun, Ninghui ; Temam, Olivier

2014 47th Annual IEEE/ACM International Symposium on Microarchitecture, 2014, p.609-622

Washington, DC, USA: IEEE Computer Society

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14
Software-Controlled Priority Characterization of POWER5 Processor
Software-Controlled Priority Characterization of POWER5 Processor
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Software-Controlled Priority Characterization of POWER5 Processor

Boneti, Carlos ; Cazorla, Francisco J. ; Gioiosa, Roberto ; Buyuktosunoglu, Alper ; Cher, Chen-Yong ; Valero, Mateo

2008 International Symposium on Computer Architecture, 2008, p.415-426

Washington, DC, USA: IEEE Computer Society

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15
A case for dynamic frequency tuning in on-chip networks
A case for dynamic frequency tuning in on-chip networks
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A case for dynamic frequency tuning in on-chip networks

Mishra, Asit K. ; Das, Reetuparna ; Eachempati, Soumya ; Iyer, Ravi ; Vijaykrishnan, N. ; Das, Chita R.

2009 42nd Annual IEEE/ACM International Symposium on Microarchitecture (MICRO), 2009, p.292-303

New York, NY, USA: ACM

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16
Network and Parallel Computing: IFIP International Conference, NPC 2008, Shanghai, China, October 18-20, 2008 : Proceedings
Network and Parallel Computing: IFIP International Conference, NPC 2008, Shanghai, China, October 18-20, 2008 : Proceedings
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Network and Parallel Computing: IFIP International Conference, NPC 2008, Shanghai, China, October 18-20, 2008 : Proceedings

Hutchison, David ; Kanade, Takeo ; Kittler, Josef ; Chen, Jinjun

Berlin/Heidelberg: Springer Berlin / Heidelberg 2008

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SODA: A Low-power Architecture For Software Radio
SODA: A Low-power Architecture For Software Radio
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Ata de Congresso 		Adicionar ao Meu Espaço

SODA: A Low-power Architecture For Software Radio

Lin, Yuan ; Lee, Hyunseok ; Woh, Mark ; Harel, Yoav ; Mahlke, Scott ; Mudge, Trevor ; Chakrabarti, Chaitali ; Flautner, Krisztian

33rd International Symposium on Computer Architecture (ISCA'06), 2006, p.89-101

Washington, DC, USA: IEEE Computer Society

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SymSig: A low latency interconnection topology for HPC clusters
SymSig: A low latency interconnection topology for HPC clusters
Material Type:
Ata de Congresso 		Adicionar ao Meu Espaço

SymSig: A low latency interconnection topology for HPC clusters

Brahme, Dhananjay ; Bhardwaj, Onkar ; Chaudhary, Vipin

20th Annual International Conference on High Performance Computing, 2013, p.462-471

IEEE

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An Analysis of Lazy and Eager Limited Preemption Approaches under DAG-Based Global Fixed Priority Scheduling
An Analysis of Lazy and Eager Limited Preemption Approaches under DAG-Based Global Fixed Priority Scheduling
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Ata de Congresso 		Adicionar ao Meu Espaço

An Analysis of Lazy and Eager Limited Preemption Approaches under DAG-Based Global Fixed Priority Scheduling

Serrano, Maria A ; Melani, Alessandra ; Kehr, Sebastian ; Bertogna, Marko ; Quiñones, Eduardo

Institute of Electrical and Electronics Engineers (IEEE) 2017

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20
Ambit: in-memory accelerator for bulk bitwise operations using commodity DRAM technology
Ambit: in-memory accelerator for bulk bitwise operations using commodity DRAM technology
Material Type:
Ata de Congresso 		Adicionar ao Meu Espaço

Ambit: in-memory accelerator for bulk bitwise operations using commodity DRAM technology

Seshadri, Vivek ; Lee, Donghyuk ; Mullins, Thomas ; Hassan, Hasan ; Boroumand, Amirali ; Kim, Jeremie ; Kozuch, Michael A. ; Mutlu, Onur ; Gibbons, Phillip B. ; Mowry, Todd C.

2017 50th Annual IEEE/ACM International Symposium on Microarchitecture (MICRO), 2017, p.273-287

New York, NY, USA: ACM

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