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11
Analysis methodologies and experimental benchmarks for eddy current testing
Analysis methodologies and experimental benchmarks for eddy current testing
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Analysis methodologies and experimental benchmarks for eddy current testing

Cardelli, E. ; Faba, A. ; Specogna, R. ; Tamburrino, A. ; Trevisan, F. ; Ventre, S.

IEEE transactions on magnetics, 2005-05, Vol.41 (5), p.1380-1383

New York, NY: IEEE

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12
A real-time traffic simulation using a communication latency hiding parallelization
A real-time traffic simulation using a communication latency hiding parallelization
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A real-time traffic simulation using a communication latency hiding parallelization

Chronopoulos, A.T. ; Johnston, C.M.

IEEE transactions on vehicular technology, 2002-05, Vol.51 (3), p.498-510 [Periódico revisado por pares]

New York, NY: IEEE

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13
Generalized Hypercube and Hyperbus Structures for a Computer Network
Generalized Hypercube and Hyperbus Structures for a Computer Network
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Artigo 		Adicionar ao Meu Espaço

Generalized Hypercube and Hyperbus Structures for a Computer Network

BHUYAN, L. N ; AGRAWAL, D. P

IEEE transactions on computers, 1984-04, Vol.C-33 (4), p.323-333 [Periódico revisado por pares]

New York, NY: IEEE

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14
2D time-domain electromagnetic macroscopic numerical modelling on parallel computer: application to the mm-wave silicon DIMPATT diode
2D time-domain electromagnetic macroscopic numerical modelling on parallel computer: application to the mm-wave silicon DIMPATT diode
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2D time-domain electromagnetic macroscopic numerical modelling on parallel computer: application to the mm-wave silicon DIMPATT diode

El Moussati, Ali ; Dalle, Christophe

Journal of computational electronics, 2008-03, Vol.7 (1), p.34-42 [Periódico revisado por pares]

Boston: Springer US

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15
An implementation framework for HPF distributed arrays on message-passing parallel computer systems
An implementation framework for HPF distributed arrays on message-passing parallel computer systems
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Artigo 		Adicionar ao Meu Espaço

An implementation framework for HPF distributed arrays on message-passing parallel computer systems

van Reeuwijk, K. ; Denissen, W. ; Sips, H.J. ; Paalvast, E.M.R.M.

IEEE transactions on parallel and distributed systems, 1996-09, Vol.7 (9), p.897-914 [Periódico revisado por pares]

Los Alamitos, CA: IEEE

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16
Parallel random number generation for VLSI systems using cellular automata
Parallel random number generation for VLSI systems using cellular automata
Material Type:
Artigo 		Adicionar ao Meu Espaço

Parallel random number generation for VLSI systems using cellular automata

Hortensius, P.D. ; McLeod, R.D. ; Card, H.C.

IEEE transactions on computers, 1989-10, Vol.38 (10), p.1466-1473 [Periódico revisado por pares]

New York, NY: IEEE

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17
Security as a new dimension in embedded system design
Security as a new dimension in embedded system design
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Ata de Congresso 		Adicionar ao Meu Espaço

Security as a new dimension in embedded system design

Kocher, Paul ; Lee, Ruby ; McGraw, Gary ; Raghunathan, Anand

Annual ACM IEEE Design Automation Conference: Proceedings of the 41st annual conference on Design automation, 2004, p.753-760

New York, NY, USA: ACM

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18
Parallel solution of Riccati matrix equations with the matrix sign function
Parallel solution of Riccati matrix equations with the matrix sign function
Material Type:
Artigo 		Adicionar ao Meu Espaço

Parallel solution of Riccati matrix equations with the matrix sign function

Quintana-Orti, Enrique S. ; Hernandez, Vicente

Automatica (Oxford), 1998-02, Vol.34 (2), p.151-156 [Periódico revisado por pares]

Oxford: Elsevier Ltd

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19
Modeling rotating machines on parallel computers using the BSP library
Modeling rotating machines on parallel computers using the BSP library
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Artigo 		Adicionar ao Meu Espaço

Modeling rotating machines on parallel computers using the BSP library

Walsh, D. ; Glasgow, C. ; Dawkins, I.

IEEE transactions on magnetics, 1999-05, Vol.35 (3), p.1286-1289

New York, NY: IEEE

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20
Compiler optimizations for enhancing parallelism and their impact on architecture design
Compiler optimizations for enhancing parallelism and their impact on architecture design
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Artigo 		Adicionar ao Meu Espaço

Compiler optimizations for enhancing parallelism and their impact on architecture design

Polychronopoulos, C.D.

IEEE transactions on computers, 1988-08, Vol.37 (8), p.991-1004 [Periódico revisado por pares]

New York, NY: IEEE

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