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The architecture of microprocessors
The architecture of microprocessors
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The architecture of microprocessors

F. Anceau Wilson, Manissa J. Dobrée; Milligan, Derek

Wokingham, England Reading, Mass. Addison-Wesley c1986

Localização: FAU - Fac. Arquitetura e Urbanismo    (621.38195 An21a ) e outros locais(Acessar)

2
On-Chip Interconnection Architecture of the Tile Processor
On-Chip Interconnection Architecture of the Tile Processor
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On-Chip Interconnection Architecture of the Tile Processor

Wentzlaff, D. ; Griffin, P. ; Hoffmann, H. ; Liewei Bao ; Edwards, B. ; Ramey, C. ; Mattina, M. ; Chyi-Chang Miao ; Brown, J.F. ; Agarwal, A.

IEEE MICRO, 2007-09, Vol.27 (5), p.15-31 [Periódico revisado por pares]

Los Alamitos: IEEE

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An Efficient and Scalable Semiconductor Architecture for Parallel Automata Processing
An Efficient and Scalable Semiconductor Architecture for Parallel Automata Processing
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An Efficient and Scalable Semiconductor Architecture for Parallel Automata Processing

Dlugosch, Paul ; Brown, Dave ; Glendenning, Paul ; Leventhal, Michael ; Noyes, Harold

IEEE transactions on parallel and distributed systems, 2014-12, Vol.25 (12), p.3088-3098 [Periódico revisado por pares]

New York: IEEE

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4
Advanced Computer Architecture: 11th Conference, ACA 2016, Weihai, China, August 22-23, 2016, Proceedings
Advanced Computer Architecture: 11th Conference, ACA 2016, Weihai, China, August 22-23, 2016, Proceedings
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Advanced Computer Architecture: 11th Conference, ACA 2016, Weihai, China, August 22-23, 2016, Proceedings

Wu, JunJie ; Li, Lian Wu, Junjie ; Li, Lian ; Li, Lian ; Wu, Junjie

Singapore: Springer Nature 2016

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5
A New Golden Age in Computer Architecture: Empowering the Machine-Learning Revolution
A New Golden Age in Computer Architecture: Empowering the Machine-Learning Revolution
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A New Golden Age in Computer Architecture: Empowering the Machine-Learning Revolution

Dean, Jeff ; Patterson, David ; Young, Cliff

IEEE MICRO, 2018-03, Vol.38 (2), p.21-29 [Periódico revisado por pares]

Los Alamitos: IEEE

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ML-HW Co-Design of Noise-Robust TinyML Models and Always-On Analog Compute-in-Memory Edge Accelerator
ML-HW Co-Design of Noise-Robust TinyML Models and Always-On Analog Compute-in-Memory Edge Accelerator
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ML-HW Co-Design of Noise-Robust TinyML Models and Always-On Analog Compute-in-Memory Edge Accelerator

Zhou, Chuteng ; Redondo, Fernando Garcia ; Buchel, Julian ; Boybat, Irem ; Comas, Xavier Timoneda ; Nandakumar, S. R. ; Das, Shidhartha ; Sebastian, Abu ; Le Gallo, Manuel ; Whatmough, Paul N.

IEEE MICRO, 2022-11, Vol.42 (6), p.76-87 [Periódico revisado por pares]

IEEE

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7
DNN+NeuroSim V2.0: An End-to-End Benchmarking Framework for Compute-in-Memory Accelerators for On-Chip Training
DNN+NeuroSim V2.0: An End-to-End Benchmarking Framework for Compute-in-Memory Accelerators for On-Chip Training
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DNN+NeuroSim V2.0: An End-to-End Benchmarking Framework for Compute-in-Memory Accelerators for On-Chip Training

Peng, Xiaochen ; Huang, Shanshi ; Jiang, Hongwu ; Lu, Anni ; Yu, Shimeng

IEEE transactions on computer-aided design of integrated circuits and systems, 2021-11, Vol.40 (11), p.2306-2319 [Periódico revisado por pares]

New York: IEEE

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The architecture of virtual machines
The architecture of virtual machines
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The architecture of virtual machines

Smith, J.E. ; Ravi Nair

Computer (Long Beach, Calif.), 2005-05, Vol.38 (5), p.32-38 [Periódico revisado por pares]

New York, NY: IEEE

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Low-Latency In Situ Image Analytics With FPGA-Based Quantized Convolutional Neural Network
Low-Latency In Situ Image Analytics With FPGA-Based Quantized Convolutional Neural Network
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Low-Latency In Situ Image Analytics With FPGA-Based Quantized Convolutional Neural Network

Wang, Maolin ; Lee, Kelvin C. M. ; Chung, Bob M. F. ; Bogaraju, Sharatchandra Varma ; Ng, Ho-Cheung ; Wong, Justin S. J. ; Shum, Ho Cheung ; Tsia, Kevin K. ; So, Hayden Kwok-Hay

IEEE transaction on neural networks and learning systems, 2022-07, Vol.PP (7), p.1-14

United States: IEEE

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FPGA implementation of hardware accelerated RTOS based on real-time event handling
FPGA implementation of hardware accelerated RTOS based on real-time event handling
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FPGA implementation of hardware accelerated RTOS based on real-time event handling

Zagan, Ionel ; Găitan, Vasile Gheorghiță

The Journal of supercomputing, 2023-07, Vol.79 (11), p.12441-12471 [Periódico revisado por pares]

New York: Springer US

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