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1
A systematic approach to exploring embedded system architectures at multiple abstraction levels
A systematic approach to exploring embedded system architectures at multiple abstraction levels
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A systematic approach to exploring embedded system architectures at multiple abstraction levels

Pimentel, A.D. ; Erbas, C. ; Polstra, S.

IEEE transactions on computers, 2006-02, Vol.55 (2), p.99-112 [Periódico revisado por pares]

New York: IEEE

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2
Designing efficient high performance server-centric data center network architecture
Designing efficient high performance server-centric data center network architecture
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Designing efficient high performance server-centric data center network architecture

Wang, Ting ; Su, Zhiyang ; Xia, Yu ; Muppala, Jogesh ; Hamdi, Mounir

Computer networks (Amsterdam, Netherlands : 1999), 2015-03, Vol.79, p.283-296 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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3
Programmable Crossbar Quantum-Dot Cellular Automata Circuits
Programmable Crossbar Quantum-Dot Cellular Automata Circuits
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Programmable Crossbar Quantum-Dot Cellular Automata Circuits

Kalogeiton, Vicky S. ; Papadopoulos, Dim P. ; Liolis, Orestis ; Mardiris, Vassilios A. ; Sirakoulis, Georgios C. ; Karafyllidis, Ioannis G.

IEEE transactions on computer-aided design of integrated circuits and systems, 2017-08, Vol.36 (8), p.1367-1380 [Periódico revisado por pares]

New York: IEEE

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4
Energy efficiency in wireless sensor networks: A top-down survey
Energy efficiency in wireless sensor networks: A top-down survey
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Energy efficiency in wireless sensor networks: A top-down survey

Rault, Tifenn ; Bouabdallah, Abdelmadjid ; Challal, Yacine

Computer networks (Amsterdam, Netherlands : 1999), 2014-07, Vol.67 (4), p.104-122 [Periódico revisado por pares]

Kidlington: Elsevier B.V

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5
An Energy-Efficient Mixed-Bitwidth Systolic Accelerator for NAS-Optimized Deep Neural Networks
An Energy-Efficient Mixed-Bitwidth Systolic Accelerator for NAS-Optimized Deep Neural Networks
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Artigo 		Adicionar ao Meu Espaço

An Energy-Efficient Mixed-Bitwidth Systolic Accelerator for NAS-Optimized Deep Neural Networks

Mao, Wei ; Dai, Liuyao ; Li, Kai ; Cheng, Quan ; Wang, Yuhang ; Du, Laimin ; Luo, Shaobo ; Huang, Mingqiang ; Yu, Hao

IEEE transactions on very large scale integration (VLSI) systems, 2022-12, Vol.30 (12), p.1-13 [Periódico revisado por pares]

New York: IEEE

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6
Exploring the tradeoffs between programmability and efficiency in data-parallel accelerators
Exploring the tradeoffs between programmability and efficiency in data-parallel accelerators
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Ata de Congresso 		Adicionar ao Meu Espaço

Exploring the tradeoffs between programmability and efficiency in data-parallel accelerators

Lee, Yunsup ; Avizienis, Rimas ; Bishara, Alex ; Xia, Richard ; Lockhart, Derek ; Batten, Christopher ; Asanović, Krste

2011 38th Annual International Symposium on Computer Architecture (ISCA), 2011, p.129-140

New York, NY, USA: ACM

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7
DURE: An Energy- and Resource-Efficient TCAM Architecture for FPGAs With Dynamic Updates
DURE: An Energy- and Resource-Efficient TCAM Architecture for FPGAs With Dynamic Updates
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DURE: An Energy- and Resource-Efficient TCAM Architecture for FPGAs With Dynamic Updates

Ullah, Inayat ; Ullah, Zahid ; Afzaal, Umar ; Lee, Jeong-A

IEEE transactions on very large scale integration (VLSI) systems, 2019-06, Vol.27 (6), p.1298-1307 [Periódico revisado por pares]

New York: IEEE

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8
High-Level Synthesis Design Space Exploration: Past, Present, and Future
High-Level Synthesis Design Space Exploration: Past, Present, and Future
Material Type:
Artigo 		Adicionar ao Meu Espaço

High-Level Synthesis Design Space Exploration: Past, Present, and Future

Schafer, Benjamin Carrion ; Wang, Zi

IEEE transactions on computer-aided design of integrated circuits and systems, 2020-10, Vol.39 (10), p.2628-2639 [Periódico revisado por pares]

New York: IEEE

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9
Analysis and Design of a Low-Voltage Low-Power Double-Tail Comparator
Analysis and Design of a Low-Voltage Low-Power Double-Tail Comparator
Material Type:
Artigo 		Adicionar ao Meu Espaço

Analysis and Design of a Low-Voltage Low-Power Double-Tail Comparator

Babayan-Mashhadi, Samaneh ; Lotfi, Reza

IEEE transactions on very large scale integration (VLSI) systems, 2014-02, Vol.22 (2), p.343-352 [Periódico revisado por pares]

New York: IEEE

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10
Improving the Accuracy and Hardware Efficiency of Neural Networks Using Approximate Multipliers
Improving the Accuracy and Hardware Efficiency of Neural Networks Using Approximate Multipliers
Material Type:
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Improving the Accuracy and Hardware Efficiency of Neural Networks Using Approximate Multipliers

Ansari, Mohammad Saeed ; Mrazek, Vojtech ; Cockburn, Bruce F. ; Sekanina, Lukas ; Vasicek, Zdenek ; Han, Jie

IEEE transactions on very large scale integration (VLSI) systems, 2020-02, Vol.28 (2), p.317-328 [Periódico revisado por pares]

New York: IEEE

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