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0.3 pJ/Bit Machine Learning Resistant Strong PUF Using Subthreshold Voltage Divider Array
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0.3 pJ/Bit Machine Learning Resistant Strong PUF Using Subthreshold Voltage Divider Array

Venkatesh, Abilash ; Venkatasubramaniyan, Aishwarya Bahudhanam ; Xi, Xiaodan ; Sanyal, Arindam

IEEE transactions on circuits and systems. II, Express briefs, 2020-08, Vol.67 (8), p.1394-1398 [Periódico revisado por pares]

New York: IEEE

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2
0.5-V 4-MB Variation-Aware Cache Architecture Using 7T/14T SRAM and Its Testing Scheme
0.5-V 4-MB Variation-Aware Cache Architecture Using 7T/14T SRAM and Its Testing Scheme
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0.5-V 4-MB Variation-Aware Cache Architecture Using 7T/14T SRAM and Its Testing Scheme

Nakata, Yohei ; Okumura, Shunsuke ; Kawaguchi, Hiroshi ; Yoshimoto, Masahiko

Information and Media Technologies, 2012, Vol.7(2), pp.544-555

Tokyo: Information and Media Technologies Editorial Board

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3
(05)アーキテクチャのイノベーション論: 中国民族自動車吉利のケース
(05)アーキテクチャのイノベーション論: 中国民族自動車吉利のケース
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(05)アーキテクチャのイノベーション論: 中国民族自動車吉利のケース

李, 東浩

經營學論集, 2014, pp.F5-1-F5-2

日本経営学会

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4
0.77 fJ/bit/search Content Addressable Memory Using Small Match Line Swing and Automated Background Checking Scheme for Variation Tolerance
0.77 fJ/bit/search Content Addressable Memory Using Small Match Line Swing and Automated Background Checking Scheme for Variation Tolerance
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0.77 fJ/bit/search Content Addressable Memory Using Small Match Line Swing and Automated Background Checking Scheme for Variation Tolerance

Anh Tuan Do ; Chun Yin ; Velayudhan, Kavitha ; Zhao Chuan Lee ; Kiat Seng Yeo ; Kim, Tony Tae-Hyoung

IEEE journal of solid-state circuits, 2014-07, Vol.49 (7), p.1487-1498 [Periódico revisado por pares]

New York: IEEE

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5
1,001 robot architectures for 1,001 robots [Industrial Activities]
1,001 robot architectures for 1,001 robots [Industrial Activities]
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1,001 robot architectures for 1,001 robots [Industrial Activities]

Prassler, E. ; Nilson, K.

IEEE robotics & automation magazine, 2009-03, Vol.16 (1), p.113-113 [Periódico revisado por pares]

New York: IEEE

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6
A 0.016 mV/mA Cross-Regulation 5-Output SIMO DC-DC Buck Converter Using Output-Voltage-Aware Charge Control Scheme
A 0.016 mV/mA Cross-Regulation 5-Output SIMO DC-DC Buck Converter Using Output-Voltage-Aware Charge Control Scheme
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A 0.016 mV/mA Cross-Regulation 5-Output SIMO DC-DC Buck Converter Using Output-Voltage-Aware Charge Control Scheme

Ngoc-Son Pham ; Taegeun Yoo ; Kim, Tony Tae-Hyoung ; Chan-Gun Lee ; Kwang-Hyun Baek

IEEE transactions on power electronics, 2018-11, Vol.33 (11), p.9619-9630 [Periódico revisado por pares]

New York: IEEE

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7
A 0.027-mm2 Self-Calibrating Successive Approximation ADC Core in 0.18-.MU.m CMOS
A 0.027-mm2 Self-Calibrating Successive Approximation ADC Core in 0.18-.MU.m CMOS
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A 0.027-mm2 Self-Calibrating Successive Approximation ADC Core in 0.18-.MU.m CMOS

KURAMOCHI, Yasuhide ; MATSUZAWA, Akira ; KAWABATA, Masayuki

IEICE transactions on fundamentals of electronics, communications and computer sciences, 2009, Vol.E92-A (2), p.360-366 [Periódico revisado por pares]

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8
A 0.13- \mu \text CMOS Dynamically Reconfigurable Charge Pump for Electrostatic MEMS Actuation
A 0.13- \mu \text CMOS Dynamically Reconfigurable Charge Pump for Electrostatic MEMS Actuation
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A 0.13- \mu \text CMOS Dynamically Reconfigurable Charge Pump for Electrostatic MEMS Actuation

Alameh, Abdul Hafiz ; Nabki, Frederic

IEEE transactions on very large scale integration (VLSI) systems, 2017-04, Vol.25 (4), p.1261-1270 [Periódico revisado por pares]

IEEE

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9
A 0.13mJ/Prediction CIFAR-100 Fully Synthesizable Raster-Scan-Based Wired-Logic Processor in 16-nm FPGA
A 0.13mJ/Prediction CIFAR-100 Fully Synthesizable Raster-Scan-Based Wired-Logic Processor in 16-nm FPGA
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A 0.13mJ/Prediction CIFAR-100 Fully Synthesizable Raster-Scan-Based Wired-Logic Processor in 16-nm FPGA

LI, Dongzhu ; ZHAN, Zhijie ; SUMIKAWA, Rei ; HAMADA, Mototsugu ; KOSUGE, Atsutake ; KURODA, Tadahiro

IEICE Transactions on Electronics, 2024/06/01, Vol.E107.C(6), pp.155-162 [Periódico revisado por pares]

Tokyo: The Institute of Electronics, Information and Communication Engineers

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10
A 0.18  m CMOS 3rd-Order Digitally Programmable Gm-C Filter for VHF Applications
A 0.18  m CMOS 3rd-Order Digitally Programmable Gm-C Filter for VHF Applications
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A 0.18  m CMOS 3rd-Order Digitally Programmable Gm-C Filter for VHF Applications

OTIN, A.

IEICE transactions on information and systems, 2005-07, Vol.E88-D (7), p.1509-1510 [Periódico revisado por pares]

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  1. Revistas revisadas por pares (30.357)

Data de Publicação 

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  1. Antes de1962  (112)
  2. 1962Até1976  (454)
  3. 1977Até1991  (1.147)
  4. 1992Até2007  (10.133)
  5. Após 2007  (23.363)
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  1. Inglês  (30.019)
  2. Alemão  (21)
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