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0.18um CMOS integrated chipset for 5.8GHz DSRC systems with +10dBm output power
0.18um CMOS integrated chipset for 5.8GHz DSRC systems with +10dBm output power
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0.18um CMOS integrated chipset for 5.8GHz DSRC systems with +10dBm output power

Shin, Sangho ; Yun, Seokoh ; Cho, Sanghyun ; Kim, Jongmoon ; Kang, Minseok ; Oh, Wonkap ; Kang, Sung-Mo

2008 IEEE International Symposium on Circuits and Systems, 2008, p.1958-1961

IEEE

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2
0.25-μm technology arithmetic codec for mobile multimedia communicators
0.25-μm technology arithmetic codec for mobile multimedia communicators
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0.25-μm technology arithmetic codec for mobile multimedia communicators

Alvarez, Alberto ; Lopez, Sebastian ; Lopez, Jose F ; Sarmiento, Roberto

SPIE proceedings series, 2003, Vol.5117, p.361-369

Bellingham WA: SPIE

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3
0.7 V Monolithic CMOS LNA for 802.11 A/B WLAN Application
0.7 V Monolithic CMOS LNA for 802.11 A/B WLAN Application
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0.7 V Monolithic CMOS LNA for 802.11 A/B WLAN Application

Wang-Chi Cheng ; Cheong-Fat Chan ; Suyi Tao ; King-Keung Mok

APCCAS 2006 - 2006 IEEE Asia Pacific Conference on Circuits and Systems, 2006, p.25-28

IEEE

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4
0.8 V GPS band CMOS VCO with 29% Tuning Range
0.8 V GPS band CMOS VCO with 29% Tuning Range
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Ata de Congresso 		Adicionar ao Meu Espaço

0.8 V GPS band CMOS VCO with 29% Tuning Range

Wang-Chi Cheng ; Cheong-Fat Chan ; Kong-Pang Pun ; Chiu-Sing Choy

APCCAS 2006 - 2006 IEEE Asia Pacific Conference on Circuits and Systems, 2006, p.522-525

IEEE

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5
0.9-V sense-amplifier-based reduced-clock-swing MTCMOS flip-flops
0.9-V sense-amplifier-based reduced-clock-swing MTCMOS flip-flops
Material Type:
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0.9-V sense-amplifier-based reduced-clock-swing MTCMOS flip-flops

Jinn-Shyan Wang ; Hung-Yu Li

Proceedings. IEEE Asia-Pacific Conference on ASIC, 2002, p.271-274

IEEE

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6
0.9V 12mW 2MSPS algorithmic ADC with 81dB SFDR
0.9V 12mW 2MSPS algorithmic ADC with 81dB SFDR
Material Type:
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0.9V 12mW 2MSPS algorithmic ADC with 81dB SFDR

Jipeng Li ; Gil-Cho Ahn ; Dong-Young Chang ; Un-Ku Moon

2004 Symposium on VLSI Circuits. Digest of Technical Papers (IEEE Cat. No.04CH37525), 2004, p.436-439

IEEE

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7
A 0-1 program to form minimum cost clusters in the downlink of cooperating base stations
A 0-1 program to form minimum cost clusters in the downlink of cooperating base stations
Material Type:
Ata de Congresso 		Adicionar ao Meu Espaço

A 0-1 program to form minimum cost clusters in the downlink of cooperating base stations

Giovanidis, A. ; Krolikowski, J. ; Brueck, S.

2012 IEEE Wireless Communications and Networking Conference (WCNC), 2012, p.940-945

IEEE

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8
A 0.18-μm CMOS clock and data recovery circuit with reference-less dual loops
A 0.18-μm CMOS clock and data recovery circuit with reference-less dual loops
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A 0.18-μm CMOS clock and data recovery circuit with reference-less dual loops

Miao Li ; Kwasniewski, Tad ; Shoujun Wang

2008 IEEE International Symposium on Circuits and Systems (ISCAS), 2008, p.2358-2361

IEEE

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9
A 0.18 μm CMOS Gaussian Monocycle Pulse Circuit Design for UWB
A 0.18 μm CMOS Gaussian Monocycle Pulse Circuit Design for UWB
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A 0.18 μm CMOS Gaussian Monocycle Pulse Circuit Design for UWB

Hidayat, R. ; Dejhan, K. ; Moungnoul, P. ; Miyanaga, Y.

APCCAS 2006 - 2006 IEEE Asia Pacific Conference on Circuits and Systems, 2006, p.89-92

IEEE

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10
A 0.18-μm CMOS UWB Low Noise Amplifier for Full-Band (3.1-10.6GHz) Application
A 0.18-μm CMOS UWB Low Noise Amplifier for Full-Band (3.1-10.6GHz) Application
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A 0.18-μm CMOS UWB Low Noise Amplifier for Full-Band (3.1-10.6GHz) Application

Ruey-Lue Wang ; Shih-Chih Chen ; Hsiang-Chen Kuo ; Chien-Hsuan Liu

APCCAS 2006 - 2006 IEEE Asia Pacific Conference on Circuits and Systems, 2006, p.363-366

IEEE

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