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1
0/1 Knapsack on Hardware: A Complete Solution
0/1 Knapsack on Hardware: A Complete Solution
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0/1 Knapsack on Hardware: A Complete Solution

Nibbelink, K. ; Rajopadhye, S. ; McConnell, R.

2007 IEEE International Conf. on Application-specific Systems, Architectures and Processors (ASAP), 2007, p.160-167

IEEE

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2
0.1 μm RFCMOS on high resistivity substrates for system on chip (SOC) applications
0.1 μm RFCMOS on high resistivity substrates for system on chip (SOC) applications
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0.1 μm RFCMOS on high resistivity substrates for system on chip (SOC) applications

YANG, J.-Y ; BENAISSA, K ; ASHBURN, S ; MADHANI, P ; BLYTHE, T ; SHICHIJO, H ; CRENSHAW, D ; WILLIAMS, B ; SRIDHAR, S ; AI, J ; BOSELLI, G ; ZHAO, S ; TANG, S.-P ; MAHALINGAM, N

Piscataway NJ: IEEE 2002

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3
0.13 μm CMOS Traveling-Wave Power Amplifier with On- and Off-Chip Gate-Line Termination
0.13 μm CMOS Traveling-Wave Power Amplifier with On- and Off-Chip Gate-Line Termination
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0.13 μm CMOS Traveling-Wave Power Amplifier with On- and Off-Chip Gate-Line Termination

Vasjanov, Aleksandr ; Barzdenas, Vaidotas

Electronics (Basel), 2020-01, Vol.9 (1), p.133 [Periódico revisado por pares]

Basel: MDPI AG

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4
A 0-1 program to form minimum cost clusters in the downlink of cooperating base stations
A 0-1 program to form minimum cost clusters in the downlink of cooperating base stations
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A 0-1 program to form minimum cost clusters in the downlink of cooperating base stations

Giovanidis, A. ; Krolikowski, J. ; Brueck, S.

2012 IEEE Wireless Communications and Networking Conference (WCNC), 2012, p.940-945

IEEE

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5
A 0.0018 mm frequency-to-digital-converter-based CMOS smart temperature sensor
A 0.0018 mm frequency-to-digital-converter-based CMOS smart temperature sensor
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A 0.0018 mm frequency-to-digital-converter-based CMOS smart temperature sensor

Lee, Hokyu ; Kim, Kisoo ; Jung, Sangdon ; Song, Janghoon ; Kim, Jong-Kook ; Kim, Chulwoo

Analog integrated circuits and signal processing, 2010-08, Vol.64 (2), p.153-157 [Periódico revisado por pares]

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6
A 0.004% resolution & SAT<1.8 μson-chip adaptive anti-aging system using cuckoo intelligence-based algorithm in 65 nm CMOS
A 0.004% resolution & SAT<1.8 μson-chip adaptive anti-aging system using cuckoo intelligence-based algorithm in 65 nm CMOS
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A 0.004% resolution & SAT<1.8 μson-chip adaptive anti-aging system using cuckoo intelligence-based algorithm in 65 nm CMOS

Zhang, Yuejun ; Zhang, Haiming ; Wang, Pengjun ; Wu, Qiufeng ; Li, Gang

Integration (Amsterdam), 2021-05, Vol.78, p.135-143 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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7
A 0.0043-mm2 0.085-&#956;W/MHz Relaxation Oscillator Using Charge-Prestored Asymmetric Swings R- RC Network
A 0.0043-mm2 0.085-&#956;W/MHz Relaxation Oscillator Using Charge-Prestored Asymmetric Swings R- RC Network
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A 0.0043-mm2 0.085-μW/MHz Relaxation Oscillator Using Charge-Prestored Asymmetric Swings R- RC Network

Wei, Yuchen ; Yang, Shiheng ; Liu, Yueduo ; Bao, Rongxin ; Zhu, Zihao ; Lin, Jiahui ; Zhang, Zehao ; Chen, Yong ; Yin, Jun ; Mak, Pui-In ; Li, Qiang

IEEE transactions on very large scale integration (VLSI) systems, 2023-08, Vol.31 (8), p.1248 [Periódico revisado por pares]

New York: The Institute of Electrical and Electronics Engineers, Inc. (IEEE)

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8
A 0.1-2-GHz Quadrature Correction Loop for Digital Multiphase Clock Generation Circuits in 130-nm CMOS
A 0.1-2-GHz Quadrature Correction Loop for Digital Multiphase Clock Generation Circuits in 130-nm CMOS
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A 0.1-2-GHz Quadrature Correction Loop for Digital Multiphase Clock Generation Circuits in 130-nm CMOS

Raja, Immanuel ; Khatri, Vishal ; Zahir, Zaira ; Banerjee, Gaurab

IEEE transactions on very large scale integration (VLSI) systems, 2017-03, Vol.25 (3), p.1044-1053 [Periódico revisado por pares]

IEEE

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9
A 0.1-3.5-GHz Duty-Cycle Measurement and Correction Technique in 130-nm CMOS
A 0.1-3.5-GHz Duty-Cycle Measurement and Correction Technique in 130-nm CMOS
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Artigo 		Adicionar ao Meu Espaço

A 0.1-3.5-GHz Duty-Cycle Measurement and Correction Technique in 130-nm CMOS

Raja, Immanuel ; Banerjee, Gaurab ; Zeidan, Mohamad A. ; Abraham, Jacob A.

IEEE transactions on very large scale integration (VLSI) systems, 2016-05, Vol.24 (5), p.1975-1983 [Periódico revisado por pares]

New York: IEEE

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10
A 0.1&#8211;4&#160;GHz SDR receiver with reconfigurable 10&#8211;100&#160;MHz signal bandwidth in 65&#160;nm CMOS
A 0.1&#8211;4&#160;GHz SDR receiver with reconfigurable 10&#8211;100&#160;MHz signal bandwidth in 65&#160;nm CMOS
Material Type:
Artigo 		Adicionar ao Meu Espaço

A 0.1–4 GHz SDR receiver with reconfigurable 10–100 MHz signal bandwidth in 65 nm CMOS

Zhang, Xinwang ; Chi, Baoyong ; Cao, Meng ; Fu, Ling ; Xia, Zhaokang ; Yin, Yun ; Feng, Hongxing ; Zhang, Xing ; Chiang, Patrick ; Wang, Zhihua

Analog integrated circuits and signal processing, 2013-12, Vol.77 (3), p.567-582 [Periódico revisado por pares]

Boston: Springer US

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