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1
Hierarchical power management of a system with autonomously power-managed components using reinforcement learning
Hierarchical power management of a system with autonomously power-managed components using reinforcement learning
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Hierarchical power management of a system with autonomously power-managed components using reinforcement learning

Triki, M. ; Wang, Y. ; Ammari, A.C. ; Pedram, M.

Integration (Amsterdam), 2015-01, Vol.48, p.10-20 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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2
Stochastic logical effort as a variation aware delay model to estimate timing yield
Stochastic logical effort as a variation aware delay model to estimate timing yield
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Artigo 		Adicionar ao Meu Espaço

Stochastic logical effort as a variation aware delay model to estimate timing yield

Bayrakci, Alp Arslan

Integration (Amsterdam), 2015-01, Vol.48, p.101-108 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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3
A highly dependable self-adaptive mixed-signal multi-core system-on-chip architecture
A highly dependable self-adaptive mixed-signal multi-core system-on-chip architecture
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Artigo 		Adicionar ao Meu Espaço

A highly dependable self-adaptive mixed-signal multi-core system-on-chip architecture

von Rosen, Julius ; Salfelder, Felix ; Hedrich, Lars ; Betting, Benjamin ; Brinkschulte, Uwe

Integration (Amsterdam), 2015-01, Vol.48, p.55-71 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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4
Fast multidimensional optimization of analog circuits initiated by monodimensional global Peano explorations
Fast multidimensional optimization of analog circuits initiated by monodimensional global Peano explorations
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Fast multidimensional optimization of analog circuits initiated by monodimensional global Peano explorations

Malak, Akram ; Li, Yao ; Iskander, Ramy ; Durbin, François ; Javid, Farakh ; Guebhard, Jean-Marc ; Louërat, Marie-Minerve ; Tissot, André

Integration (Amsterdam), 2015-01, Vol.48, p.198-212 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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5
A synchronous latency-insensitive RISC for better than worst-case design
A synchronous latency-insensitive RISC for better than worst-case design
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A synchronous latency-insensitive RISC for better than worst-case design

Casu, Mario R. ; Mantovani, Paolo

Integration (Amsterdam), 2015-01, Vol.48, p.72-82 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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6
Reducing random-dopant fluctuation impact using footer transistors in many-core systems
Reducing random-dopant fluctuation impact using footer transistors in many-core systems
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Reducing random-dopant fluctuation impact using footer transistors in many-core systems

Majzoub, Sohaib

Integration (Amsterdam), 2015-01, Vol.48, p.46-54 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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7
An energy-efficient, high-precision SFP LPFIR filter engine for digital hearing aids
An energy-efficient, high-precision SFP LPFIR filter engine for digital hearing aids
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An energy-efficient, high-precision SFP LPFIR filter engine for digital hearing aids

Ou, Shih-Hao ; Chang, Kuo-Chiang ; Liu, Chih-Wei

Integration (Amsterdam), 2015-01, Vol.48, p.230-238 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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8
Length-constrained escape routing of differential pairs
Length-constrained escape routing of differential pairs
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Length-constrained escape routing of differential pairs

Yan, Jin-Tai

Integration (Amsterdam), 2015-01, Vol.48, p.158-169 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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9
Timing-constrained power minimization in VLSI circuits by simultaneous multilayer wire spacing
Timing-constrained power minimization in VLSI circuits by simultaneous multilayer wire spacing
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Timing-constrained power minimization in VLSI circuits by simultaneous multilayer wire spacing

Moiseev, Konstantin ; Wimer, Shmuel ; Kolodny, Avinoam

Integration (Amsterdam), 2015-01, Vol.48, p.116-128 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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10
On optimizing system energy of voltage–frequency island based 3-D multi-core SoCs under thermal constraints
On optimizing system energy of voltage–frequency island based 3-D multi-core SoCs under thermal constraints
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On optimizing system energy of voltage–frequency island based 3-D multi-core SoCs under thermal constraints

Jin, Song ; Wang, Yu ; Liu, Tongna

Integration (Amsterdam), 2015-01, Vol.48, p.36-45 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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