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Day–Night architecture: Development of an ultra-low power RISC-V processor for wearable anomaly detection
Day–Night architecture: Development of an ultra-low power RISC-V processor for wearable anomaly detection
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Day–Night architecture: Development of an ultra-low power RISC-V processor for wearable anomaly detection

Choi, Eunjin ; Park, Jina ; Lee, Kyeongwon ; Lee, Jae-Jin ; Han, Kyuseung ; Lee, Woojoo

Journal of systems architecture, 2024-07, Vol.152, p.103161, Article 103161 [Periódico revisado por pares]

Elsevier B.V

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AI for conceptual architecture: Reflections on designing with text-to-text, text-toimage, and image-to-image generators
AI for conceptual architecture: Reflections on designing with text-to-text, text-toimage, and image-to-image generators
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AI for conceptual architecture: Reflections on designing with text-to-text, text-toimage, and image-to-image generators

Horvath, Anca-Simona ; Pouliou, Panagiota

Frontiers of architectural research, 2024-06, Vol.13 (3), p.593-612 [Periódico revisado por pares]

Nanjing: KeAi Publishing Communications Ltd

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3
ExTern: Boosting RISC-V core performance using ternary encoding
ExTern: Boosting RISC-V core performance using ternary encoding
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ExTern: Boosting RISC-V core performance using ternary encoding

EbrahimiAzandaryani, Farhad ; Fey, Dietmar

Microprocessors and microsystems, 2024-06, Vol.107, p.105058, Article 105058 [Periódico revisado por pares]

Elsevier B.V

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An energy-efficient image filtering interpolation algorithm using domain-specific dynamic reconfigurable array processor
An energy-efficient image filtering interpolation algorithm using domain-specific dynamic reconfigurable array processor
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An energy-efficient image filtering interpolation algorithm using domain-specific dynamic reconfigurable array processor

Guo, Aiying ; Lin, Enlin ; Zhang, Jianhua ; Liu, Jingjing

Integration (Amsterdam), 2024-05, Vol.96, p.102167, Article 102167 [Periódico revisado por pares]

Elsevier B.V

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Memory-processor co-scheduling of AECR-DAG real-time tasks on partitioned multicore platforms with scratchpads
Memory-processor co-scheduling of AECR-DAG real-time tasks on partitioned multicore platforms with scratchpads
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Memory-processor co-scheduling of AECR-DAG real-time tasks on partitioned multicore platforms with scratchpads

Senoussaoui, Ikram ; Lipari, Giuseppe ; Zahaf, Houssam-Eddine ; Benhaoua, Mohammed Kamal

Journal of systems architecture, 2024-05, Vol.150, p.103117, Article 103117 [Periódico revisado por pares]

Elsevier B.V

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MOSAIC: Maximizing ResOurce Sharing in Behavioral Application SpecIfic ProCessors
MOSAIC: Maximizing ResOurce Sharing in Behavioral Application SpecIfic ProCessors
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MOSAIC: Maximizing ResOurce Sharing in Behavioral Application SpecIfic ProCessors

Si, Qilin ; Carrion Schafer, Benjamin

Microprocessors and microsystems, 2024-04, Vol.106, p.105039, Article 105039 [Periódico revisado por pares]

Elsevier B.V

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Deep neural networks accelerators with focus on tensor processors
Deep neural networks accelerators with focus on tensor processors
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Deep neural networks accelerators with focus on tensor processors

Bolhasani, Hamidreza ; Marandinejad, Mohammad

Microprocessors and microsystems, 2024-03, Vol.105, p.105005, Article 105005 [Periódico revisado por pares]

Elsevier B.V

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8
Automating application-driven customization of ASIPs: A survey
Automating application-driven customization of ASIPs: A survey
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Automating application-driven customization of ASIPs: A survey

Hussein, Eslam ; Waschneck, Bernd ; Mayr, Christian

Journal of systems architecture, 2024-03, Vol.148, p.103080, Article 103080 [Periódico revisado por pares]

Elsevier B.V

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Time-predictable task-to-thread mapping in multi-core processors
Time-predictable task-to-thread mapping in multi-core processors
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Time-predictable task-to-thread mapping in multi-core processors

Samadi, Mohammad ; Royuela, Sara ; Pinho, Luis Miguel ; Carvalho, Tiago ; Quiñones, Eduardo

Journal of systems architecture, 2024-03, Vol.148, p.103068, Article 103068 [Periódico revisado por pares]

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10
Vehicular network processor design for scalability & automation: Elastic Gateway SoC concept & builder
Vehicular network processor design for scalability & automation: Elastic Gateway SoC concept & builder
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Vehicular network processor design for scalability & automation: Elastic Gateway SoC concept & builder

Gonzalez Mariño, Angela ; Fons, Francesc ; Moreno Arostegui, Juan Manuel

Journal of systems architecture, 2024-01, Vol.146, p.103038, Article 103038 [Periódico revisado por pares]

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  2. 1988Até1996  (258)
  3. 1997Até2005  (224)
  4. 2006Até2015  (581)
  5. Após 2015  (524)
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  2. Chinês  (1)
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