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1
Hierarchical power management of a system with autonomously power-managed components using reinforcement learning
Hierarchical power management of a system with autonomously power-managed components using reinforcement learning
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Hierarchical power management of a system with autonomously power-managed components using reinforcement learning

Triki, M. ; Wang, Y. ; Ammari, A.C. ; Pedram, M.

Integration (Amsterdam), 2015-01, Vol.48, p.10-20 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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2
A synchronous latency-insensitive RISC for better than worst-case design
A synchronous latency-insensitive RISC for better than worst-case design
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Artigo 		Adicionar ao Meu Espaço

A synchronous latency-insensitive RISC for better than worst-case design

Casu, Mario R. ; Mantovani, Paolo

Integration (Amsterdam), 2015-01, Vol.48, p.72-82 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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3
On optimizing system energy of voltage–frequency island based 3-D multi-core SoCs under thermal constraints
On optimizing system energy of voltage–frequency island based 3-D multi-core SoCs under thermal constraints
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On optimizing system energy of voltage–frequency island based 3-D multi-core SoCs under thermal constraints

Jin, Song ; Wang, Yu ; Liu, Tongna

Integration (Amsterdam), 2015-01, Vol.48, p.36-45 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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4
An energy-efficient, high-precision SFP LPFIR filter engine for digital hearing aids
An energy-efficient, high-precision SFP LPFIR filter engine for digital hearing aids
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An energy-efficient, high-precision SFP LPFIR filter engine for digital hearing aids

Ou, Shih-Hao ; Chang, Kuo-Chiang ; Liu, Chih-Wei

Integration (Amsterdam), 2015-01, Vol.48, p.230-238 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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5
Timing-constrained power minimization in VLSI circuits by simultaneous multilayer wire spacing
Timing-constrained power minimization in VLSI circuits by simultaneous multilayer wire spacing
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Timing-constrained power minimization in VLSI circuits by simultaneous multilayer wire spacing

Moiseev, Konstantin ; Wimer, Shmuel ; Kolodny, Avinoam

Integration (Amsterdam), 2015-01, Vol.48, p.116-128 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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6
Energy efficient hybrid adder architecture
Energy efficient hybrid adder architecture
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Energy efficient hybrid adder architecture

Wimer, Shmuel ; Stanislavsky, Amnon

Integration (Amsterdam), 2015-01, Vol.48, p.109-115 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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7
Efficient architecture and hardware implementation of hybrid fuzzy-Kalman filter for workload prediction
Efficient architecture and hardware implementation of hybrid fuzzy-Kalman filter for workload prediction
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Efficient architecture and hardware implementation of hybrid fuzzy-Kalman filter for workload prediction

Kuang, Shiann-Rong ; Wu, Kun-Yi ; Ke, Bao-Chen ; Yeh, Jia-Huei ; Jheng, Hao-Yi

Integration (Amsterdam), 2014-09, Vol.47 (4), p.408-416 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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8
GrainFlow: Enable testing for future internet architectures by per-bit customization
GrainFlow: Enable testing for future internet architectures by per-bit customization
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GrainFlow: Enable testing for future internet architectures by per-bit customization

Liu, Zhongjin ; Li, Yong ; Cui, Bo ; Su, Li ; Jin, Depeng ; Zeng, Lieguang

Computer networks (Amsterdam, Netherlands : 1999), 2014-08, Vol.69, p.121-132 [Periódico revisado por pares]

Kidlington: Elsevier B.V

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9
An inverted, organic WORM device based on PEDOT:PSS with very low turn-on voltage
An inverted, organic WORM device based on PEDOT:PSS with very low turn-on voltage
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An inverted, organic WORM device based on PEDOT:PSS with very low turn-on voltage

Nawrocki, Robert A. ; Galiger, Erin M. ; Ostrowski, David P. ; Bailey, Brian A. ; Jiang, Xin ; Voyles, Richard M. ; Kopidakis, Nikos ; Olson, Dana C. ; Shaheen, Sean E.

Organic electronics, 2014-08, Vol.15 (8), p.1791-1798 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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10
Recursive design of hardware priority queues
Recursive design of hardware priority queues
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Recursive design of hardware priority queues

Afek, Y. ; Bremler-Barr, A. ; Schiff, L.

Computer networks (Amsterdam, Netherlands : 1999), 2014-06, Vol.66, p.52-67 [Periódico revisado por pares]

Kidlington: Elsevier B.V

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