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Cost-effective VLSI architectures and buffer size optimization for full-search block matching algorithms
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Cost-effective VLSI architectures and buffer size optimization for full-search block matching algorithms

YEH, Y.-H ; LEE, C.-Y

IEEE transactions on very large scale integration (VLSI) systems, 1999-09, Vol.7 (3), p.345-358 [Periódico revisado por pares]

Piscataway, NJ: IEEE

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