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Prenormalization rounding in IEEE floating-point operations using a flagged prefix adder
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Prenormalization rounding in IEEE floating-point operations using a flagged prefix adder

Burgess, N.

IEEE transactions on very large scale integration (VLSI) systems, 2005-02, Vol.13 (2), p.266-277 [Periódico revisado por pares]

Piscataway, NJ: IEEE

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