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0.11-2.5 GHz All-digital DLL for Mobile Memory Interface with Phase Sampling Window Adaptation to Reduce Jitter Accumulation
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0.11-2.5 GHz All-digital DLL for Mobile Memory Interface with Phase Sampling Window Adaptation to Reduce Jitter Accumulation

채주형 ; 김민오 ; 홍기문 ; 박지환 ; 고형준 ; 신우열 ; 지한규 ; 정덕균 ; 김수환

JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE, 2017, 17(3), 75, pp.411-424

대한전자공학회

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2
0.13-μm 32-Mb/64-Mb embedded DRAM core with high efficient redundancy and enhanced testability
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0.13-μm 32-Mb/64-Mb embedded DRAM core with high efficient redundancy and enhanced testability

Kikukawa, H. ; Tomishima, S. ; Tsuji, T. ; Kawasaki, T. ; Sakamoto, S. ; Ishikawa, M. ; Abe, W. ; Tanizaki, H. ; Kato, H. ; Uchikoba, T. ; Inokuchi, T. ; Senoh, M. ; Fukushima, Y. ; Nirro, M. ; Maruta, M. ; Shibayama, A. ; Ooishi, T. ; Takahashi, K. ; Hidaka, H.

IEEE journal of solid-state circuits, 2002-07, Vol.37 (7), p.932-940 [Periódico revisado por pares]

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3
0.18-μm CMOS equalization techniques for 10-Gb/s fiber optical communication links
0.18-μm CMOS equalization techniques for 10-Gb/s fiber optical communication links
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0.18-μm CMOS equalization techniques for 10-Gb/s fiber optical communication links

MAENG, Moonkyun ; BIEN, Franklin ; HUR, Youngsik ; KIM, Hyoungsoo ; CHANDRAMOULI, Soumya ; GEBARA, Edward ; LASKAR, Joy

IEEE transactions on microwave theory and techniques, 2005-11, Vol.53 (11), p.3509-3519 [Periódico revisado por pares]

New York, NY: Institute of Electrical and Electronics Engineers

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4
0.18-μm Nondestructive readout FeRAM using charge compensation technique
0.18-μm Nondestructive readout FeRAM using charge compensation technique
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0.18-μm Nondestructive readout FeRAM using charge compensation technique

KATO, Yoshihisa ; YAMADA, Takayoshi ; SHIMADA, Yasuhiro

IEEE transactions on electron devices, 2005-12, Vol.52 (12), p.2616-2621 [Periódico revisado por pares]

New York, NY: Institute of Electrical and Electronics Engineers

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5
A 0.05-mm2 2.91-nJ/Decision Keyword-Spotting (KWS) Chip Featuring an Always-Retention 5T-SRAM in 28-nm CMOS
A 0.05-mm2 2.91-nJ/Decision Keyword-Spotting (KWS) Chip Featuring an Always-Retention 5T-SRAM in 28-nm CMOS
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A 0.05-mm2 2.91-nJ/Decision Keyword-Spotting (KWS) Chip Featuring an Always-Retention 5T-SRAM in 28-nm CMOS

Tan, Fei ; Wei-Han, Yu ; Ka-Fai Un ; Martins, Rui P ; Mak, Pui-In

IEEE journal of solid-state circuits, 2024-02, Vol.59 (2), p.626 [Periódico revisado por pares]

New York: The Institute of Electrical and Electronics Engineers, Inc. (IEEE)

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6
A 0.1-1.5 GHz 8-bit Inverter-Based Digital-to-Phase Converter Using Harmonic Rejection
A 0.1-1.5 GHz 8-bit Inverter-Based Digital-to-Phase Converter Using Harmonic Rejection
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A 0.1-1.5 GHz 8-bit Inverter-Based Digital-to-Phase Converter Using Harmonic Rejection

Ming-Shuan Chen ; Hafez, Amr Amin ; Chih-Kong Ken Yang

IEEE journal of solid-state circuits, 2013-11, Vol.48 (11), p.2681-2692 [Periódico revisado por pares]

New York, NY: IEEE

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A 0.1- mu A standby current, ground-bounce-immune 1-Mbit CMOS SRAM
A 0.1- mu A standby current, ground-bounce-immune 1-Mbit CMOS SRAM
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A 0.1- mu A standby current, ground-bounce-immune 1-Mbit CMOS SRAM

Ando, M. ; Okazawa, T. ; Furuta, H. ; Ohkawa, M. ; Monden, J. ; Kodama, N. ; Abe, K. ; Ishihara, H. ; Sasaki, I.

IEEE journal of solid-state circuits, 1989-12, Vol.24 (6), p.1708-1713 [Periódico revisado por pares]

IEEE

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8
A 0.1-μm 1.8-V 256-Mb phase-change random access memory (PRAM) with 66-MHz synchronous burst-read operation
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A 0.1-μm 1.8-V 256-Mb phase-change random access memory (PRAM) with 66-MHz synchronous burst-read operation

KANG, Sangbeom ; WOO YEONG CHO ; YU HWAN RO ; KIM, Suyeon ; HA, Choong-Duk ; KIM, Ki-Sung ; KIM, Young-Ran ; KIM, Du-Eung ; KWAK, Choong-Keun ; BYUN, Hyun-Geun ; JEONG, Gitae ; JEONG, Hongsik ; CHO, Beak-Hyung ; KIM, Kinam ; SHIN, Yunsueng ; LEE, Kwang-Jin ; LEE, Chang-Soo ; OH, Hyung-Rok ; CHOI, Byung-Gil ; QI WANG ; KIM, Hye-Jin ; PARK, Mu-Hui

IEEE journal of solid-state circuits, 2007, Vol.42 (1), p.210-218 [Periódico revisado por pares]

New York, NY: Institute of Electrical and Electronics Engineers

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A 0.13- \mu m CMOS 6 Gb/s/pin Memory Transceiver Using Pseudo-Differential Signaling for Removing Common-Mode Noise Due to SSN
A 0.13- \mu m CMOS 6 Gb/s/pin Memory Transceiver Using Pseudo-Differential Signaling for Removing Common-Mode Noise Due to SSN
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A 0.13- \mu m CMOS 6 Gb/s/pin Memory Transceiver Using Pseudo-Differential Signaling for Removing Common-Mode Noise Due to SSN

HA, Kyung-Soo ; KIM, Lee-Sup ; BAE, Seung-Jun ; PARK, Kwang-Il ; JOO SUN CHOI ; JUN, Young-Hyun ; KIM, Kinam

IEEE journal of solid-state circuits, 2009-11, Vol.44 (11), p.3146-3162 [Periódico revisado por pares]

New York, NY: IEEE

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10
A 0.13-μm 1-GS/s CMOS Discrete-Time FFT Processor for Ultra-Wideband OFDM Wireless Receivers
A 0.13-μm 1-GS/s CMOS Discrete-Time FFT Processor for Ultra-Wideband OFDM Wireless Receivers
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A 0.13-μm 1-GS/s CMOS Discrete-Time FFT Processor for Ultra-Wideband OFDM Wireless Receivers

LEHNE, Mark ; RAMAN, Sanjay

IEEE transactions on microwave theory and techniques, 2011-06, Vol.59 (6), p.1639-1650 [Periódico revisado por pares]

New York, NY: Institute of Electrical and Electronics Engineers

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