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0.13-μm 32-Mb/64-Mb embedded DRAM core with high efficient redundancy and enhanced testability
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0.13-μm 32-Mb/64-Mb embedded DRAM core with high efficient redundancy and enhanced testability

Kikukawa, H. ; Tomishima, S. ; Tsuji, T. ; Kawasaki, T. ; Sakamoto, S. ; Ishikawa, M. ; Abe, W. ; Tanizaki, H. ; Kato, H. ; Uchikoba, T. ; Inokuchi, T. ; Senoh, M. ; Fukushima, Y. ; Nirro, M. ; Maruta, M. ; Shibayama, A. ; Ooishi, T. ; Takahashi, K. ; Hidaka, H.

IEEE journal of solid-state circuits, 2002-07, Vol.37 (7), p.932-940 [Periódico revisado por pares]

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2
A 0.07 mm ^2 Asynchronous Logic CMOS Pulsed Receiver Based on Radio Events Self-Synchronization
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A 0.07 mm ^2 Asynchronous Logic CMOS Pulsed Receiver Based on Radio Events Self-Synchronization

Crepaldi, Marco ; Macis, Silvia ; Ros, Paolo Motto ; Demarchi, Danilo

IEEE transactions on circuits and systems. I, Regular papers, 2014-03, Vol.61 (3), p.750-763 [Periódico revisado por pares]

IEEE

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3
A 0.13 μm CMOS front-end, for DCS1800/UMTS/ 802.11b-g with multiband positive feedback low-noise amplifier
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A 0.13 μm CMOS front-end, for DCS1800/UMTS/ 802.11b-g with multiband positive feedback low-noise amplifier

LISCIDINI, Antonio ; BRANDOLINI, Massimo ; SANZOGNI, Davide ; CASTELLO, Rinaldo

IEEE journal of solid-state circuits, 2006-04, Vol.41 (4), p.981-989 [Periódico revisado por pares]

New York, NY: Institute of Electrical and Electronics Engineers

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4
A 0.18-μm CMOS IA-32 processor with a 4-GHz integer execution unit
A 0.18-μm CMOS IA-32 processor with a 4-GHz integer execution unit
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A 0.18-μm CMOS IA-32 processor with a 4-GHz integer execution unit

Hinton, G. ; Upton, M. ; Sager, D.J. ; Boggs, D. ; Carmean, D.M. ; Roussel, P. ; Chappell, T.I. ; Fletcher, T.D. ; Milshtein, M.S. ; Sprague, M. ; Samaan, S. ; Murray, R.

IEEE journal of solid-state circuits, 2001-11, Vol.36 (11), p.1617-1627 [Periódico revisado por pares]

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5
A 0.18 μm CMOS pipelined encoder for a 5 GS/s 4-bit flash analogue-to-digital converter
A 0.18 μm CMOS pipelined encoder for a 5 GS/s 4-bit flash analogue-to-digital converter
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A 0.18 μm CMOS pipelined encoder for a 5 GS/s 4-bit flash analogue-to-digital converter

Sheikhaei, S. ; Mirabbasi, S. ; Ivanov, A.

Canadian journal of electrical and computer engineering, 2005-09, Vol.30 (4), p.183-187 [Periódico revisado por pares]

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6
A 0.2 a hbox 1.2 V DC/DC Boost Converter for Power Harvesting Applications
A 0.2 a hbox 1.2 V DC/DC Boost Converter for Power Harvesting Applications
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A 0.2 a hbox 1.2 V DC/DC Boost Converter for Power Harvesting Applications

Richelli, A ; Colalongo, L ; Tonoli, S ; Kovacs-Vajna, Z M

IEEE transactions on power electronics, 2009-01, Vol.24 (6) [Periódico revisado por pares]

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7
A 0.24-nJ/bit Super-Regenerative Pulsed UWB Receiver in 0.18-μm CMOS
A 0.24-nJ/bit Super-Regenerative Pulsed UWB Receiver in 0.18-μm CMOS
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A 0.24-nJ/bit Super-Regenerative Pulsed UWB Receiver in 0.18-μm CMOS

THOPPAY, Prakash Egambaram ; DEHOLLAIN, Catherine ; GREEN, Michael M ; DECLERCQ, Michel J

IEEE journal of solid-state circuits, 2011-11, Vol.46 (11), p.2623-2634 [Periódico revisado por pares]

New York, NY: Institute of Electrical and Electronics Engineers

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8
A 0.25-3.25-GHz Wideband CMOS-RF Spectrum Sensor for Narrowband Energy Detection
A 0.25-3.25-GHz Wideband CMOS-RF Spectrum Sensor for Narrowband Energy Detection
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A 0.25-3.25-GHz Wideband CMOS-RF Spectrum Sensor for Narrowband Energy Detection

Khatri, Vishal ; Banerjee, Gaurab

IEEE transactions on very large scale integration (VLSI) systems, 2016-09, Vol.24 (9), p.2887-2898 [Periódico revisado por pares]

New York: IEEE

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9
A 0.25-μm CMOS 1.9-GHz PHS RF transceiver with a 150-kHz low-IF architecture
A 0.25-μm CMOS 1.9-GHz PHS RF transceiver with a 150-kHz low-IF architecture
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A 0.25-μm CMOS 1.9-GHz PHS RF transceiver with a 150-kHz low-IF architecture

JEONG, Hoesam ; YOO, Byoung-Joo ; HAN, Cheolkyu ; LEE, Sang-Yoon ; LEE, Kang-Yoon ; KIM, Suhwan ; JEONG, Deog-Kyoon ; KIM, Wonchan

IEEE journal of solid-state circuits, 2007-06, Vol.42 (6), p.1318-1327 [Periódico revisado por pares]

New York, NY: Institute of Electrical and Electronics Engineers

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10
A 0.2a2 Gb/s 6x OSR Receiver Using a Digitally Self-Adaptive Equalizer
A 0.2a2 Gb/s 6x OSR Receiver Using a Digitally Self-Adaptive Equalizer
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A 0.2a2 Gb/s 6x OSR Receiver Using a Digitally Self-Adaptive Equalizer

Gerfers, F ; den Besten, GW ; Petkov, P V ; Conder, JE ; Koellmann, A J

IEEE journal of solid-state circuits, 2008-01, Vol.43 (6) [Periódico revisado por pares]

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