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0–1 ILP-based run-time hierarchical energy optimization for heterogeneous cluster-based multi/many-core systems
0–1 ILP-based run-time hierarchical energy optimization for heterogeneous cluster-based multi/many-core systems
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0–1 ILP-based run-time hierarchical energy optimization for heterogeneous cluster-based multi/many-core systems

Yang, Simei ; Le Nours, Sébastien ; Mendez Real, Maria ; Pillement, Sébastien

Journal of systems architecture, 2021-06, Vol.116, p.102035, Article 102035 [Periódico revisado por pares]

Elsevier B.V

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2
0.13-μm 32-Mb/64-Mb embedded DRAM core with high efficient redundancy and enhanced testability
0.13-μm 32-Mb/64-Mb embedded DRAM core with high efficient redundancy and enhanced testability
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0.13-μm 32-Mb/64-Mb embedded DRAM core with high efficient redundancy and enhanced testability

Kikukawa, H. ; Tomishima, S. ; Tsuji, T. ; Kawasaki, T. ; Sakamoto, S. ; Ishikawa, M. ; Abe, W. ; Tanizaki, H. ; Kato, H. ; Uchikoba, T. ; Inokuchi, T. ; Senoh, M. ; Fukushima, Y. ; Nirro, M. ; Maruta, M. ; Shibayama, A. ; Ooishi, T. ; Takahashi, K. ; Hidaka, H.

IEEE journal of solid-state circuits, 2002-07, Vol.37 (7), p.932-940 [Periódico revisado por pares]

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3
A 0.0018 mm frequency-to-digital-converter-based CMOS smart temperature sensor
A 0.0018 mm frequency-to-digital-converter-based CMOS smart temperature sensor
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A 0.0018 mm frequency-to-digital-converter-based CMOS smart temperature sensor

Lee, Hokyu ; Kim, Kisoo ; Jung, Sangdon ; Song, Janghoon ; Kim, Jong-Kook ; Kim, Chulwoo

Analog integrated circuits and signal processing, 2010-08, Vol.64 (2), p.153-157 [Periódico revisado por pares]

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4
A 0.004% resolution & SAT<1.8 μson-chip adaptive anti-aging system using cuckoo intelligence-based algorithm in 65 nm CMOS
A 0.004% resolution & SAT<1.8 μson-chip adaptive anti-aging system using cuckoo intelligence-based algorithm in 65 nm CMOS
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A 0.004% resolution & SAT<1.8 μson-chip adaptive anti-aging system using cuckoo intelligence-based algorithm in 65 nm CMOS

Zhang, Yuejun ; Zhang, Haiming ; Wang, Pengjun ; Wu, Qiufeng ; Li, Gang

Integration (Amsterdam), 2021-05, Vol.78, p.135-143 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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5
A 0.0043-mm2 0.085-&#956;W/MHz Relaxation Oscillator Using Charge-Prestored Asymmetric Swings R- RC Network
A 0.0043-mm2 0.085-&#956;W/MHz Relaxation Oscillator Using Charge-Prestored Asymmetric Swings R- RC Network
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A 0.0043-mm2 0.085-μW/MHz Relaxation Oscillator Using Charge-Prestored Asymmetric Swings R- RC Network

Wei, Yuchen ; Yang, Shiheng ; Liu, Yueduo ; Bao, Rongxin ; Zhu, Zihao ; Lin, Jiahui ; Zhang, Zehao ; Chen, Yong ; Yin, Jun ; Mak, Pui-In ; Li, Qiang

IEEE transactions on very large scale integration (VLSI) systems, 2023-08, Vol.31 (8), p.1248 [Periódico revisado por pares]

New York: The Institute of Electrical and Electronics Engineers, Inc. (IEEE)

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6
A 0.015-mm ^} Inductorless 32-GHz Clock Generator With Wide Frequency-Tuning Range in 28-nm CMOS Technology
A 0.015-mm ^} Inductorless 32-GHz Clock Generator With Wide Frequency-Tuning Range in 28-nm CMOS Technology
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A 0.015-mm ^} Inductorless 32-GHz Clock Generator With Wide Frequency-Tuning Range in 28-nm CMOS Technology

Jeong, Gyu-Seob ; Kim, Wooseok ; Park, Jaejin ; Kim, Taeik ; Park, Hojin ; Jeong, Deog-Kyoon

IEEE transactions on circuits and systems. II, Express briefs, 2017-06, Vol.64 (6), p.655-659 [Periódico revisado por pares]

New York: IEEE

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7
A 0.016 mV/mA Cross-Regulation 5-Output SIMO DC-DC Buck Converter Using Output-Voltage-Aware Charge Control Scheme
A 0.016 mV/mA Cross-Regulation 5-Output SIMO DC-DC Buck Converter Using Output-Voltage-Aware Charge Control Scheme
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A 0.016 mV/mA Cross-Regulation 5-Output SIMO DC-DC Buck Converter Using Output-Voltage-Aware Charge Control Scheme

Ngoc-Son Pham ; Taegeun Yoo ; Kim, Tony Tae-Hyoung ; Chan-Gun Lee ; Kwang-Hyun Baek

IEEE transactions on power electronics, 2018-11, Vol.33 (11), p.9619-9630 [Periódico revisado por pares]

New York: IEEE

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8
A 0.07 mm[Formula Omitted] Asynchronous Logic CMOS Pulsed Receiver Based on Radio Events Self-Synchronization
A 0.07 mm[Formula Omitted] Asynchronous Logic CMOS Pulsed Receiver Based on Radio Events Self-Synchronization
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A 0.07 mm[Formula Omitted] Asynchronous Logic CMOS Pulsed Receiver Based on Radio Events Self-Synchronization

Crepaldi, Marco ; Macis, Silvia ; Ros, Paolo Motto ; Demarchi, Danilo

IEEE transactions on circuits and systems. I, Regular papers, 2014-03, Vol.61 (3), p.750 [Periódico revisado por pares]

New York: The Institute of Electrical and Electronics Engineers, Inc. (IEEE)

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9
A 0.1-2-GHz Quadrature Correction Loop for Digital Multiphase Clock Generation Circuits in 130-nm CMOS
A 0.1-2-GHz Quadrature Correction Loop for Digital Multiphase Clock Generation Circuits in 130-nm CMOS
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A 0.1-2-GHz Quadrature Correction Loop for Digital Multiphase Clock Generation Circuits in 130-nm CMOS

Raja, Immanuel ; Khatri, Vishal ; Zahir, Zaira ; Banerjee, Gaurab

IEEE transactions on very large scale integration (VLSI) systems, 2017-03, Vol.25 (3), p.1044-1053 [Periódico revisado por pares]

IEEE

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A 0.1-3.5-GHz Duty-Cycle Measurement and Correction Technique in 130-nm CMOS
A 0.1-3.5-GHz Duty-Cycle Measurement and Correction Technique in 130-nm CMOS
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A 0.1-3.5-GHz Duty-Cycle Measurement and Correction Technique in 130-nm CMOS

Raja, Immanuel ; Banerjee, Gaurab ; Zeidan, Mohamad A. ; Abraham, Jacob A.

IEEE transactions on very large scale integration (VLSI) systems, 2016-05, Vol.24 (5), p.1975-1983 [Periódico revisado por pares]

New York: IEEE

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