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1
Graph-Based Algorithms for Boolean Function Manipulation
Graph-Based Algorithms for Boolean Function Manipulation
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Graph-Based Algorithms for Boolean Function Manipulation

BRYANT, R. E

IEEE Trans. Comput.; (United States), 1986-08, Vol.C-35 (8), p.677-691 [Periódico revisado por pares]

New York, NY: IEEE

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2
Fat-trees: Universal networks for hardware-efficient supercomputing
Fat-trees: Universal networks for hardware-efficient supercomputing
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Fat-trees: Universal networks for hardware-efficient supercomputing

Leiserson, C. E.

IEEE transactions on computers, , Vol.C-34 (10), p.892-901 [Periódico revisado por pares]

New York, NY: IEEE

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3
Image Analysis Using Mathematical Morphology
Image Analysis Using Mathematical Morphology
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Image Analysis Using Mathematical Morphology

Haralick, Robert M. ; Sternberg, Stanley R. ; Zhuang, Xinhua

IEEE transactions on pattern analysis and machine intelligence, 1987-07, Vol.PAMI-9 (4), p.532-550 [Periódico revisado por pares]

Los Alamitos, CA: IEEE

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4
A Partitioning Strategy for Nonuniform Problems on Multiprocessors
A Partitioning Strategy for Nonuniform Problems on Multiprocessors
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A Partitioning Strategy for Nonuniform Problems on Multiprocessors

Berger, Marsha J. ; Bokhari, Shahid H.

IEEE Trans. Comput.; (United States), 1987-05, Vol.C-36 (5), p.570-580 [Periódico revisado por pares]

Legacy CDMS: IEEE

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5
The TAME project: towards improvement-oriented software environments
The TAME project: towards improvement-oriented software environments
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The TAME project: towards improvement-oriented software environments

Basili, V.R. ; Rombach, H.D.

IEEE transactions on software engineering, 1988-06, Vol.14 (6), p.758-773 [Periódico revisado por pares]

Legacy CDMS: IEEE

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6
A VLIW architecture for a trace scheduling compiler
A VLIW architecture for a trace scheduling compiler
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A VLIW architecture for a trace scheduling compiler

Colwell, R.P. ; Nix, R.P. ; O'Donnell, J.J. ; Papworth, D.B. ; Rodman, P.K.

IEEE Trans. Comput.; (United States), 1988-08, Vol.37 (8), p.967-979 [Periódico revisado por pares]

New York, NY: IEEE

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7
Generalized Hypercube and Hyperbus Structures for a Computer Network
Generalized Hypercube and Hyperbus Structures for a Computer Network
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Generalized Hypercube and Hyperbus Structures for a Computer Network

BHUYAN, L. N ; AGRAWAL, D. P

IEEE transactions on computers, 1984-04, Vol.C-33 (4), p.323-333 [Periódico revisado por pares]

New York, NY: IEEE

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8
Approximate analysis of fork/join synchronization in parallel queues
Approximate analysis of fork/join synchronization in parallel queues
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Approximate analysis of fork/join synchronization in parallel queues

Nelson, R. ; Tantawi, A.N.

IEEE Trans. Comput.; (United States), 1988-06, Vol.37 (6), p.739-743 [Periódico revisado por pares]

New York, NY: IEEE

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9
Deadlock-Free Message Routing in Multiprocessor Interconnection Networks
Deadlock-Free Message Routing in Multiprocessor Interconnection Networks
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Deadlock-Free Message Routing in Multiprocessor Interconnection Networks

DALLY, W. J ; SEITZ, C. L

IEEE Trans. Comput.; (United States), 1987-05, Vol.C-36 (5), p.547-553 [Periódico revisado por pares]

New York, NY: IEEE

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10
Machine-independent virtual memory management for paged uniprocessor and multiprocessor architectures
Machine-independent virtual memory management for paged uniprocessor and multiprocessor architectures
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Machine-independent virtual memory management for paged uniprocessor and multiprocessor architectures

Rashid, R. ; Tevanian, A. ; Young, M. ; Golub, D. ; Baron, R. ; Black, D. ; Bolosky, W.J. ; Chew, J.

IEEE Trans. Comput.; (United States), 1988-08, Vol.37 (8), p.896-908 [Periódico revisado por pares]

New York, NY: IEEE

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