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Passive solar building design
Passive solar building design
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Passive solar building design

Carter, C. ; De Villiers, J.

United States: Pergamon Books Inc.,Elmsford, NY 1987

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2
Fast 6464 multiplication using 1616 flow-through multipliers and Wallace trees
Fast 6464 multiplication using 1616 flow-through multipliers and Wallace trees
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Fast 6464 multiplication using 1616 flow-through multipliers and Wallace trees

Fox, M. ; Hastings, C. ; Rajpal, S.

United States: Electron Conventions,El Segundo, CA 1983

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3
Big, fast, and simple-algorithms, architecture, and components for high-end superminis
Big, fast, and simple-algorithms, architecture, and components for high-end superminis
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Big, fast, and simple-algorithms, architecture, and components for high-end superminis

Gordon, E. ; Hastings, C.

United States: Electron Conventions,El Segundo, CA 1982

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4
Impact of some architectural features of the implementation of a concurrent pascal machine
Impact of some architectural features of the implementation of a concurrent pascal machine
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Livro 		Adicionar ao Meu Espaço

Impact of some architectural features of the implementation of a concurrent pascal machine

Kim, K.H. ; Abou-el-naga, A.

United States: IEEE,New York, NY 1982

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5
High speed matrix processors using floating point representation
High speed matrix processors using floating point representation
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High speed matrix processors using floating point representation

Birkner, D.A.

United States: Electron Conventions,El Segundo, CA 1980

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6
Optical computing
Optical computing
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Optical computing

Feitelson, D.G.

United States: Cambridge, MA; The MIT Press 1988

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7
Radon and projection transform-based computer vision
Radon and projection transform-based computer vision
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Radon and projection transform-based computer vision

Sanz, J.L.C. ; Hinkle, E.B. ; Jain, A.K.

United States: Springer-Verlag New York Inc.,New York, NY 1987

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8
The SPUR instruction unit: An on-chip instruction cache memory for a high performance VLSI multiprocessor
The SPUR instruction unit: An on-chip instruction cache memory for a high performance VLSI multiprocessor
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The SPUR instruction unit: An on-chip instruction cache memory for a high performance VLSI multiprocessor

Duncombe, R.R.

United States: Univ. of California Press,Berkeley, CA 1987

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9
An introduction to distributed and parallel processing
An introduction to distributed and parallel processing
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An introduction to distributed and parallel processing

Sharp, J.A.

United States: Blackwell Scientific Pub.,Boston, MA 1986

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10
Highly parallel signal processing architectures; Proceedings of the Nineteenth Critical Reviews of Technology Conference, Los Angeles, CA, Jan. 21, 22, 1986
Highly parallel signal processing architectures; Proceedings of the Nineteenth Critical Reviews of Technology Conference, Los Angeles, CA, Jan. 21, 22, 1986
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Highly parallel signal processing architectures; Proceedings of the Nineteenth Critical Reviews of Technology Conference, Los Angeles, CA, Jan. 21, 22, 1986

Bromley, K.

United States: Society of Photo-Optical Instrumentation Engineers,Bellingham, WA 1986

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