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1
FPGA-Based Accelerators of Deep Learning Networks for Learning and Classification: A Review
FPGA-Based Accelerators of Deep Learning Networks for Learning and Classification: A Review
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FPGA-Based Accelerators of Deep Learning Networks for Learning and Classification: A Review

Shawahna, Ahmad ; Sait, Sadiq M. ; El-Maleh, Aiman

IEEE access, 2019, Vol.7, p.7823-7859 [Periódico revisado por pares]

Piscataway: IEEE

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2
TeraChem: A graphical processing unit‐accelerated electronic structure package for large‐scale ab initio molecular dynamics
TeraChem: A graphical processing unit‐accelerated electronic structure package for large‐scale ab initio molecular dynamics
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TeraChem: A graphical processing unit‐accelerated electronic structure package for large‐scale ab initio molecular dynamics

Seritan, Stefan ; Bannwarth, Christoph ; Fales, Bryan S. ; Hohenstein, Edward G. ; Isborn, Christine M. ; Kokkila‐Schumacher, Sara I. L. ; Li, Xin ; Liu, Fang ; Luehr, Nathan ; Snyder, James W. ; Song, Chenchen ; Titov, Alexey V. ; Ufimtsev, Ivan S. ; Wang, Lee‐Ping ; Martínez, Todd J.

Wiley interdisciplinary reviews. Computational molecular science, 2021-03, Vol.11 (2), p.e1494-n/a [Periódico revisado por pares]

Hoboken, USA: Wiley Periodicals, Inc

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3
GPUs and the Future of Parallel Computing
GPUs and the Future of Parallel Computing
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GPUs and the Future of Parallel Computing

Keckler, S. W. ; Dally, W. J. ; Khailany, B. ; Garland, M. ; Glasco, D.

IEEE MICRO, 2011-09, Vol.31 (5), p.7-17 [Periódico revisado por pares]

Los Alamitos: IEEE

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4
State-of-the-art in Heterogeneous Computing
State-of-the-art in Heterogeneous Computing
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State-of-the-art in Heterogeneous Computing

Brodtkorb, Andre R. ; Dyken, Christopher ; Hagen, Trond R. ; Hjelmervik, Jon M. ; Storaasli, Olaf O.

Scientific programming, 2010, Vol.18 (1), p.1-33 [Periódico revisado por pares]

Egypt: Hindawi Publishing Corporation

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5
Resiliency in numerical algorithm design for extreme scale simulations
Resiliency in numerical algorithm design for extreme scale simulations
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Resiliency in numerical algorithm design for extreme scale simulations

Agullo, Emmanuel ; Altenbernd, Mirco ; Anzt, Hartwig ; Bautista-Gomez, Leonardo ; Benacchio, Tommaso ; Bonaventura, Luca ; Bungartz, Hans-Joachim ; Chatterjee, Sanjay ; Ciorba, Florina M ; DeBardeleben, Nathan ; Drzisga, Daniel ; Eibl, Sebastian ; Engelmann, Christian ; Gansterer, Wilfried N ; Giraud, Luc ; Göddeke, Dominik ; Heisig, Marco ; Jézéquel, Fabienne ; Kohl, Nils ; Li, Xiaoye Sherry ; Lion, Romain ; Mehl, Miriam ; Mycek, Paul ; Obersteiner, Michael ; Quintana-Ortí, Enrique S ; Rizzi, Francesco ; Rüde, Ulrich ; Schulz, Martin ; Fung, Fred ; Speck, Robert ; Stals, Linda ; Teranishi, Keita ; Thibault, Samuel ; Thönnes, Dominik ; Wagner, Andreas ; Wohlmuth, Barbara

The international journal of high performance computing applications, 2022-03, Vol.36 (2), p.251-285 [Periódico revisado por pares]

London, England: SAGE Publications

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6
The IBM Blue Gene/Q Interconnection Fabric
The IBM Blue Gene/Q Interconnection Fabric
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The IBM Blue Gene/Q Interconnection Fabric

Dong Chen ; Eisley, N. A. ; Heidelberger, P. ; Senger, R. M. ; Sugawara, Y. ; Kumar, S. ; Salapura, V. ; Satterfield, D. ; Steinmacher-Burow, B. ; Parker, J.

IEEE MICRO, 2012-01, Vol.32 (1), p.32-43 [Periódico revisado por pares]

IEEE

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7
Scheduling computation and communication on a software-defined photonic Network-on-Chip architecture for high-performance real-time systems
Scheduling computation and communication on a software-defined photonic Network-on-Chip architecture for high-performance real-time systems
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Scheduling computation and communication on a software-defined photonic Network-on-Chip architecture for high-performance real-time systems

Temuçin, Hüseyin ; İmre, Kayhan M.

Journal of systems architecture, 2018-10, Vol.90, p.54-71 [Periódico revisado por pares]

Elsevier B.V

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8
Single-Cycle Multihop Asynchronous Repeated Traversal: A SMART Future for Reconfigurable On-Chip Networks
Single-Cycle Multihop Asynchronous Repeated Traversal: A SMART Future for Reconfigurable On-Chip Networks
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Single-Cycle Multihop Asynchronous Repeated Traversal: A SMART Future for Reconfigurable On-Chip Networks

Krishna, Tushar ; Chen, Chia-Hsin Owen ; Sunghyun Park ; Woo-Cheol Kwon ; Subramanian, Suvinay ; Chandrakasan, Anantha P. ; Li-Shiuan Peh

Computer (Long Beach, Calif.), 2013-10, Vol.46 (10), p.48-55 [Periódico revisado por pares]

New York: IEEE

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9
NOCA - A Notification-Oriented Computer Architecture: Prototype and Simulator
NOCA - A Notification-Oriented Computer Architecture: Prototype and Simulator
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NOCA - A Notification-Oriented Computer Architecture: Prototype and Simulator

Linhares, Robson R. ; Pordeus, Leonardo F. ; Simao, Jean M. ; Stadzisz, Paulo C.

IEEE access, 2020, Vol.8, p.37287-37304 [Periódico revisado por pares]

Piscataway: IEEE

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10
Energy-efficient multithreading for a hierarchical heterogeneous multicore through locality-cognizant thread generation
Energy-efficient multithreading for a hierarchical heterogeneous multicore through locality-cognizant thread generation
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Energy-efficient multithreading for a hierarchical heterogeneous multicore through locality-cognizant thread generation

La Fratta, Patrick A. ; Kogge, Peter M.

Journal of parallel and distributed computing, 2013-12, Vol.73 (12), p.1551-1562 [Periódico revisado por pares]

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