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Estudos e avaliações de compiladores para arquiteturas reconfiguráveis

Lopes, Joelmir José

Biblioteca Digital de Teses e Dissertações da USP; Universidade de São Paulo; Instituto de Ciências Matemáticas e de Computação 2007-05-25

Acesso online. A biblioteca também possui exemplares impressos.

  • Título:
    Estudos e avaliações de compiladores para arquiteturas reconfiguráveis
  • Autor: Lopes, Joelmir José
  • Orientador: Silva, Jorge Luiz e
  • Assuntos: Benchmarks; Hardware Reconfigurável; Linguagem C; Linguagens De Descrição De Hardware; Benchmark; C Language; Hardware Design Languages; Reconfigurable Hardware
  • Notas: Dissertação (Mestrado)
  • Descrição: Com o aumento crescente das capacidades dos circuitos integrado e conseqüente complexidade das aplicações, em especial as embarcadas, um requisito tem se tornado fundamental no desenvolvimento desses sistemas: ferramentas de desenvolvimento cada vez mais acessíveis aos engenheiros, permitindo, por exemplo, que um programa escrito em linguagem C possa ser convertido diretamente em hardware. Os FPGAs (Field Programmable Gate Array), elemento fundamental na caracterização de computação reconfigurável, é um exemplo desse crescimento, tanto em capacidade do CI como disponibilidade de ferramentas. Esse projeto teve como objetivos: estudar algumas ferramentas de conversão C, C++ ou Java para hardware reconfigurável; estudar benchmarks a serem executadas nessas ferramentas para obter desempenho das mesmas, e ter o domínio dos conceitos na conversão de linguagens de alto nível para hardware reconfigurável. A plataforma utilizada no projeto foi a da empresa Xilinx XUP V2P
  • DOI: 10.11606/D.55.2007.tde-13092007-102252
  • Editor: Biblioteca Digital de Teses e Dissertações da USP; Universidade de São Paulo; Instituto de Ciências Matemáticas e de Computação
  • Data de criação/publicação: 2007-05-25
  • Formato: Adobe PDF
  • Idioma: Português
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  • Realização: ABCD-USP USP   Logos de Redes Sociais: Freepik

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