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Layout design and verification

T Ohtsuki 1940- (Tatsuo)

Disponible en EPBC - Esc. Politécnica-Bib Central (621.3.049.771.15 Ad95 v.4 )(Obténgalo)

Título:
Layout design and verification
Autor: T Ohtsuki 1940- (Tatsuo)
Materias: Integrated circuits -- Very large scale integration -- Design and construction; Integrated circuits -- Verification; CIRCUITOS INTEGRADOS VLSI -- PROJETO E CONSTRUÇÃO; Electronic equipment Very large scale integrated circuits Design Applications of computer systems
Notas: Includes bibliographies and indexes
Títulos relacionados: Serie:Advances in CAD for VLSI v. 4
Editor: Amsterdam New York North-Holland New York, N.Y., U.S.A. Sole distributors for the U.S.A. and Canada, Elsevier Science Pub. Co.
Fecha de creación: 1986
Formato: ix, 356 p. ill. 25 cm.
Idioma: Inglés

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