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CAMP: a hierarchical cache architecture for multi-core mixed criticality processors
CAMP: a hierarchical cache architecture for multi-core mixed criticality processors
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CAMP: a hierarchical cache architecture for multi-core mixed criticality processors

Nair, Arun S. ; Patil, Geeta ; Agarwal, Archit ; Pai, Aboli V. ; Raveendran, Biju K. ; Punnekkat, Sasikumar

International journal of parallel, emergent and distributed systems, 2024-05, Vol.39 (3), p.317-352 [Periódico revisado por pares]

Abingdon: Taylor & Francis

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2
Decentralized Coded Caching Attains Order-Optimal Memory-Rate Tradeoff
Decentralized Coded Caching Attains Order-Optimal Memory-Rate Tradeoff
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Decentralized Coded Caching Attains Order-Optimal Memory-Rate Tradeoff

Maddah-Ali, Mohammad Ali ; Niesen, Urs

IEEE/ACM transactions on networking, 2015-08, Vol.23 (4), p.1029-1040 [Periódico revisado por pares]

IEEE

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3
ROCKY: A Robust Hybrid On-Chip Memory Kit for the Processors With STT-MRAM Cache Technology
ROCKY: A Robust Hybrid On-Chip Memory Kit for the Processors With STT-MRAM Cache Technology
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ROCKY: A Robust Hybrid On-Chip Memory Kit for the Processors With STT-MRAM Cache Technology

Talebi, Mahdi ; Salahvarzi, Arash ; Hosseini Monazzah, Amir Mahdi ; Skadron, Kevin ; Fazeli, Mahdi

IEEE transactions on computers, 2021-12, Vol.70 (12), p.2198-2210 [Periódico revisado por pares]

IEEE

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4
The Oracle Sparc T5 16-Core Processor Scales to Eight Sockets
The Oracle Sparc T5 16-Core Processor Scales to Eight Sockets
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The Oracle Sparc T5 16-Core Processor Scales to Eight Sockets

Feehrer, J. ; Jairath, S. ; Loewenstein, P. ; Sivaramakrishnan, R. ; Smentek, D. ; Turullols, S. ; Vahidsafa, A.

IEEE MICRO, 2013-03, Vol.33 (2), p.48-57 [Periódico revisado por pares]

Los Alamitos: IEEE

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5
An Energy-Efficient Memory Unit for Clustered Microarchitectures
An Energy-Efficient Memory Unit for Clustered Microarchitectures
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An Energy-Efficient Memory Unit for Clustered Microarchitectures

Bieschewski, Stefan ; Parcerisa, Joan-Manuel ; Gonzalez, Antonio

IEEE transactions on computers, 2016-08, Vol.65 (8), p.2631-2637 [Periódico revisado por pares]

New York: IEEE

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6
Data Backup Optimization for Nonvolatile SRAM in Energy Harvesting Sensor Nodes
Data Backup Optimization for Nonvolatile SRAM in Energy Harvesting Sensor Nodes
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Data Backup Optimization for Nonvolatile SRAM in Energy Harvesting Sensor Nodes

Yongpan Liu ; Jinshan Yue ; Hehe Li ; Qinghang Zhao ; Mengying Zhao ; Xue, Chun Jason ; Guangyu Sun ; Meng-Fan Chang ; Huazhong Yang

IEEE transactions on computer-aided design of integrated circuits and systems, 2017-10, Vol.36 (10), p.1660-1673 [Periódico revisado por pares]

New York: IEEE

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7
RAMON: Region-Aware Memory Controller
RAMON: Region-Aware Memory Controller
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Artigo 		Adicionar ao Meu Espaço

RAMON: Region-Aware Memory Controller

Marino, Mario D. ; Li, Kuan-Ching

IEEE transactions on very large scale integration (VLSI) systems, 2018-04, Vol.26 (4), p.697-710 [Periódico revisado por pares]

IEEE

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8
SynCron: Efficient Synchronization Support for Near-Data-Processing Architectures
SynCron: Efficient Synchronization Support for Near-Data-Processing Architectures
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Ata de Congresso 		Adicionar ao Meu Espaço

SynCron: Efficient Synchronization Support for Near-Data-Processing Architectures

Giannoula, Christina ; Vijaykumar, Nandita ; Papadopoulou, Nikela ; Karakostas, Vasileios ; Fernandez, Ivan ; Gomez-Luna, Juan ; Orosa, Lois ; Koziris, Nectarios ; Goumas, Georgios ; Mutlu, Onur

2021 IEEE International Symposium on High-Performance Computer Architecture (HPCA), 2021, p.263-276

IEEE

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9
The Execution Migration Machine: Directoryless Shared-Memory Architecture
The Execution Migration Machine: Directoryless Shared-Memory Architecture
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The Execution Migration Machine: Directoryless Shared-Memory Architecture

Keun Sup Shim ; Lis, Mieszko ; Khan, Omer ; Devadas, Srinivas

Computer (Long Beach, Calif.), 2015-09, Vol.48 (9), p.50-59 [Periódico revisado por pares]

New York: IEEE

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10
Neural Network-Based Performance Prediction for Task Migration on S-NUCA Many-Cores
Neural Network-Based Performance Prediction for Task Migration on S-NUCA Many-Cores
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Neural Network-Based Performance Prediction for Task Migration on S-NUCA Many-Cores

Rapp, Martin ; Pathania, Anuj ; Mitra, Tulika ; Henkel, Jorg

IEEE transactions on computers, 2021-10, Vol.70 (10), p.1691-1704 [Periódico revisado por pares]

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