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1
Scheduling techniques for GPU architectures with processing-in-memory capabilities
Scheduling techniques for GPU architectures with processing-in-memory capabilities
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Ata de Congresso 		Adicionar ao Meu Espaço

Scheduling techniques for GPU architectures with processing-in-memory capabilities

Pattnaik, Ashutosh ; Xulong Tang ; Adwait Jog ; Kayiran, Onur ; Mishra, Asit K. ; Kandemir, Mahmut T. ; Mutlu, Onur ; Das, Chita R.

2016 International Conference on Parallel Architecture and Compilation Techniques (PACT), 2016, p.31-44

ACM

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2
Digital Twin in the IoT Context: A Survey on Technical Features, Scenarios, and Architectural Models
Digital Twin in the IoT Context: A Survey on Technical Features, Scenarios, and Architectural Models
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Digital Twin in the IoT Context: A Survey on Technical Features, Scenarios, and Architectural Models

Minerva, Roberto ; Lee, Gyu Myoung ; Crespi, Noel

Proceedings of the IEEE, 2020-10, Vol.108 (10), p.1785-1824 [Periódico revisado por pares]

New York: IEEE

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3
Overview of the SpiNNaker System Architecture
Overview of the SpiNNaker System Architecture
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Overview of the SpiNNaker System Architecture

Furber, Steve B. ; Lester, David R. ; Plana, Luis A. ; Garside, Jim D. ; Painkras, Eustace ; Temple, Steve ; Brown, Andrew D.

IEEE transactions on computers, 2013-12, Vol.62 (12), p.2454-2467 [Periódico revisado por pares]

New York: IEEE

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4
Exploring Instruction Fusion Opportunities in General Purpose Processors
Exploring Instruction Fusion Opportunities in General Purpose Processors
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Exploring Instruction Fusion Opportunities in General Purpose Processors

Singh, Sawan ; Perais, Arthur ; Jimborean, Alexandra ; Ros, Alberto

2022 55th IEEE/ACM International Symposium on Microarchitecture (MICRO), 2022, p.199-212

Piscataway, NJ, USA: IEEE Press

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5
High Throughput/Gate AES Hardware Architectures Based on Datapath Compression
High Throughput/Gate AES Hardware Architectures Based on Datapath Compression
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High Throughput/Gate AES Hardware Architectures Based on Datapath Compression

Ueno, Rei ; Homma, Naofumi ; Morioka, Sumio ; Miura, Noriyuki ; Matsuda, Kohei ; Nagata, Makoto ; Bhasin, Shivam ; Mathieu, Yves ; Graba, Tarik ; Danger, Jean-Luc

IEEE transactions on computers, 2020-04, Vol.69 (4), p.534-548 [Periódico revisado por pares]

New York: IEEE

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6
Partially-Connected Neural Architecture Search for Reduced Computational Redundancy
Partially-Connected Neural Architecture Search for Reduced Computational Redundancy
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Partially-Connected Neural Architecture Search for Reduced Computational Redundancy

Xu, Yuhui ; Xie, Lingxi ; Dai, Wenrui ; Zhang, Xiaopeng ; Chen, Xin ; Qi, Guo-Jun ; Xiong, Hongkai ; Tian, Qi

IEEE transactions on pattern analysis and machine intelligence, 2021-09, Vol.43 (9), p.2953-2970 [Periódico revisado por pares]

United States: IEEE

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7
Optimizing the Convolution Operation to Accelerate Deep Neural Networks on FPGA
Optimizing the Convolution Operation to Accelerate Deep Neural Networks on FPGA
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Optimizing the Convolution Operation to Accelerate Deep Neural Networks on FPGA

Ma, Yufei ; Cao, Yu ; Vrudhula, Sarma ; Seo, Jae-sun

IEEE transactions on very large scale integration (VLSI) systems, 2018-07, Vol.26 (7), p.1354-1367 [Periódico revisado por pares]

New York: IEEE

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8
Anton 3: twenty microseconds of molecular dynamics simulation before lunch
Anton 3: twenty microseconds of molecular dynamics simulation before lunch
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Anton 3: twenty microseconds of molecular dynamics simulation before lunch

Shaw, David E. ; Adams, Peter J. ; Azaria, Asaph ; Bank, Joseph A. ; Batson, Brannon ; Bell, Alistair ; Bergdorf, Michael ; Bhatt, Jhanvi ; Butts, J. Adam ; Correia, Timothy ; Dirks, Robert M. ; Dror, Ron O. ; Eastwood, Michael P. ; Edwards, Bruce ; Even, Amos ; Feldmann, Peter ; Fenn, Michael ; Fenton, Christopher H. ; Forte, Anthony ; Gagliardo, Joseph ; Gill, Gennette ; Gorlatova, Maria ; Greskamp, Brian ; Grossman, J.P. ; Gullingsrud, Justin ; Harper, Anissa ; Hasenplaugh, William ; Heily, Mark ; Heshmat, Benjamin Colin ; Hunt, Jeremy ; Ierardi, Douglas J. ; Iserovich, Lev ; Jackson, Bryan L. ; Johnson, Nick P. ; Kirk, Mollie M. ; Klepeis, John L. ; Kuskin, Jeffrey S. ; Mackenzie, Kenneth M. ; Mader, Roy J. ; McGowen, Richard ; McLaughlin, Adam ; Moraes, Mark A. ; Nasr, Mohamed H. ; Nociolo, Lawrence J. ; O'Donnell, Lief ; Parker, Andrew ; Peticolas, Jon L. ; Pocina, Goran ; Predescu, Cristian ; Quan, Terry ; Salmon, John K. ; Schwink, Carl ; Shim, Keun Sup ; Siddique, Naseer ; Spengler, Jochen ; Szalay, Tamas ; Tabladillo, Raymond ; Tartler, Reinhard ; Taube, Andrew G. ; Theobald, Michael ; Towles, Brian ; Vick, William ; Wang, Stanley C. ; Wazlowski, Michael ; Weingarten, Madeleine J. ; Williams, John M. ; Yuh, Kevin A.

Proceedings of the International Conference for High Performance Computing, Networking, Storage and Analysis, 2021, p.1-11

New York, NY, USA: ACM

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9
On the features and challenges of security and privacy in distributed internet of things
On the features and challenges of security and privacy in distributed internet of things
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On the features and challenges of security and privacy in distributed internet of things

Roman, Rodrigo ; Zhou, Jianying ; Lopez, Javier

Computer networks (Amsterdam, Netherlands : 1999), 2013-07, Vol.57 (10), p.2266-2279 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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10
Cloud radio access network (C-RAN): a primer
Cloud radio access network (C-RAN): a primer
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Cloud radio access network (C-RAN): a primer

Wu, Jun ; Zhang, Zhifeng ; Hong, Yu ; Wen, Yonggang

IEEE network, 2015-01, Vol.29 (1), p.35-41 [Periódico revisado por pares]

New York: IEEE

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