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A 65 nm CMOS 7b 2 GS/s 20.7 mW Flash ADC With Cascaded Latch Interpolation
A 65 nm CMOS 7b 2 GS/s 20.7 mW Flash ADC With Cascaded Latch Interpolation
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A 65 nm CMOS 7b 2 GS/s 20.7 mW Flash ADC With Cascaded Latch Interpolation

Kim, Jong-In ; Oh, Dong-Ryeol ; Jo, Dong-Shin ; Sung, Ba-Ro-Saim ; Ryu, Seung-Tak

IEEE journal of solid-state circuits, 2015-10, Vol.50 (10), p.2319-2330 [Periódico revisado por pares]

New York: IEEE

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2
A 7-Bit Two-Step Flash ADC With Sample-and-Hold Sharing Technique
A 7-Bit Two-Step Flash ADC With Sample-and-Hold Sharing Technique
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A 7-Bit Two-Step Flash ADC With Sample-and-Hold Sharing Technique

Oh, Dong-Ryeol ; Seo, Min-Jae ; Ryu, Seung-Tak

IEEE journal of solid-state circuits, 2022-09, Vol.57 (9), p.2791-2801 [Periódico revisado por pares]

New York: IEEE

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3
A 65-nm CMOS 6-bit 2.5-GS/s 7.5-mW 8[Formula Omitted] Time-Domain Interpolating Flash ADC With Sequential Slope-Matching Offset Calibration
A 65-nm CMOS 6-bit 2.5-GS/s 7.5-mW 8[Formula Omitted] Time-Domain Interpolating Flash ADC With Sequential Slope-Matching Offset Calibration
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A 65-nm CMOS 6-bit 2.5-GS/s 7.5-mW 8[Formula Omitted] Time-Domain Interpolating Flash ADC With Sequential Slope-Matching Offset Calibration

Oh, Dong-Ryeol ; Kim, Jong-In ; Dong-Shin, Jo ; Woo-Chul, Kim ; Dong-Jin, Chang ; Seung-Tak Ryu

IEEE journal of solid-state circuits, 2019-01, Vol.54 (1), p.288 [Periódico revisado por pares]

New York: The Institute of Electrical and Electronics Engineers, Inc. (IEEE)

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4
A 28-nm CMOS 12-Bit 250-MS/s Voltage-Current-Time Domain 3-Stage Pipelined ADC
A 28-nm CMOS 12-Bit 250-MS/s Voltage-Current-Time Domain 3-Stage Pipelined ADC
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A 28-nm CMOS 12-Bit 250-MS/s Voltage-Current-Time Domain 3-Stage Pipelined ADC

Moon, Kyoung-Jun ; Oh, Dong-Ryeol ; Choi, Michael ; Ryu, Seung-Tak

IEEE transactions on circuits and systems. II, Express briefs, 2020-12, Vol.67 (12), p.2843-2847 [Periódico revisado por pares]

New York: IEEE

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5
A 1.5-MHz BW 81.2-dB SNDR Dual-Residue Pipeline ADC With a Fully Dynamic Noise-Shaping Interpolating-SAR ADC
A 1.5-MHz BW 81.2-dB SNDR Dual-Residue Pipeline ADC With a Fully Dynamic Noise-Shaping Interpolating-SAR ADC
Material Type:
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A 1.5-MHz BW 81.2-dB SNDR Dual-Residue Pipeline ADC With a Fully Dynamic Noise-Shaping Interpolating-SAR ADC

Chung, Jae-Hyun ; Kim, Ye-Dam ; Park, Chang-Un ; Park, Kun-Woo ; Oh, Dong-Ryeol ; Seo, Min-Jae ; Ryu, Seung-Tak

IEEE journal of solid-state circuits, 2024, p.1-11 [Periódico revisado por pares]

IEEE

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6
An 8-Bit 1-GS/s Asynchronous Loop-Unrolled SAR-Flash ADC With Complementary Dynamic Amplifiers in 28-nm CMOS
An 8-Bit 1-GS/s Asynchronous Loop-Unrolled SAR-Flash ADC With Complementary Dynamic Amplifiers in 28-nm CMOS
Material Type:
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An 8-Bit 1-GS/s Asynchronous Loop-Unrolled SAR-Flash ADC With Complementary Dynamic Amplifiers in 28-nm CMOS

Oh, Dong-Ryeol ; Moon, Kyoung-Jun ; Lim, Won-Mook ; Kim, Ye-Dam ; An, Eun-Ji ; Ryu, Seung-Tak

IEEE journal of solid-state circuits, 2021-04, Vol.56 (4), p.1216-1226 [Periódico revisado por pares]

New York: IEEE

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7
A 6-bit 10-GS/s 63-mW 4x TI time-domain interpolating flash ADC in 65-nm CMOS
A 6-bit 10-GS/s 63-mW 4x TI time-domain interpolating flash ADC in 65-nm CMOS
Material Type:
Ata de Congresso 		Adicionar ao Meu Espaço

A 6-bit 10-GS/s 63-mW 4x TI time-domain interpolating flash ADC in 65-nm CMOS

Dong-Ryeol Oh ; Jong-In Kim ; Min-Jae Seo ; Jin-Gwang Kim ; Seung-Tak Ryu

ESSCIRC Conference 2015 - 41st European Solid-State Circuits Conference (ESSCIRC), 2015, p.323-326

IEEE

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8
A 12-bit 10GS/s 16-Channel Time-Interleaved ADC with a Digital Processing Timing-Skew Background Calibration in 5nm FinFET
A 12-bit 10GS/s 16-Channel Time-Interleaved ADC with a Digital Processing Timing-Skew Background Calibration in 5nm FinFET
Material Type:
Ata de Congresso 		Adicionar ao Meu Espaço

A 12-bit 10GS/s 16-Channel Time-Interleaved ADC with a Digital Processing Timing-Skew Background Calibration in 5nm FinFET

Moon, Kyoung-Jun ; Oh, Dong-Ryeol ; Park, Young-Hyo ; Lee, Kyung-Hoon ; Park, Sun-Jae ; Lee, Sung-No ; Hwang, Hee-Chang ; Shin, Hyo-Chul ; Cho, Young-Jae ; Choi, Michael ; Shin, Jong-Shin

2022 IEEE Symposium on VLSI Technology and Circuits (VLSI Technology and Circuits), 2022, p.172-173

IEEE

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9
A 6-Bit 20 GS/s Time-Interleaved Two-Step Flash ADC in 40 nm CMOS
A 6-Bit 20 GS/s Time-Interleaved Two-Step Flash ADC in 40 nm CMOS
Material Type:
Artigo 		Adicionar ao Meu Espaço

A 6-Bit 20 GS/s Time-Interleaved Two-Step Flash ADC in 40 nm CMOS

Oh, Dong-Ryeol

Electronics (Basel), 2022-10, Vol.11 (19), p.3052 [Periódico revisado por pares]

Basel: MDPI AG

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10
Real-Time Point-Based Rendering Using Visibility Map
Real-Time Point-Based Rendering Using Visibility Map
Material Type:
Artigo 		Adicionar ao Meu Espaço

Real-Time Point-Based Rendering Using Visibility Map

SHIN, Byeong-Seok ; OH, Dong-Ryeol ; KANG, Daniel

IEICE Transactions on Information and Systems, 2008/01/01, Vol.E91.D(1), pp.124-131 [Periódico revisado por pares]

Oxford: The Institute of Electronics, Information and Communication Engineers

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