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0, 1, 2, many - A classroom occupancy monitoring system for smart public buildings
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Ata de Congresso 		Adicionar ao Meu Espaço

0, 1, 2, many - A classroom occupancy monitoring system for smart public buildings

Paci, Francesco ; Brunelli, Davide ; Benini, Luca

Proceedings of the 2014 Conference on Design and Architectures for Signal and Image Processing, 2014, p.1-6

European Electronic Chips & Systems design Initiat

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2
A 0.0018 mm frequency-to-digital-converter-based CMOS smart temperature sensor
A 0.0018 mm frequency-to-digital-converter-based CMOS smart temperature sensor
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A 0.0018 mm frequency-to-digital-converter-based CMOS smart temperature sensor

Lee, Hokyu ; Kim, Kisoo ; Jung, Sangdon ; Song, Janghoon ; Kim, Jong-Kook ; Kim, Chulwoo

Analog integrated circuits and signal processing, 2010-08, Vol.64 (2), p.153-157 [Periódico revisado por pares]

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3
A 0.0023 mm ^2/ch. Delta-Encoded, Time-Division Multiplexed Mixed-Signal ECoG Recording Architecture With Stimulus Artifact Suppression
A 0.0023 mm ^2/ch. Delta-Encoded, Time-Division Multiplexed Mixed-Signal ECoG Recording Architecture With Stimulus Artifact Suppression
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A 0.0023 mm ^2/ch. Delta-Encoded, Time-Division Multiplexed Mixed-Signal ECoG Recording Architecture With Stimulus Artifact Suppression

Uehlin, John P. ; Smith, William Anthony ; Pamula, V. Rajesh ; Perlmutter, Steve I. ; Rudell, Jacques C. ; Sathe, Visvesh S.

IEEE transactions on biomedical circuits and systems, 2020-04, Vol.14 (2), p.319-331 [Periódico revisado por pares]

United States: IEEE

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4
A 0.004% resolution & SAT<1.8 μson-chip adaptive anti-aging system using cuckoo intelligence-based algorithm in 65 nm CMOS
A 0.004% resolution & SAT<1.8 μson-chip adaptive anti-aging system using cuckoo intelligence-based algorithm in 65 nm CMOS
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A 0.004% resolution & SAT<1.8 μson-chip adaptive anti-aging system using cuckoo intelligence-based algorithm in 65 nm CMOS

Zhang, Yuejun ; Zhang, Haiming ; Wang, Pengjun ; Wu, Qiufeng ; Li, Gang

Integration (Amsterdam), 2021-05, Vol.78, p.135-143 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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5
A 0.0043-mm2 0.085-&#956;W/MHz Relaxation Oscillator Using Charge-Prestored Asymmetric Swings R-RC Network
A 0.0043-mm2 0.085-&#956;W/MHz Relaxation Oscillator Using Charge-Prestored Asymmetric Swings R-RC Network
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A 0.0043-mm2 0.085-μW/MHz Relaxation Oscillator Using Charge-Prestored Asymmetric Swings R-RC Network

Wei, Yuchen ; Yang, Shiheng ; Liu, Yueduo ; Bao, Rongxin ; Zhu, Zihao ; Lin, Jiahui ; Zhang, Zehao ; Chen, Yong ; Yin, Jun ; Mak, Pui-In ; Li, Qiang

IEEE transactions on very large scale integration (VLSI) systems, 2023-08, Vol.31 (8), p.1248-1252 [Periódico revisado por pares]

New York: IEEE

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6
A 0.008&#8208;mm2, 35&#8208;&#956;W, 8.87&#8208;ps&#8208;resolution CMOS time&#8208;to&#8208;digital converter using dual&#8208;slope architecture
A 0.008&#8208;mm2, 35&#8208;&#956;W, 8.87&#8208;ps&#8208;resolution CMOS time&#8208;to&#8208;digital converter using dual&#8208;slope architecture
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A 0.008‐mm2, 35‐μW, 8.87‐ps‐resolution CMOS time‐to‐digital converter using dual‐slope architecture

Kim, Yeomyung ; Shon, Doohyun ; Kim, Tae Wook

International journal of circuit theory and applications, 2017-04, Vol.45 (4), p.466-482 [Periódico revisado por pares]

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7
A 0.009 mm2 Wide-Tuning Range Automatically Placed-and-Routed ADPLL in 14-nm FinFET CMOS
A 0.009 mm2 Wide-Tuning Range Automatically Placed-and-Routed ADPLL in 14-nm FinFET CMOS
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A 0.009 mm2 Wide-Tuning Range Automatically Placed-and-Routed ADPLL in 14-nm FinFET CMOS

Moore, David M. ; Xanthopoulos, Thucydides ; Meninger, Scott ; Wentzloff, David D.

IEEE solid-state circuits letters, 2018-03, Vol.1 (3), p.74-77 [Periódico revisado por pares]

IEEE

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8
A 0.013 }^, 5 \mu\hbox , DC-Coupled Neural Signal Acquisition IC With 0.5 V Supply
A 0.013 }^, 5 \mu\hbox , DC-Coupled Neural Signal Acquisition IC With 0.5 V Supply
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A 0.013 }^, 5 \mu\hbox , DC-Coupled Neural Signal Acquisition IC With 0.5 V Supply

Muller, R. ; Gambini, S. ; Rabaey, J. M.

IEEE journal of solid-state circuits, 2012-01, Vol.47 (1), p.232-243 [Periódico revisado por pares]

IEEE

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9
A 0.013-mm2 0.53-mW/Gb/s 32-Gb/s Hybrid Analog Equalizer Under 21-dB Channel Loss in 65-nm CMOS
A 0.013-mm2 0.53-mW/Gb/s 32-Gb/s Hybrid Analog Equalizer Under 21-dB Channel Loss in 65-nm CMOS
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A 0.013-mm2 0.53-mW/Gb/s 32-Gb/s Hybrid Analog Equalizer Under 21-dB Channel Loss in 65-nm CMOS

Balachandran, Arya ; Chen, Yong ; Boon, Chirn Chye

IEEE transactions on very large scale integration (VLSI) systems, 2018-03, Vol.26 (3), p.599-603 [Periódico revisado por pares]

IEEE

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10
A 0.015-mm ^} Inductorless 32-GHz Clock Generator With Wide Frequency-Tuning Range in 28-nm CMOS Technology
A 0.015-mm ^} Inductorless 32-GHz Clock Generator With Wide Frequency-Tuning Range in 28-nm CMOS Technology
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A 0.015-mm ^} Inductorless 32-GHz Clock Generator With Wide Frequency-Tuning Range in 28-nm CMOS Technology

Jeong, Gyu-Seob ; Kim, Wooseok ; Park, Jaejin ; Kim, Taeik ; Park, Hojin ; Jeong, Deog-Kyoon

IEEE transactions on circuits and systems. II, Express briefs, 2017-06, Vol.64 (6), p.655-659 [Periódico revisado por pares]

New York: IEEE

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