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Least Common Ancestor Networks
Least Common Ancestor Networks
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Least Common Ancestor Networks

Scherson, Isaac D. ; Chien, Chi-Kai

VLSI Design, 1995-01, Vol.1995 (4), p.353-364 [Periódico revisado por pares]

Hindawi Limiteds

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2
PARTIF: Interactive System-level Partitioning
PARTIF: Interactive System-level Partitioning
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Artigo 		Adicionar ao Meu Espaço

PARTIF: Interactive System-level Partitioning

Ismail, Tarek Ben ; O'Brien, Kevin ; Jerraya, Ahmed

VLSI Design, 1995-01, Vol.1995 (3-4), p.333-345 [Periódico revisado por pares]

Hindawi Limiteds

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3
New Methods for the Construction of Test Cases for Partitioning Heuristics
New Methods for the Construction of Test Cases for Partitioning Heuristics
Material Type:
Artigo 		Adicionar ao Meu Espaço

New Methods for the Construction of Test Cases for Partitioning Heuristics

Saab, Youssef

VLSI Design, 1995-01, Vol.1995 (1), p.93-98 [Periódico revisado por pares]

Hindawi Limiteds

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4
A Comparative Study of Synchronous Clocking Schemes for VLSI Based Systems
A Comparative Study of Synchronous Clocking Schemes for VLSI Based Systems
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Artigo 		Adicionar ao Meu Espaço

A Comparative Study of Synchronous Clocking Schemes for VLSI Based Systems

El-Amawy, Ahmed ; Maheshwar, Umasankar

VLSI Design, 1995-01, Vol.1995 (1), p.81-92 [Periódico revisado por pares]

Hindawi Limiteds

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5
Embeddings into Hyper Petersen Networks: Yet Another Hypercube-Like Interconnection Topology
Embeddings into Hyper Petersen Networks: Yet Another Hypercube-Like Interconnection Topology
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Artigo 		Adicionar ao Meu Espaço

Embeddings into Hyper Petersen Networks: Yet Another Hypercube-Like Interconnection Topology

SAJAL K. DAS ; SABINE ÖHRING ; AMIT K. BANERJEE

VLSI Design, 1995-01, Vol.1995 (4), p.335-351 [Periódico revisado por pares]

Hindawi Limiteds

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6
Flipping Modules to Minimize Maximum Wire Length
Flipping Modules to Minimize Maximum Wire Length
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Artigo 		Adicionar ao Meu Espaço

Flipping Modules to Minimize Maximum Wire Length

Chong, Kyunrak ; Sahni, Sartaj

VLSI Design, 1995-01, Vol.1995 (1), p.37-41 [Periódico revisado por pares]

Hindawi Limiteds

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7
Input/Output Pad Placement Problem
Input/Output Pad Placement Problem
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Input/Output Pad Placement Problem

KHALED AL-ZAMEL ; MUKKAI S. KRISHNAMOORTHY

VLSI Design, 1995-01, Vol.1995 (1), p.53-57 [Periódico revisado por pares]

Hindawi Limiteds

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8
Hydrodynamic Models of Semiconductor Electron Transport at High Fields
Hydrodynamic Models of Semiconductor Electron Transport at High Fields
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Hydrodynamic Models of Semiconductor Electron Transport at High Fields

Ancona, M. G.

VLSI Design, 1995-01, Vol.1995 (2), p.101-114 [Periódico revisado por pares]

Hindawi Limiteds

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9
Electron Transport Using the Quantum Corrected Hydrodynamic Equations
Electron Transport Using the Quantum Corrected Hydrodynamic Equations
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Electron Transport Using the Quantum Corrected Hydrodynamic Equations

Kreskovsky, J. P. ; Grubin, H. L.

VLSI Design, 1995-01, Vol.1995 (2), p.179-200 [Periódico revisado por pares]

Hindawi Limiteds

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10
Resonant Tunneling in the Quantum Hydrodynamic Model
Resonant Tunneling in the Quantum Hydrodynamic Model
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Resonant Tunneling in the Quantum Hydrodynamic Model

Gardner, Carl L.

VLSI Design, 1995-01, Vol.1995 (2), p.201-210 [Periódico revisado por pares]

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