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1
Simulation of computer architectures: simulators, benchmarks, methodologies, and recommendations
Simulation of computer architectures: simulators, benchmarks, methodologies, and recommendations
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Simulation of computer architectures: simulators, benchmarks, methodologies, and recommendations

Yi, J.J. ; Lilja, D.J.

IEEE transactions on computers, 2006-03, Vol.55 (3), p.268-280 [Periódico revisado por pares]

New York: IEEE

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2
Cantor versus Harley: optimization and analysis of explicit formulae for hyperelliptic curve cryptosystems
Cantor versus Harley: optimization and analysis of explicit formulae for hyperelliptic curve cryptosystems
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Cantor versus Harley: optimization and analysis of explicit formulae for hyperelliptic curve cryptosystems

Wollinger, T. ; Pelzl, J. ; Paar, C.

IEEE transactions on computers, 2005-07, Vol.54 (7), p.861-872 [Periódico revisado por pares]

New York: IEEE

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3
High-speed parallel-prefix VLSI Ling adders
High-speed parallel-prefix VLSI Ling adders
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High-speed parallel-prefix VLSI Ling adders

Dimitrakopoulos, G. ; Nikolos, D.

IEEE transactions on computers, 2005-02, Vol.54 (2), p.225-231 [Periódico revisado por pares]

New York: IEEE

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4
Location-aided flooding: an energy-efficient data dissemination protocol for wireless-sensor networks
Location-aided flooding: an energy-efficient data dissemination protocol for wireless-sensor networks
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Location-aided flooding: an energy-efficient data dissemination protocol for wireless-sensor networks

Sabbineni, H. ; Chakrabarty, K.

IEEE transactions on computers, 2005-01, Vol.54 (1), p.36-46 [Periódico revisado por pares]

New York: IEEE

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5
A class of M-ary asymmetric symbol error correcting codes for data entry devices
A class of M-ary asymmetric symbol error correcting codes for data entry devices
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A class of M-ary asymmetric symbol error correcting codes for data entry devices

Kaneko, H. ; Fujiwara, E.

IEEE transactions on computers, 2004-02, Vol.53 (2), p.159-167 [Periódico revisado por pares]

New York: IEEE

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High bandwidth on-chip cache design
High bandwidth on-chip cache design
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High bandwidth on-chip cache design

Wilson, K.M. ; Olukotun, K.

IEEE transactions on computers, 2001-04, Vol.50 (4), p.292-307 [Periódico revisado por pares]

New York: IEEE

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7
Better adaptive diagnosis of hypercubes
Better adaptive diagnosis of hypercubes
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Better adaptive diagnosis of hypercubes

Kranakis, E. ; Pelc, A.

IEEE transactions on computers, 2000-10, Vol.49 (10), p.1013-1020 [Periódico revisado por pares]

New York: IEEE

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8
Augmenting loop tiling with data alignment for improved cache performance
Augmenting loop tiling with data alignment for improved cache performance
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Augmenting loop tiling with data alignment for improved cache performance

Panda, P.R. ; Nakamura, H. ; Dutt, N.D. ; Nicolau, A.

IEEE transactions on computers, 1999-02, Vol.48 (2), p.142-149 [Periódico revisado por pares]

IEEE

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9
Space/time trade-offs for higher radix modular multiplication using repeated addition
Space/time trade-offs for higher radix modular multiplication using repeated addition
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Space/time trade-offs for higher radix modular multiplication using repeated addition

Walter, C.D.

IEEE transactions on computers, 1997-02, Vol.46 (2), p.139-141 [Periódico revisado por pares]

New York, NY: IEEE

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10
Adaptive system-level diagnosis for hypercube multiprocessors
Adaptive system-level diagnosis for hypercube multiprocessors
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Adaptive system-level diagnosis for hypercube multiprocessors

Chao Feng ; Bhuyan, L.N. ; Lombardi, F.

IEEE transactions on computers, 1996-10, Vol.45 (10), p.1157-1170 [Periódico revisado por pares]

New York, NY: IEEE

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