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0.18um CMOS Technology in Implementation of S Box and a Modified S Box
0.18um CMOS Technology in Implementation of S Box and a Modified S Box
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Ata de Congresso 		Adicionar ao Meu Espaço

0.18um CMOS Technology in Implementation of S Box and a Modified S Box

Rahimunnisa, K. ; Rajeshkumar, K. ; Sureshkumar, S. Nagamalai, Dhinaharan ; Zizka, Jan ; Özcan, Abdulkadir

Recent Trends in Wireless and Mobile Networks, p.279-287 [Periódico revisado por pares]

Berlin, Heidelberg: Springer Berlin Heidelberg

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2
0.8 μm cmos implementation of weighted-order statistic image filter based on cellular neural network architecture
0.8 μm cmos implementation of weighted-order statistic image filter based on cellular neural network architecture
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Artigo 		Adicionar ao Meu Espaço

0.8 μm cmos implementation of weighted-order statistic image filter based on cellular neural network architecture

Kowalski, J

IEEE transactions on neural networks, 2003-09, Vol.14 (5), p.1366-1374

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3
0.9 to 2.5 GHz Sub-Sampling Receiver Architecture for Dynamically Reconfigurable SDR
0.9 to 2.5 GHz Sub-Sampling Receiver Architecture for Dynamically Reconfigurable SDR
Material Type:
Ata de Congresso 		Adicionar ao Meu Espaço

0.9 to 2.5 GHz Sub-Sampling Receiver Architecture for Dynamically Reconfigurable SDR

Kale, Ajinkya ; Sturm, Johannes ; Pasupureddi, Vijaya Sankara Rao

2018 IEEE Computer Society Annual Symposium on VLSI (ISVLSI), 2018, p.316-320

IEEE

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4
1-2 Brother Trees or AVL Trees Revisited
1-2 Brother Trees or AVL Trees Revisited
Material Type:
Artigo 		Adicionar ao Meu Espaço

1-2 Brother Trees or AVL Trees Revisited

Ottmann, T. ; Wood, D.

Computer journal, 1980-08, Vol.23 (3), p.248-255 [Periódico revisado por pares]

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5
1-Bit compressive sensing encryption in multicarrier systems
1-Bit compressive sensing encryption in multicarrier systems
Material Type:
Ata de Congresso 		Adicionar ao Meu Espaço

1-Bit compressive sensing encryption in multicarrier systems

Lee, Yonggu ; Jo, Hanseong ; Choi, Jinho

2018 IEEE Wireless Communications and Networking Conference (WCNC), 2018, p.1-6

IEEE

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6
1.1V to +1.1V 3:1 Power Switch Architecture for Controlling Body Bias of SRAM Array in 28nm UTBB CMOS FDSOI
1.1V to +1.1V 3:1 Power Switch Architecture for Controlling Body Bias of SRAM Array in 28nm UTBB CMOS FDSOI
Material Type:
Ata de Congresso 		Adicionar ao Meu Espaço

1.1V to +1.1V 3:1 Power Switch Architecture for Controlling Body Bias of SRAM Array in 28nm UTBB CMOS FDSOI

Chhabra, Amit ; Rana, Vikas

2016 29th International Conference on VLSI Design and 2016 15th International Conference on Embedded Systems (VLSID), 2016, p.179-184

IEEE

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7
1,2, Pause: Lets Start by Meaningfully Navigating the Current Online Authentication Solutions Space
1,2, Pause: Lets Start by Meaningfully Navigating the Current Online Authentication Solutions Space
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Ata de Congresso 		Adicionar ao Meu Espaço

1,2, Pause: Lets Start by Meaningfully Navigating the Current Online Authentication Solutions Space

Loutfi, Ijlal ; Jøsang, Audun Marsh, Stephen ; Dimitrakos, Theo ; Damsgaard Jensen, Christian ; Murayama, Yuko

Trust Management IX, p.165-176

Cham: Springer International Publishing

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8
{1,2,3}-Restricted Connectivity of $(n,k)$-Enhanced Hypercubes
{1,2,3}-Restricted Connectivity of $(n,k)$-Enhanced Hypercubes
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Artigo 		Adicionar ao Meu Espaço

{1,2,3}-Restricted Connectivity of $(n,k)$-Enhanced Hypercubes

Yu, Hui ; Yang, Jiejie ; Lin, Limei ; Huang, Yanze ; Li, Jine ; Chen, Riqing

Computer journal, 2020-09, Vol.63 (9), p.1355-1371 [Periódico revisado por pares]

Oxford University Press

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9
A 0.18 μm CMOS multilayer and low resistive load architecture dedicated for LoC applications
A 0.18 μm CMOS multilayer and low resistive load architecture dedicated for LoC applications
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Ata de Congresso 		Adicionar ao Meu Espaço

A 0.18 μm CMOS multilayer and low resistive load architecture dedicated for LoC applications

Miled, Mohamed Amine ; Sawan, Mohamad

2013 IEEE 11th International New Circuits and Systems Conference (NEWCAS), 2013, p.1-4

IEEE

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10
A 0.7-Microsecond Ferrite Core Memory
A 0.7-Microsecond Ferrite Core Memory
Material Type:
Artigo 		Adicionar ao Meu Espaço

A 0.7-Microsecond Ferrite Core Memory

Rhodes, W. H. ; Russell, L. A. ; Sakalay, F. E. ; Whalen, R. M.

IBM journal of research and development, 1961-07, Vol.5 (3), p.174-182 [Periódico revisado por pares]

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